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原创【正点原子FPGA连载】第五章Qt 信号与槽摘自【正点原子】【正点原子】DFZU2EG_4EV MPSoc之嵌入式Qt开发指南_V1.0

1）实验平台：正点原子MPSoC开发板2）平台购买地址：https://detail.tmall.com/item.htm?id=6924508746703）全套实验源码+手册+视频下载地址： http://www.openedv.com/thread-340252-1-1.html在这章节里，我们学习Qt的信号与槽，这里分一个章节来学习这个Qt的信号与槽，可见这个信号与槽有多么重要。在学习Qt的过程中，信号与槽是必不可少的部分，也是Qt编程的基础，是Qt编程的一大创新（其实与C#的事件很相似，编程都是

2023-03-28 14:33:10 15

原创【正点原子FPGA连载】第四章使用Qt Designer开发摘自【正点原子】【正点原子】DFZU2EG_4EV MPSoc之嵌入式Qt开发指南_V1.0

1）实验平台：正点原子MPSoC开发板2）平台购买地址：https://detail.tmall.com/item.htm?id=6924508746703）全套实验源码+手册+视频下载地址： http://www.openedv.com/thread-340252-1-1.html本章将简介使用Qt Creator里自带的Qt Designer，使用Qt Designer比较方便的构造UI界面。特点是方便布局，比较形象。在这小节里我们继续学习如何使用Qt Designer开发程序，Qt Designe

2023-03-28 14:30:15 7

原创【正点原子FPGA连载】第三章初识Qt摘自【正点原子】【正点原子】DFZU2EG_4EV MPSoc之嵌入式Qt开发指南_V1.0

1）实验平台：正点原子MPSoC开发板2）平台购买地址：https://detail.tmall.com/item.htm?id=6924508746703）全套实验源码+手册+视频下载地址： http://www.openedv.com/thread-340252-1-1.html本章将介绍什么是Qt，同时与大家一起安装Qt，根据不同用户的编程习惯，这里我们介绍在Windows安装和在Ubuntu下安装。教程重点是以在Ubuntu环境下编写Qt作讲解。配置Ubuntu下的Qt Creator的中文输入

2023-03-25 15:45:01 40

原创【正点原子FPGA连载】第二章C++基础摘自【正点原子】【正点原子】DFZU2EG_4EV MPSoc之嵌入式Qt开发指南_V1.0

1）实验平台：正点原子MPSoC开发板2）平台购买地址：https://detail.tmall.com/item.htm?id=6924508746703）全套实验源码+手册+视频下载地址： http://www.openedv.com/thread-340252-1-1.html在第二章C++基础里，这里主要介绍概念为主，主要介绍C++与C语言中常用的不同点，和一些新的变化。其中不会去说指针、数据类型、变量类型、判断和循环等这些知识，这些和C语言基本是一样使用的。我们主要学习C++的面向对象编程，对

2023-03-25 15:40:51 28

原创【正点原子FPGA连载】第一章在Ubuntu下编写C++摘自【正点原子】【正点原子】DFZU2EG_4EV MPSoc之嵌入式Qt开发指南_V1.0

C++（c plus plus）是一种静态类型的、编译式的、通用的、大小写敏感的、不规则的编程语言，支持过程化编程、面向对象编程和泛型编程。C++ 被认为是一种中级语言，它综合了高级语言和低级语言的特点。C++是由Bjarne Stroustrup于1979年在新泽西州美利山贝尔实验室开始设计开发的。C++进一步扩充和完善了C语言，最初命名为带类的C，后来在 1983 年更名为 C++。C++ 是C的一个超集，事实上，任何合法的C程序都是合法的C++程序。

2023-03-25 15:29:37 27

原创【正点原子Linux连载】第二章交叉编译环境搭建摘自【正点原子】ATK-DLRV1126Qt开发环境搭建手册

1）实验平台：正点原子RV1126 Linux开发板2）平台购买地址：https://detail.tmall.com/item.htm?id=6921762657493）全套实验源码+手册+视频下载地址： http://www.openedv.com/thread-340252-1-1.html为了能够在Ubuntu下qt creator IDE上开发、编译ATK-DLRV1126平台（ARM 32bit）Qt应用程序，我们需要对其进行相应的配置，包括qmake、ATK-DLRV1126交叉编译器等配

2023-03-24 18:11:09 31

原创【正点原子FPGA连载】第一章Ubuntu系统安装摘自【正点原子】DFZU2EG/4EV MPSoC 之FPGA开发指南V1.0

1）实验平台：正点原子MPSoC开发板2）平台购买地址：https://detail.tmall.com/item.htm?id=6924508746703）全套实验源码+手册+视频下载地址： http://www.openedv.com/thread-340252-1-1.htmlLinux的开发需要在Linux系统下进行，这就要求我们的PC主机安装Linux系统，本书我们选择Ubuntu这个Linux发行版系统。本章讲解如何安装虚拟机，以及如何在虚拟机中安装Ubuntu系统，安装完成以后如何做简单的

2023-03-23 18:30:51 32

原创【正点原子FPGA连载】第三十五章基于UDP协议的远程更新QSPI Flash实验摘自【正点原子】DFZU2EG_4EV MPSoC之嵌入式Vitis开发指南

UDP由于本身的尽最大能力交付问题，即不稳定可靠，在传输文件上并不合适，在网络性能较好时，能够不丢失数据，当网络性能较差时，会面临数据丢失的问题，可靠性无法保证。UDP更适合于传输音视频这种对实时性要求高而又能容忍丢失数据的场合。当然了，也可以在UDP协议之上，编写一个能够确保可靠性的应用层协议，如TFTP协议。本实验只是将《基于TCP协议的远程更新QSPI Flash实验》中的TCP协议实现改为UDP协议实现，了解如何使用UDP协议实现远程更新QSPI。

2023-03-17 16:15:36 93

原创【正点原子FPGA连载】第三十四章基于TCP协议的远程更新QSPI Flash实验摘自【正点原子】DFZU2EG_4EV MPSoC之嵌入式Vitis开发指南

第三十四章基于TCP协议的远程更新QSPI Flash实验在《程序固化实验》中，我们了解了如何通过Vitis软件将BOOT.bin文件固化到QSPI Flash中，这种现场通过Vitis软件固化的方式很常用，重新固化也很方便。然而在实际应用中，通过Vitis软件固化或重新固化Flash并不一定可行，如产品量产发布后进入维护升级阶段，若需要修改、更新Flash中的BOOT.bin文件，遇到产品安放在高危环境中或产品整合到大型机械内部，或产品生产时没有预留JTAG口，而是预先将程序固化到Flash中等情况，使

2023-03-16 15:39:01 46

原创【正点原子FPGA连载】第三十三章基于lwip的tftp server实验摘自【正点原子】DFZU2EG_4EV MPSoC之嵌入式Vitis开发指南

一、TFTP简介（基于RFC1350版本）简单文件传输协议TFTP (Trivial File Transfer Protocol) 是TCP/IP协议族中的一个用来在客户机与服务器之间进行简单文件传输，基于UDP实现的应用层协议，提供不复杂、开销不大的文件传输服务，端口号为 69。为了保证文件可靠传输TFTP有自己的差错改正措施。TFTP 只支持文件传输、不支持交互、没有庞大的命令集，也没有目录列表功能，以及不能对用户进行身份鉴别。

2023-03-16 15:34:25 634

原创【正点原子FPGA连载】第三十二章基于lwip的TCP服务器性能测试实验摘自【正点原子】DFZU2EG_4EV MPSoC之嵌入式Vitis开发指南

1)TCP 协议简介TCP（Transmission Control Protocol，传输控制协议）是一种面向连接的、可靠的、基于字节流的传输层通信协议。在开放系统互连OSI参考模型中，它完成第四层传输层所指定的功能，UDP（User Datagram Protocol，用户数据报协议）是同一层内另一个重要的传输协议。在因特网协议族（Internet protocol suite）中，TCP层是位于IP层之上，应用层之下的中间层。

2023-03-14 10:07:58 70

原创【正点原子FPGA连载】第三十一章基于lwip的echo server实验摘自【正点原子】DFZU2EG_4EV MPSoC之嵌入式Vitis开发指南

1)TCP/IP协议简介TCP/IP协议中文名为传输控制协议/因特网互联协议，又名网络通讯协议，是Internet最基本的协议、Internet国际互联网络的基础，由网络层的IP协议和传输层的TCP协议组成。TCP/IP定义了电子设备如何连入因特网，以及数据如何在它们之间传输的标准。协议采用了4层的层级结构，每一层都呼叫它的下一层所提供的协议来完成自己的需求。通俗而言：TCP负责发现传输的问题，一有问题就发出信号，要求重新传输，直到所有数据安全正确地传输到目的地。

2023-03-14 10:01:14 63

原创【正点原子FPGA连载】第三十章双目OV5640摄像头LCD显示实验摘自【正点原子】DFZU2EG_4EV MPSoC之嵌入式Vitis开发指南

摄像头在日常生活中非常常见，一般分为单目摄像头、双目摄像头和多目摄像头。单目摄像头凭借着成本低和易用的特点，目前使用最为广泛；双目摄像头主要应用于单目摄像头无法胜任的场合，如三维坐标定位等；当然针对一些特殊的应用，目前市场上也出现了多目摄像头，以应对更加复杂的场景。我们在前面的例程中实现了单目OV5640摄像头LCD屏的实时显示，本章我们在此基础上实现双目OV5640摄像头的实时显示，即两路摄像头的图像视频显示在LCD屏上，并叠加两个标记层的显示。

2023-03-14 09:53:16 176

原创【正点原子FPGA连载】第二十九章TFT LCD画板实验摘自【正点原子】DFZU2EG_4EV MPSoC之嵌入式Vitis开发指南

目前最常用的触摸屏有两种：电阻式触摸屏与电容式触摸屏。下面，我们来分别介绍。（一）电阻式触摸屏：在Iphone面世之前，几乎清一色的都是使用电阻式触摸屏，电阻式触摸屏利用压力感应进行触点检测控制，需要直接应力接触，通过检测电阻来定位触摸位置。正点原子2.8/3.5寸LCD模块自带的触摸屏都属于电阻式触摸屏，下面简单介绍下电阻式触摸屏的原理。

2023-03-10 10:02:43 142

原创【正点原子FPGA连载】第二十八章OV5640 DP显示实验摘自【正点原子】DFZU2EG_4EV MPSoC之嵌入式Vitis开发指南

AXI4接口总共有三种类型，它们分别是AXI4(AXI4-Full)、AXI4-Lite和AXI4-Stream，不同的接口类型适用于不同的应用场景，下面对这三个接口做简要说明。AXI4-Full：最高性能的接口，适合存储器映射的通信，支持每个地址阶段最高256个数据传输周期的批量传输，适合于更需要持久、高速性能的IP。AXI4-Lite：AXI4-Full接口的轻量级版本，用于存储器映射的单次数据通信会话。这个版本的好处是简化了的接口占用较少的逻辑部分面积。

2023-03-10 09:55:47 104

原创【正点原子FPGA连载】第二十七章OV5640摄像头LCD显示摘自【正点原子】DFZU2EG_4EV MPSoC之嵌入式Vitis开发指南

OV5640是一款1/4英寸单芯片图像传感器，其感光阵列达到25921944（即500W像素），能实现最快15fps QSXVGA（25921944）或者90fps VGA（640*480）分辨率的图像采集。传感器采用OmniVision推出的OmniBSI（背面照度）技术，使传感器达到更高的性能，如高灵敏度、低串扰和低噪声。传感器内部集成了图像处理的功能，包括自动曝光控制（AEC）、自动白平衡（AWB）等。

2023-03-09 16:13:14 195

原创【正点原子FPGA连载】第二十六章SD卡读BMP图片DP显示实验摘自【正点原子】DFZU2EG_4EV MPSoC之嵌入式Vitis开发指南

因为SD卡读取BMP图片和DP显示在前面的“SD卡读取BMP图片LCD显示实验”和“DP彩条显示实验”中都有过详细的介绍了，这里就不再重复赘述。

2023-03-09 16:02:42 69

原创【正点原子FPGA连载】第二十五章SD卡读BMP图片HDMI显示实验摘自【正点原子】DFZU2EG_4EV MPSoC之嵌入式Vitis开发指南

在“SD卡读BMP图片LCD显示实验”的简介部分，我们详细介绍了BMP图片的数据格式；另外在《MPSOC FPGA开发指南》中的“HDMI彩条显示实验”一章，我们介绍了HDMI接口。如果大家对这两部分的内容不熟悉的话，可以参考相应的章节，此处就不再赘述了。25.2实验任务本章的实验任务是使用MPSOC开发板读取SD卡中存放的BMP格式图片，分辨率为1920*1080，并将其显示在HDMI显示器上。

2023-03-09 10:31:30 92

原创【正点原子FPGA连载】第二十四章SD卡读BMP图片LCD显示实验摘自【正点原子】DFZU2EG_4EV MPSoC之嵌入式Vitis开发指南

我们常用的图片格式有很多，一般最常用的有四种：JPEG（或JPG）、BMP、PNG和GIF。其中JPEG（或JPG）、BMP和PNG是静态图片，而GIF则是动态图片。BMP全称是Bitmap（位图）的缩写，其特点是几乎不进行压缩，由此导致了它与生俱来的缺点，即占用磁盘空间较大；而其它三种图片格式均进行了不同程度的压缩，以节省磁盘空间。在本次实验中，我们选择使用不压缩的BMP图片格式，解析该格式的图片最为简单。

2023-03-09 09:46:42 115

原创【正点原子FPGA连载】第二十三章PS通过VDMA驱动LCD显示实验摘自【正点原子】DFZU2EG_4EV MPSoC之嵌入式Vitis开发指南

AXI VDMA（AXI Video Direct Memory Access，以下简称VDMA），是Xilinx提供的软核IP。其功能和AXI DMA（以下简称DMA）有些类似，都可以为存储器或者AXI4-Stream类目标外设之间提供高带宽直接存储器存取。和DMA相比，VDMA增加了帧缓存的缓冲机制和同步锁相（GenLock）等功能，是为了针对视频图像应用而做的升级版的DMA。VDMA集成了视频专用功能，如帧同步和2D DMA传输等，非常适合基于MPSOC架构上的图像和视频处理，缩短了开发周期。

2023-03-08 10:16:59 107

原创【正点原子FPGA连载】第二十二章IP封装与接口定义实验摘自【正点原子】DFZU2EG_4EV MPSoC之嵌入式Vitis开发指南

在前面的实验中，我们通过调用各种功能的IP核，可以快速地搭建Block Design。除了调用Vivado IP库中的IP核，我们还可以创建或封装自己的IP核。在本章我们将学习如何把HDL实现的功能模块封装成IP核，以及如何定义新的接口类型。本章包括以下几个部分：2222.1简介22.2实验任务22.3硬件设计22.4程序设计22.5下载验证Vivado开发工具集成了大量Xilinx官方IP核以及第三方厂商提供的IP核，如图 22.1.1所示。

2023-03-03 10:19:56 462

原创【正点原子FPGA连载】第二十一章AXI DMA环路测试摘自【正点原子】DFZU2EG_4EV MPSoC之嵌入式Vitis开发指南

DMA是所有现代计算机的重要特色，它允许不同速度的硬件设备进行沟通，而不需要依于中央处理器的大量中断负载。否则，中央处理器需要从来源把每一片段的数据复制到寄存器，然后把它们再次写回到新的地方。在这个时间里，中央处理器就无法执行其它的任务。DMA是用硬件实现存储器与存储器之间或存储器与I/O设备之间直接进行高速数据传输。使用DMA时，CPU向DMA控制器发出一个存储传输请求，这样当DMA控制器在传输的时候，CPU执行其它操作，传输操作完成时DMA以中断的方式通知CPU。

2023-03-01 10:15:58 513

原创【正点原子FPGA连载】第二十章AXI4接口之DDR读写实验摘自【正点原子】DFZU2EG_4EV MPSoC之嵌入式Vitis开发指南

MPSOC将高性能ARM Cotex-A系列处理器与高性能FPGA在单芯片内紧密结合，为设计带来了如减小体积和功耗、降低设计风险，增加设计灵活性等诸多优点。在将不同工艺特征的处理器与FPGA融合在一个芯片上之后，片内处理器与FPGA之间的互联通路就成了MPSOC芯片设计的重中之重。如果Cotex-A53与FPGA之间的数据交互成为瓶颈，那么处理器与FPGA结合的性能优势就不能发挥出来。

2023-02-27 10:20:40 1095 1

原创【正点原子FPGA连载】第十九章FreeRtos Hello World实验摘自【正点原子】DFZU2EG_4EV MPSoC之嵌入式Vitis开发指南

什么是FreeRtos？Free即免费的，RTOS全称是Real Time Operating System，中文就是实时操作系统。注意，RTOS不是指某一个确定的系统，而是指一类系统，比如uC/OS，FreeRTOS，RTX，RT-Thread等这些都是RTOS类操作系统。操作系统允许多个任务同时运行，这个叫做多任务。实际上，一个处理器核心在某一时刻只能运行一个任务。操作系统中任务调度器的责任就是决定在某一时刻究竟运行哪个任务。

2023-02-27 10:16:40 1421

原创【正点原子FPGA连载】第十八章基于BRAM的PS和PL的数据交互摘自【正点原子】DFZU2EG_4EV MPSoC之嵌入式Vitis开发指南

BRAM（Block RAM）是PL部分的存储器阵列，PS和PL通过对BRAM进行读写操作，来实现数据的交互。在PL中，通过输出时钟、地址、读写控制等信号来对BRAM进行读写操作（关于BRAM的操作时序，请参考“RAM IP核实验”）；而在PS中，处理器并不需要直接驱动BRAM的端口，而是通过AXI BRAM控制器来对BRAM进行读写操作。AXI BRAM控制器是集成在Vivado设计软件中的软核，可以配置成AXI4-lite接口模式或者AXI4接口模式。

2023-02-27 10:11:42 1420

原创【正点原子FPGA连载】第十七章双核AMP实验摘自【正点原子】DFZU2EG_4EV MPSoC之嵌入式Vitis开发指南

多核处理器从多核的结构上是否一致，分为两种基本架构：同构多核架构和异构多核架构。同构多核处理器是指系统中的处理器在结构上是相同的；而异构处理器是指系统中的处理器在结构上是不同的，这些处理器可以是通用处理器，也可以是解决某些特定应用的专用硬核。同构多核架构相比于异构多核架构，在硬件和软件设计上较为简单，通用性较高。但在某些特定应用场合下，如异构多核架构专用的硬件加速硬核，异构多核架构的性能会更高。

2023-02-24 15:52:26 1278

原创【正点原子FPGA连载】第十六章DP彩条显示实验摘自【正点原子】DFZU2EG_4EV MPSoC之嵌入式Vitis开发指南

1）实验平台：正点原子MPSoC开发板2）平台购买地址：https://detail.tmall.com/item.htm?id=6924508746703）全套实验源码+手册+视频下载地址： http://www.openedv.com/thread-340252-1-1.htmlDP接口即DisplayPort接口，DisplayPort是由视频电子标准协会(VESA)发布的显示接口。作为DVI的继任者，DisplayPort将在传输视频信号的同时加入对高清音频信号传输的支持，同时支持更高的分辨率和

2023-02-24 15:47:40 662

原创【正点原子FPGA连载】第十五章eMMC读写测试实验摘自【正点原子】DFZU2EG_4EV MPSoC之嵌入式Vitis开发指南

eMMC的英文全称是Embedded Multi Media Card，即嵌入式多媒体卡（又叫嵌入式存储卡），eMMC是MMC协会所订立的内嵌式存储器标准规格，主要是针对手机或者平板电脑为主，是一种非易失性的存储器件。eMMC采用统一的MMC标准接口，把高密度的NAND Flash以及Device Controller（也叫Flash控制器）封装在一颗BGA芯片中，从而减少了对PCB主板空间的占用。

2023-02-24 15:44:11 487

原创【正点原子FPGA连载】第十四章SD卡读写TXT文本实验摘自【正点原子】DFZU2EG_4EV MPSoC之嵌入式Vitis开发指南

1）实验平台：正点原子MPSoC开发板2）平台购买地址：https://detail.tmall.com/item.htm?id=6924508746703）全套实验源码+手册+视频下载地址： http://www.openedv.com/thread-340252-1-1.htmlSD存储卡是一种基于半导体快闪记忆器的记忆设备。它具有体积小、传输速度快、支持热插拔等优点，在便携式装置领域得到了广泛的应用，如手机、多媒体播放器等。本章我们将使用MPSOC开发板学习如何对SD卡（这里特指Micro SD卡

2023-02-20 15:12:28 927 2

原创【正点原子FPGA连载】第十三章QSPI Flash读写测试实验摘自【正点原子】DFZU2EG_4EV MPSoC之嵌入式Vitis开发指南

MPSOC中的QSPI Flash控制器分为传统QSPI控制器(LQSPI)和通用QSPI控制器(GQSPI)两个。传统QSPI控制器通过AXI从接口提供了线性可寻址的内存空间。支持引导配置(BOOT)和应用软件配置的就地执行(execute-in-place)。通用QSPI控制器提供I/O，DMA和SPI三种接口模式，不支持引导(BOOT)和就地执行(execute-in-place)。I/O接口配置如下图所示：图13.1.1 QSPI I/O接口配置。

2023-02-16 09:26:17 994

原创【正点原子FPGA连载】第十二章PS端RTC中断实验摘自【正点原子】DFZU2EG_4EV MPSoC之嵌入式Vitis开发指南

RTC（Real_Time Clock）实时时钟模块是由集成电路构成，通常被称为时钟芯片。实时时钟(RTC)单元的作用一般是为系统和应用软件提供准确的时基，为了提升时钟精度，RTC还包括校准电路以抵消温度和电压波动。RTC由VCC_PSAUX或VCC_PSBATT电源供电，当辅助电源（VCC_PSAUX）可用时，RTC使用它来保持计数器工作；当辅助电源不可用时，RTC自动切换到电池电源（VCC_PSBATT）工作。

2023-02-15 16:30:55 832

原创【正点原子FPGA连载】第十一章PL SYSMON测量输入模拟电压摘自【正点原子】DFZU2EG_4EV MPSoC之嵌入式Vitis开发指南

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2023-02-15 16:29:09 872 2

空空如也

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