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原创 Quartusii 错误10028

检查一下代码是否有重复在不同always语句块中对同一个变量进行赋值,比如always1:a<=1;不能在两个以上always语句内对同一个变量赋值。

2024-05-21 20:22:29 239

原创 用vivado编写寄存器堆GRF

最开始写入的数据为00000000随后we=0,且raddr1,2为00则无法读出;直到raddr1,raddr2不为零时,对应的rdata开始读出数据。当we为1时写入waddr的地址对应的wdata的数据。之后we=1,开始写入数据,we=0时当依然无法读出;在we为0时rdata1,rdata2读出对应的数据。当raddr1,raddr2为00时无法读出数据。raddr1,//读地址1。raddr2,//读地址2。waddr, // 写地址。wdata, // 写数据。rdata1,//读数据1。

2024-05-14 21:01:01 310

原创 用vivado制作的数据存储器DM

测试点覆盖了rst为1和0,在rst=1时将全部置零在rst=0时无效;即在地址00000000写入了12345678,在第二个时钟上升沿时writeEN=0,读出00000000的12345678;即在地址00000000写入了56991234,在第四个时钟上升沿时writeEN=0,读出00000000的56991234;首先是时钟上升沿触发,但是仿真过程中在第一个时钟上升沿时,rst信号和writeEN信号冲突,只识别的了writeEN信号,所以在最开始没有将存储器清零;Addrin:地址,

2024-05-14 20:58:46 262

原创 用quartus ii编写的红绿灯交通系统

红绿灯,交通灯,定时跳变,可手动控制,有锁定主路绿灯,当有行人时,该路绿灯

2024-05-08 22:43:03 479

原创 用quartus ii编写的4位全加器(带寄存器,时钟信号,复位信号)

用quartus ii编写的4位全加器(带寄存器,时钟信号,复位信号)分别有A,B两数的寄存器和结果S的寄存器

2024-05-08 22:32:45 206

原创 有关于Quartus13.0时序仿真弹窗消失

①首先选择stimulation的options 选择第二个。②检查安装路径,不能有中文和空格 尤其是空格。

2024-04-02 19:47:50 289 1

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