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原创 Verilog实现分频器设计(奇偶分频、半整数分频)

verilog实现奇偶分频、半整数分频

2022-08-29 13:43:13 1644 1

Verilog实现分频器设计(奇偶分频、半整数分频)

用Verilog实现分频器设计,主要包括偶分频(占空比50%),奇分频(占空比50%),以及半整数分频(比如2.5分频、3.5分频等,占空比不可能为50%,只能接近50%)。 半整数分频采用简单有效的算法,可以实现2.5倍分频以上的所有半整数分频。 提供了设计源代码、测试仿真代码。

2022-08-29

verilog实现计数器设计

verilog实现计数器设计,包括同步异步加减法计数器的详细代码

2015-07-06

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