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原创 HDLBits练习Shift18 Verilog逻辑右移和算数右移的区别
算术右移时,移入的是移位寄存器中数字(本例中为 q[63])的符号位,而不是逻辑右移时的零。右移n位,即加入n位符号位。即若符号位为1,在左边补1;若符号位为0,就补0。算术右移的另一种思路是,它假定被移位的数字是带符号的,并保留符号,因此算术右移是右移n位将带符号的数字除以 2 的n次幂。算数左移和逻辑左移的结果并无差别。算术左移和逻辑左移一样都是右边补0。
2024-06-24 11:23:50
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原创 verilog写12 小时时钟(带上午/下午指示器)计数器(HDLbits Count clock)
比较蠢的方法,无限if嵌套,对着波形改了好久。
2024-06-20 17:29:18
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空空如也
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