【朝花夕拾】RT600 BCLK受干扰影响WS频率解决方案

最新推荐文章于 2023-10-04 05:38:08 发布
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分类专栏： RT 朝花夕拾 文章标签： mcu
版权声明：本文为博主原创文章，遵循 CC 4.0 BY-SA 版权协议，转载请附上原文出处链接和本声明。
本文链接：https://blog.csdn.net/zhoujingCSDN/article/details/130974728
版权

一 问题描述

    最近遇到客户发现一个很有意思的问题，客户使用RT600 I2S产生2通道的I2S波形，配置希望输出I2S波形：

48Khz 采样率，32bit, 2通道， BCLK输出3.072Mhz

    测试发现现象很奇怪，如果BCLK连接的模块阻抗改变，会导致正常应该输出48K的LRCK（WS）频率会变动，有时候变成96Khz，客户的模块是专用的ASIC。

   客户反应，这个问题同样可以在NXP MIMXRT685-AUD-EVK板子上复现，因为AUD-EVK FC2 P0_14连接到了外部LED的驱动电路：

    如果是官方的代码配置，不会复现问题，如果是使用客户的代码，能够复现问题。

如果断开R397 1_2的电阻，问题就不会复现，连接之后就会复现。

所谓复现：测试P0_15 LRCK采样率从期望的48Khz变成了96Khz

所谓不复现：测试P0_15 LRCK采样率就是期望的48Khz。

从I2S的构架上讲，不应该出现具体I2S IP的配置因为外部的驱动情况导致不同的输出频率，而且官方的代码直接修改接口和引脚也不会出现，问题到底出在哪里？

二，问题分析与解决方案

经过查看官方SDK的配置和客户提供的代码，发现差别很简单，在于pinmux.c对于P0_14, P0_15的配置，客户复现问题的配置如下：

 const uint32_t port0_pin14_config = (/* Pin is configured as FC2_SCK */

                                          IOPCTL_PIO_FUNC1 |

                                          /* Disable pull-up / pull-down function */

                                          IOPCTL_PIO_PUPD_DI |

                                          /* Enable pull-down function */

                                          IOPCTL_PIO_PULLDOWN_EN |

                                          /* Enables input buffer function */

                                          IOPCTL_PIO_INBUF_EN |

                                          /* Normal mode */

                                          IOPCTL_PIO_SLEW_RATE_NORMAL |

                                          /* Normal drive */

                                               IOPCTL_PIO_FULLDRIVE_DI |

                                          /* Analog mux is disabled */

                                          IOPCTL_PIO_ANAMUX_DI |

                                          /* Pseudo Output Drain is disabled */

                                          IOPCTL_PIO_PSEDRAIN_DI |

                                          /* Input function is not inverted */

                                          IOPCTL_PIO_INV_DI);

     /* PORT0 PIN14 (coords: A3) is configured as FC2_SCK */

     IOPCTL_PinMuxSet(IOPCTL, 0U, 14U, port0_pin14_config);


     const uint32_t port0_pin15_config = (/* Pin is configured as FC2_TXD_SCL_MISO_WS */

                                          IOPCTL_PIO_FUNC1 |

                                          /* Disable pull-up / pull-down function */

                                          IOPCTL_PIO_PUPD_DI |

                                          /* Enable pull-down function */

                                          IOPCTL_PIO_PULLDOWN_EN |

                                          /* Enables input buffer function */

                                          IOPCTL_PIO_INBUF_EN |

                                          /* Normal mode */

                                          IOPCTL_PIO_SLEW_RATE_NORMAL |

                                          /* Normal drive */

                                          IOPCTL_PIO_FULLDRIVE_DI |

                                          /* Analog mux is disabled */

                                          IOPCTL_PIO_ANAMUX_DI |

                                          /* Pseudo Output Drain is disabled */

                                          IOPCTL_PIO_PSEDRAIN_DI |

                                          /* Input function is not inverted */

                                          IOPCTL_PIO_INV_DI);

     /* PORT0 PIN15 (coords: A5) is configured as FC2_TXD_SCL_MISO_WS */

     IOPCTL_PinMuxSet(IOPCTL, 0U, 15U, port0_pin15_config);

官方不复现问题的配置如下：

const uint32_t port0_pin14_config = (/* Pin is configured as FC2_SCK */

                                          IOPCTL_PIO_FUNC1 |

                                          /* Disable pull-up / pull-down function */

                                          IOPCTL_PIO_PUPD_DI |

                                          /* Enable pull-down function */

                                          IOPCTL_PIO_PULLDOWN_EN |

                                          /* Enables input buffer function */

                                          IOPCTL_PIO_INBUF_EN |

                                          /* Normal mode */

                                          IOPCTL_PIO_SLEW_RATE_NORMAL |

                                          /* Normal drive */

                                                                   IOPCTL_PIO_FULLDRIVE_EN  |

                                          /* Analog mux is disabled */

                                          IOPCTL_PIO_ANAMUX_DI |

                                          /* Pseudo Output Drain is disabled */

                                          IOPCTL_PIO_PSEDRAIN_DI |

                                          /* Input function is not inverted */

                                          IOPCTL_PIO_INV_DI);

     /* PORT0 PIN14 (coords: A3) is configured as FC2_SCK */

     IOPCTL_PinMuxSet(IOPCTL, 0U, 14U, port0_pin14_config);


     const uint32_t port0_pin15_config = (/* Pin is configured as FC2_TXD_SCL_MISO_WS */

                                          IOPCTL_PIO_FUNC1 |

                                          /* Disable pull-up / pull-down function */

                                          IOPCTL_PIO_PUPD_DI |

                                          /* Enable pull-down function */

                                          IOPCTL_PIO_PULLDOWN_EN |

                                          /* Enables input buffer function */

                                          IOPCTL_PIO_INBUF_EN |

                                          /* Normal mode */

                                          IOPCTL_PIO_SLEW_RATE_NORMAL |

                                          /* Normal drive */

                                                                   IOPCTL_PIO_FULLDRIVE_EN  |

                                          /* Analog mux is disabled */

                                          IOPCTL_PIO_ANAMUX_DI |

                                          /* Pseudo Output Drain is disabled */

                                          IOPCTL_PIO_PSEDRAIN_DI |

                                          /* Input function is not inverted */

                                          IOPCTL_PIO_INV_DI);

     /* PORT0 PIN15 (coords: A5) is configured as FC2_TXD_SCL_MISO_WS */

     IOPCTL_PinMuxSet(IOPCTL, 0U, 15U, port0_pin15_config);

实际上，只要BCLK P0_14的引脚配置为FULL drive即可。

可以看到，如果配置为Full output driver，驱动能力是normal输出的两倍。所以，问题出在BCLK的引脚驱动能力这块。

  然而，推荐客户改变驱动能力的方式，纵然可以输出正确的48Khz采样率波形，客户并不接受，认为高驱动能力也代表着功耗的加大，而他们的产品是对功耗要求极高的，必须要在普通驱动能力下解决问题。所以进一步分析波形，通过使用高采样率的示波器20Gsa/s，2G探头抓取出问题时候的BCLK，可以发现有一些毛刺：

 

通过内部的沟通，也认为这个BCLK毛刺是导致问题的原因。这里需要注意的是，有些示波器，如果采样率低可能抓不到这个毛刺，还有些探头，阻抗比较小，导致探头加上到BCLK，直接问题消失的情况，所以建议使用高阻抗探头，比如1M欧，1G采样率以上的探头即可抓到。

   由于客户不接受驱动能力的改变，所以这里还可以考虑改变斜率，让上升下降变缓，滤掉毛刺区域，改变配置如下：

#define IOPCTL_PIO_SLEW_RATE_SLEW 0X80

  const uint32_t port0_pin14_config = (/* Pin is configured as FC2_SCK */

                                           IOPCTL_PIO_FUNC1 |

                                           /* Disable pull-up / pull-down function */

                                           IOPCTL_PIO_PUPD_DI |

                                           /* Enable pull-down function */

                                           IOPCTL_PIO_PULLDOWN_EN |

                                           /* Enables input buffer function */

                                           IOPCTL_PIO_INBUF_EN |

                                           /* Normal mode */

                                                                                    IOPCTL_PIO_SLEW_RATE_SLEW|//0X80|// IOPCTL_PIO_SLEW_RATE_NORMAL |

                                           /* Normal drive */

                                           IOPCTL_PIO_FULLDRIVE_DI |

                                           /* Analog mux is disabled */

                                           IOPCTL_PIO_ANAMUX_DI |

                                           /* Pseudo Output Drain is disabled */

                                           IOPCTL_PIO_PSEDRAIN_DI |

                                           /* Input function is not inverted */

                                           IOPCTL_PIO_INV_DI);

      /* PORT0 PIN14 (coords: A3) is configured as FC2_SCK */

      IOPCTL_PinMuxSet(IOPCTL, 0U, 14U, port0_pin14_config);


      const uint32_t port0_pin15_config = (/* Pin is configured as FC2_TXD_SCL_MISO_WS */

                                           IOPCTL_PIO_FUNC1 |

                                           /* Disable pull-up / pull-down function */

                                           IOPCTL_PIO_PUPD_DI |

                                           /* Enable pull-down function */

                                           IOPCTL_PIO_PULLDOWN_EN |

                                           /* Enables input buffer function */

                                           IOPCTL_PIO_INBUF_EN |

                                           /* Normal mode */

                                           IOPCTL_PIO_SLEW_RATE_NORMAL |

                                           /* Normal drive */

                                           IOPCTL_PIO_FULLDRIVE_DI |

                                           /* Analog mux is disabled */

                                           IOPCTL_PIO_ANAMUX_DI |

                                           /* Pseudo Output Drain is disabled */

                                           IOPCTL_PIO_PSEDRAIN_DI |

                                           /* Input function is not inverted */

                                           IOPCTL_PIO_INV_DI);

      /* PORT0 PIN15 (coords: A5) is configured as FC2_TXD_SCL_MISO_WS */

      IOPCTL_PinMuxSet(IOPCTL, 0U, 15U, port0_pin15_config);

测试结果如下：

可以看到波形很光滑，毛刺消失，输出也是稳定的48Khz,满足客户不改变驱动能力的要求。

综上：在使用RT600 FC2做I2S的时候，为了BCLK不受外部电路影响，从而影响到WS的波形频率，建议引脚配置以下二选一：

  1. 使用Full output drive,提高驱动能力 ->IOPCTL_PIO_FULLDRIVE_EN
  2. 使用慢slewrate,滤掉BCLK上升下降小毛刺->IOPCTL_PIO_SLEW_RATE_SLEW
嵌联驰
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- I2S是用于传输音频数据的标准协议，包括时钟信号（BCLK）、帧同步信号（WS或LRCK）和数据线（通常为SDOUT和SDIN）。 - 在此项目中，i.MX RT1052将作为I2S主设备，向从设备（如MP3解码芯片）发送命令和数据。 3....
频率计VHDL程序及仿真
05-28
《频率计VHDL程序与仿真详解》 在数字电子技术领域，频率计是一种重要的测量设备，用于测量信号的频率。在VHDL（Very High Speed Integrated Circuit Hardware Description Language）编程中，我们可以设计出硬件...
基于FPGA的数字频率计代码.doc
10-05
该文档是关于基于FPGA（Field-Programmable Gate Array，现场可编程门阵列）设计的数字频率计的代码实现。数字频率计是一种测量信号频率的电子设备，它可以精确地显示输入信号的频率值。在本文档中，设计者采用VHDL...
MCU的I2S为slave时出现噪音的解决方案
宁静以致墨的专栏
12-12 3467
g_ak4961_i2s_tx_handle.Instance->SR __IO uint32_t SR; /*! 27.5.3 SPI 状态寄存器 (SPI_SR) CRCERR 8: FRE 位 8 FRE：帧格式错误 (Frame format error) 注意： 当 SPI 在 TI 从模式或 I2S 从模式下工作时，使用此标志 #define __HAL_
浅谈I2S协议、PDM麦克风
qq_35552527的博客
02-10 9739
项目中需要调试硅麦，硅麦输出PDM信号，需要转换芯片把PDM信号转成I2S信号输出。 I2S协议 一、基本介绍 I2S（Inter-IC Sound）是飞利浦公司针对数字音频设备（如CD播放器、数码音效处理器、数字电视音响系统）之间的音频数据传输而制定的一种总线标准。标准的I2S总线电缆是由3根串行导线组成的：1根是时分多路复用（简称TDM）数据线；1根是字选择线；1根是时钟线。 二、协议时序格式...
STM32H7高性能MCU系列 STM32H7A3NGH6 32-bit RISC内核
Mandy_mjd的博客
11-05 2470
STM32H7A3NGH6是基于高性能Arm Cortex-M7的32位MCU，工作频率高达400MHz。
接上一篇文章，数据字典学习经验基础知识分享
07-09
关于自我学习软件工程数据字典基础知识必备干货分享
convnext-tiny-22k-224.pth模型文件
07-09
convnext-tiny-22k-224.pth模型文件
蓝桥杯介绍、心得、往年试题及相关练习
07-09
项目总结 本文详细介绍了蓝桥杯全国软件和信息技术专业人才大赛，包括其背景、参赛心得、往年试题及相关练习。通过学习和练习这些内容，参赛者可以提高自己的算法和编程能力，为蓝桥杯比赛做好充分准备。 蓝桥杯不仅是一个展示编程和算法能力的平台，也是一个提升综合素质和应对挑战的机会。通过参与比赛，参赛者可以积累宝贵的经验，与其他优秀选手交流学习，不断提高自身水平。希望本文能为准备参加蓝桥杯的选手提供有价值的参考，助力他们在比赛中取得优异成绩。
智能台灯智能台灯智能台灯智能台灯智能台灯
07-09
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食品、食品添加剂、食品相关产品采购台账记录制度.docx
07-09
食品、食品添加剂、食品相关产品采购台账记录制度.docx
GitHub入门：开启代码托管与协作之旅
最新发布
07-09
GitHub是一个面向开源及私有软件项目的托管平台，因为只支持Git作为唯一的版本库格式进行托管，故名GitHub。GitHub提供了分布式版本控制和源代码管理（SCM）功能，此外还有一些特色功能，例如允许用户对项目进行跟踪/协调/管理/文档化/信息共享/允许团队成员之间进行交流。 GitHub的基本功能是免费的，它提供了付费账户，拥有更多的私有仓库和一些高级功能。GitHub上的项目通常被称为“repository”（仓库），你可以在仓库中找到项目的源代码、文档、issue跟踪系统、Wiki页面以及项目的社区讨论。 GitHub的主要特点包括： - **版本控制**：使用Git进行版本控制，帮助开发者管理代码变更。 - **协作**：支持多人协作开发，通过分支（branch）、合并请求（pull request）和代码审查（code review）等功能。 - **社区**：数百万开发者和公司使用GitHub分享代码、启动项目和构建软件。 - **开源**：大量开源项目托管在GitHub上，任何人都可以访问和贡献。 - **文档**：使用Markdown格式编写README和其
I2S_BCLK I2S_WS都是什么意思
06-01
I2S_BCLK指的是I2S总线时钟（Bit Clock），它是I2S数据帧中每个位的时钟信号，用于同步数据的传输。I2S_WS指的是I2S帧同步信号（Word Select），它用于指示I2S数据帧中的一个音频数据字（如左声道或右声道）的开始和...

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