问题已解决,经验总结。
1.将case中if结构中的dir提出会解决对应问题
2.哪怕always中是顺序执行,两行阻塞赋值亦或是非阻塞赋值,无法完成在stm32中真正两行顺序赋值,最终赋值结果有概率出错
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有关总结提问:在2完成的基础上加入新的阶段,2中采用的改进失效,错误类型相同,为什么呢
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module top_module(
input clk,
input areset, // Freshly brainwashed Lemmings walk left.
input bump_left,
input bump_right,
input ground,
output walk_left,
output walk_right,
output aaah );
// parameter LEFT=0, RIGHT=1, ...
reg[1:0] state, next_state;
reg dir;
parameter left = 2'b0,right = 2'b01,fall = 2'b10;
// State transition logic
always @(*) begin
case(state)