用Eclipse和MCU Xpresso IDE调试RISC-V芯片！

今天站长在国外的网站上，看到这样一篇很有意思的文章，特意做了部分的翻译，转载到这里。如果希望查看原文，可以点击这里阅读。

翻译摘要：

一个新的RISC-V玩家在open-isa.org出现了。在这个网站上，我免费申请了一块开发板。要不是几个星期之后我收到了两块板，我已经几乎忘记了这件事情:-)

这个网站和论坛的讨论中指出，同时芯片上的Logo也证实：那个芯片的是Freescale（哦，现在是NXP）生产的，见这个网页：https://hackaday.com/2019/02/04/openisa-launches-free-risc-v-vegaboard/

他们所做的是在https://open-isa.org上创建一个社区页面，这也是这款开发板的“入门”要点所指向的地方，从这里我得到了用来设置环境的内容。 恩智浦似乎已经开始了一种“雷达式”的试运行，这本身就很有趣。

VEGA RV32M1开发板

开发板本身也很有意思。 它看起来像是系列的“Freedom”板之一。 该板配有USB线缆，五个跳线和一个简短的“入门”单页。

与SiFive板相比，我很高兴地宣告，该板可以使用10针SWD / JTAG连接器正确调试。

VEGA开发板

VEGA开发板的背面

该板与飞思卡尔/恩智浦的其他“FRDM”（或Freedom）板非常相似。 该板采用NXP Kinetis K26作为UART（可能还有Debug？我没有找到固件）桥接器。

VEGA开发板上的MK26

因此我用一个SEGGER的J-Link Mini来调试这个板子。

电路板上有4个内核（Kinetis K26那个是额外的核心）。可以选择从哪个核心启动，可惜我还没有尝试过。

VEGA板的框图(来源：https://www.eejournal.com/article/priming-the-risc-v-pump/)

由于每半边(RI5CY/M4F和Zero-RISCY/M0+)共享相同的总线，它很像一个双异核系统的设置。有意思的是，两个RISC-V核心是来自苏黎世ETH的PULP项目。

安装：

https://open-isa.org/get-started/上的“入门”，提供了设置环境的视频和基本步骤，解释了使用make文件或DIY Eclipse IDE的过程。我决定改用NXP MCUXpresso IDE，效果非常好。 我在本文中使用了MCUXpresso IDE V10.3.1，它只需要GNU MCU Eclipse插件和工具链来为RISC-V开发。

此处省却10个设置步骤，未作翻译，有兴趣的读者可以点击此处阅读原文。

至此，所有的插件和工具都安装好了。

调试器：

我采用J-Link EDU Mini。电路板上有三个SWD / JTAG接头：要使用靠近RV32M1微控制器的接头。

工具链附带预先构建的OpenOCD软件包，可与SEGGER J-Link配合使用（请参阅https://wiki.segger.com/OpenOCD）。 

此处省却设置步骤，未作翻译，有兴趣的读者可以点击此处阅读原文。

设置Eclipse工具链：

在MCUXpresso IDE中，验证工作区设置中的工具链设置（菜单窗口>首选项）：

此处省却设置步骤，未作翻译，有兴趣的读者可以点击此处阅读原文。

导入项目：

从SDK中导入一个项目，例如

C:\Vega\rv32m1_sdk_riscv\boards\rv32m1_vega\demo_apps\bubble\ri5cy\riscveclipse

拖拽.project文件至IDE中，由于SDK中的项目使用相对路径，我需要"Link"到它：

如果工具链设置正确，应该可以正常地编译：

调试：

这些项目包括OpenOCD的启动配置（菜单运行>调试配置）。验证正确的openOCD二进制文件是否与其配置文件一起使用：

OpenOCD的设置

通过J8的USB接口给板子上电：

调试VEGA板

随后点击”调试“按钮，我进入了调试界面

使用OpenOCD调试VEGA板

总结：

使用RISC-V核心，甚至像这个板子这样使用多个核心，是一件很有趣的事情，我很高兴看到软件和工具正在发展。 RISC-V可能是下一个重要的事情，但肯定可能需要一段时间才能广泛使用。 根据https://www.eejournal.com/article/priming-the-risc-v-pump/，将来会有更多的板子出现。

下一步是什么？ 有一个新的FreeRTOS版本可用于RISC-V，所以我肯定会尝试它....

祝各位快乐，RISCing （转自恩智浦MCU加油站）

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