SPI协议

GGbao_

已于 2023-05-05 22:38:16 修改

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分类专栏：协议文章标签：网络

于 2023-04-27 13:07:20 首次发布

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SPI通信简介

SPI作为通用通信协议在许多不同设备中使用。例如，SD卡模块，RFID卡读取器模块和2.4 GHz无线发送器/接收器均使用SPI与微控制器通信。 SPI是全双工接口，主机和从机可以分别通过MOSI和MISO线路同时发送数据。

SPI的一个独特优势是可以无中断传输数据。可以在连续流中发送或接收任意数量的位。使用I2C和UART，数据以数据包的形式发送，限制为特定位数。开始和停止条件定义了每个数据包的开始和结束，因此数据在传输过程中被中断。

通过SPI通信的设备处于主从关系。主机是控制设备（通常是微控制器），而从机（通常是传感器，显示器或存储芯片）从主机获取指令。SPI的最简单配置是一个主设备+一个从设备的系统，但是一个主设备可以控制多个从设备。

MOSI (Master Output/Slave Input) – 主设备向从设备发送数据的信号线

MISO (Master Input/Slave Output) – 从设备向主设备发送数据的信号线

SCLK (Clock) – 时钟信号线用于通讯同步。该信号由主机产生，其支持的最高通讯速率为fpclk/2，即所挂载总线速率的一半。如SPI2挂载在APB1总线上，则其最高速率为36MHz / 2 = 18MHz。类似木桶效应，两个设备之间通讯时，通讯速率受限于较低速的设备。

SS/CS (Slave Select/Chip Select) – 主设备选择要向其发送数据的从设备的片选信号线（NSS：即片选信号线，用于选择通讯的从设备，也可用CS表示。每个从设备都有一条独立的NSS信号线，主机通过将某个设备的NSS线置低电平来选择与之通讯的从设备。所以SPI通讯以NSS线电平置低为起始信号，以NSS线电平被拉高为停止信号。）

如上图，编号1和6即为起始和停止信号的发生区域。NSS电平由高变低，则产生起始信号；NSS电平由低变高，则产生停止信号。从机检测到自己的NSS线电平被置低，则开始与主机进行通讯；反之，检测到NSS电平被拉高，则停止通讯。

使用的信号线	4
最大传输速度	最高可达10Mbps
同步/异步	同步
串行/并行	串行
最大主设备数	1
最大从设备数	理论上无上限*

*实际上，从站的数量受到系统负载电容的限制，这降低了主机在电压电平之间准确切换的能力。

数据有效性

MOSI和MISO线在SCK的每个时钟周期传输一位数据，开发者可以自行设置MSB或LSB先行，不过需要保证两个通讯设备都使用同样的协定。从上图看到，在SCK的上升沿和下降沿时进行触发和采样。

SPI有四种通讯模式，在SCK上升沿触发，下降沿采样只是其中一种模式。四种模式的主要区别便是总线空闲时SCK的状态及数据采样时刻。这涉及到“时钟极性CPOL”和“时钟相位CPHA”，由CPOL和CPHA的组合而产生了四种的通讯模式。

CPOL、CPHA

CPOL：即在没有数据传输时，时钟的空闲状态的电平。
CPHA：即数据的采样时刻。

图16-2

上图中CPHA=0时候，主器件是在NSS信号有效后，立即输出bit1，尽管此时SCLK信号还没有效。从器件bit1的输出时刻是在SCLK信号有效以前，比SCLK的有效早半个周期，其bit1的输出时刻与NSS信号没有关系。

SPI_CR1寄存器的CPOL和CPHA位组合配置成四种时序关系，即四种通讯模式。

SPI模块为了和外设进行数据交换，根据外设工作要求，其输出串行同步时钟极性和相位可以进行配置，时钟极性(CPOL)对传输协议没有重大的影响。如果CPOL=0，串行同步时钟的空闲状态为低电平；如果CPOL=1，串行同步时钟的空闲状态为高电平。时钟相位(CPHA)能够配置用于选择两种不同的传输协议之一进行数据传输。如果 CPHA=0，在串行同步时钟的第一个跳变沿(上升或下降)数据被采样；如果CPHA=1，在串行同步时钟的第二个跳变沿(上升或下降)数据被采样。 SPI主模块和与之通信的外设时钟相位和极性应该一致。

如图16-2所示，如果CPOL被清0，则SCK在空闲状态保持低电平，反之被置1则保持高电平；如果CPHA位被清0，则在SCK每个时钟周期的第1个边沿（奇数边沿）进行数据位采样，反之被置1则在SCK每个时钟周期的第2个边沿（偶数边沿）采样。

如下表所示的四种SPI通讯模式。