FPGA门数计算方法

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来源:网络素材

FPGA门数计算方法

我们在比较FPGA的芯片参数时经常说某一款FPGA是多少万门的,也有的说其有多少个LE,那么二者之间有何关系呢?

FPGA等效门数的计算方法有两种,一是把FPGA基本单元(如LUT+FF,ESB/BRAM)和实现相同功能的标准门阵列比较,门阵列中包含的门数即为该FPGA基本单元的等效门数,然后乘以基本单元的数目就可以得到FPGA门数估计值;二是分别用FPGA和标准门阵列实现相同的功能,从中统计出FPGA的等效门数,这种方法比较多的依赖于经验数据。

对于第一种方法,FPGA包括LUT/FF/RAM等资源,分析各种资源等效门数时,总原则是等效原则,就是实现相同的功能,在标准门阵列中需要的门数就是FPGA该资源等效门数,例如实现一个带寄存器输出的4输入XOR,在FPGA中需要用一个LUT和1个FF实现,在标准门阵列中一般要用21个与非门实现,于是1个LUT+1个FF等效于21个门。对ESB(BRAM),由于用标准门阵列实现1bit的RAM时一般需要4个门,因此ESB/BARM 做RAM使用时,1bit等效4个门,对Altera FPGA中一个2048bit的ESB,等效门数为8K。光靠这些数据还不能比较准确地计算出FPGA的等效门数。因为这只是一种简单情况,实际情况要复杂很多。

例如,如果实现的是带寄存器输出地2输入XOR,FPGA也要用1个LUT+FF,而标准门阵列只需要8个NAND,于是1个LUT+1个FF只等效于8个门。同时特定功能的实现,在不同的标准门阵列系列中需要的门数也不一样,因此等效门的计算只能是个大概的数值。也就是说对于某一具体型号FPGA的门数估计,与FPGA资源的用途有密切关系。LUT用于实现2输入XOR和4输入XOR等效门数不一样(分别为1和13);FF不带异步清零、复位、时钟使能和带这些端口的等效门数不同(分别为8和13);ESB(BRAM)做RAM使用时,1bit等效4个门,1个2048bit的BRAM等效8K门,但是做查找表使用时可能只相当于不到200门。因此估计FPGA的等效门数需要做更细致的分析。

图1显示了EP20K系列的等效门数等参数,下面以EP20K1000E为例详细说明FPGA等效门数的估计方法。

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图1 EP20K 系列的等效门数等参数

(1)计算逻辑阵列的等效门数

估算EP20K1000E的门数时,把FPGA特定资源和LCA300K标准逻辑阵列的门数(LSI LCA300K Data Book)比较,可以对FPGA等效门做出估计。FPGA一个LUT+FF等效门数计算如图2所示

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图2 一个LUT+FF等效门数

即LUT+FF等效于8~21个门,上限和下限分别由实现简单函数、复杂函数分别界定。

APEX20K的等效门数也可以根据经验数据获得,把超过100个针对4输入LUT的设计用FPGA实现,同时用LCA300K gate arrays和Design Compiler实现,比较相同的设计FPGA所用的LE数目和LCA300K所用的门数可知,每个LE相当于12个门。EP20K1000E有38400个LE,于是相当于46万门。

(2)计算ESB的等效门数

RAM中一个bit所需要的门数与RAM的体系结构、工艺、厂商等有关,一般而言,1bit相当于4个门,Altera也采用这个标准,这样可以方便地估计ESB等效门数。

计算ESB等效门数也可以采用和LSI LCA300K比较的方法,即通过与实现相同容量RAM在LCA300K所用的门数相比较,从而得到ESB的每一bit相当于多少门,从而计算出ESB的等效门数,参考图3。

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图3 ESB的等效门数

从上图可见,4gates/bit是一个比较合适的估计,于是EP20K1000E的ESB等效门数为

160 ESBs X 2,048 bits per ESB X 4 gates per bit = 1,310,720 gates,即约为130万门。

总而言之,对EP20K1000E,LUT+FF等效门数约为46万(经验数值),ESB全用作RAM时等效门数约为130万,所以最大系统门数为170万。

结论:

FPGA等效门数估计方法可以是把FPGA资源基本单元(如LUT+FF,ESB)和实现相同功能的标准门阵列相比得到FPGA基本单元等效的门数,然后乘以单元的个数得到整个FPGA等效门数。也可以是实现很多设计,和用标准门阵列相比,从中统计出等效门数。FPGA的等效门数估计一般分为LUT+FF和ESB(BRAM)两部分,LUT+FF等效于8~21个门,典型值为12;ESB做RAM使用时,一般相当于4门/bit,此时估计出的门数最多,如果ESB做乘积项/LUT则等效门数大大减小,例如对EP20K1000E,前者为130万,后者为2万。

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### 回答1: FPGA(Field-Programmable Gate Array)是一种灵活可编程的集成电路(IC),它可以通过编程来实现各种不同的电路功能。FPGA的性能和资源利用率很大程度上取决于设计的质量,因此需要进行精确的测量和评估。 对于FPGA的精度测量,可以采用以下方法: 1. 时钟测量法:通过在FPGA上引入一定频率的时钟信号,可以测量FPGA的时钟精度,包括时钟周期和抖动。 2. 延迟测量法:通过在FPGA上实现一个简单的计数器或移位寄存器,可以测量FPGA的延迟精度。 3. 时序分析法:通过仿真和分析FPGA上设计的时序逻辑,可以确定FPGA的时序精度和限制。 4. 电气测量法:通过测量FPGA的电气特性,如功耗和电流,可以评估FPGA的质量和资源利用率。 对于FPGA的性能评估,可以采用以下方法: 1. 时钟分析法:通过分析FPGA上的时钟频率和时钟分配情况,可以确定FPGA的性能和时钟限制。 2. 逻辑分析法:通过分析FPGA上设计的逻辑电路,可以评估FPGA的逻辑资源利用率和逻辑延迟。 3. 布局分析法:通过分析FPGA上的布局,可以评估FPGA的资源利用率和时钟分布情况。 以上方法可以结合使用,以全面评估FPGA的质量和性能。 ### 回答2: FPGA(现场可编程门阵列)是一种集成电路芯片,具有高度可编程性和灵活性,可用于实现各种数字电路。在精度测量中,FPGA可用于实现测频分辨率计算。 测频分辨率是指在一定频率范围内可以分辨的最小频率变化量。它与采样率和时域记录长度有关。FPGA可以通过采样信号并对其进行处理来计算测频分辨率。 计算测频分辨率的方法如下: 1. 设置FPGA的时钟频率,这是基本的时钟信号,用于采样外部信号。 2. 选择适当的时域记录长度,这是指在一定时间内采样的信号点数。 3. 将外部信号输入到FPGA,并通过FPGA的模数转换器(ADC)将其转换成数字信号。 4. 使用FPGA的时钟信号对采样的信号进行时域分析。可以使用快速傅里叶变换(FFT)算法来将信号从时域转换到频域。 5. 根据FFT计算出来的频谱数据,可以得到频率与幅值的对应关系。通过查找频率与幅值之间最小可分辨的差距,就可以得到测频分辨率。 需要注意的是,FPGA的测频分辨率也受限于采样率和时域记录长度。较高的采样率和更长的时域记录长度通常可以实现更高的测频分辨率。此外,选取适当的FFT窗函数和频谱分辨率也可以对测频分辨率进行优化。 总结起来,FPGA通过采样外部信号,使用FFT算法进行时域分析,计算得到频谱数据,并通过检查频率与幅值之间的最小可分辨差距来计算测频分辨率。 ### 回答3: FPGA(可编程逻辑门阵列)是一种可通过编程实现不同电路功能的集成电路。在精度测量中,FPGA可以用于测频分辨率的计算。 测频分辨率是指可以分辨出两个频率之间最小的差异。计算测频分辨率的方法如下: 1. 首先,确定FPGA的输入频率范围,即要进行测量的频率范围。 2. 然后,确定FPGA的采样率。采样率是指对输入信号进行采样的频率,通常使用赫兹(Hz)来表示。 3. 根据采样定理,采样率应至少是被测量信号频率的两倍以上。因此,可以根据采样率来确定测量范围内的最高可分辨频率。 4. 测频分辨率可以通过采样率除以FPGA中用于进行频率计算的时钟频率来计算。时钟频率是FPGA中时钟模块的工作频率,通常以赫兹(Hz)来表示。 5. 最后,根据计算得出的结果,可以得知FPGA的测频分辨率。较小的测频分辨率表示FPGA能够更准确地测量频率差异。 需要注意的是,FPGA在实际应用中还需要考虑信噪比、采样精度、量化误差等因素对精度测量的影响。因此,在实际应用中要综合考虑多个因素,并根据具体需求进行相应的优化和调整。 综上所述,FPGA测频分辨率的计算方法主要包括确定输入频率范围、采样率、采样定理、时钟频率,并根据计算结果得出测频分辨率。

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