设计计时器

目前计时器普遍采用cpu时序逻辑电路实现计时,在硬件层次,变速精灵无法对其进行加速,虚拟机也许可以实现在硬件层次的加速,但是貌似要修改虚拟机的程序文件,其实变相在修改硬件,在软件层次上修改逻辑电路基本上行不通,只能通过底层代码来选择电路

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采取定时器组合,由于主频确定,通过引入不定参数和数据和时钟延时,在可接受的范围内对程序解释器进行有限判定

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