数字电子技术 部分经典实验wp

已于 2023-12-12 18:25:21 修改
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于 2023-12-05 00:04:48 首次发布
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版权
本文详细介绍了西安工业大学计算机学院电子技术基础实验中的组合逻辑电路（如全加器、全减器、优先编码器和计数器）的仿真，包括74LS148编码解码、74LS138全加/减器、74160和74151/74138的多通道数据传输，以及7490模60加法计数器的设计。

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概述

本文基于西安工业大学_计算机学院_电子技术基础实验内容，本文对所有实验进行了仿真，供各位学习使用！

From Chenxi

组合逻辑电路（全加器与全减器）

优先编码器74LS148进行编码、译码与显示

74LS138实现一位全加/减器

74LS151实现三变量多数表决电路

74160设计一个模N=24的加法计数器

74151, 74138设计多通道数据分时传送电路

7490设计一个模N=60的加法计数器

在virtuoso的菜单栏中集成starrc、calibre
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那么可以尝试用这样的方式解决：将.cdsinit文件中集成starrc的语句，移动到集成calibre的语句之前。
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