Vivado .gitignore example file

本文介绍在使用Xilinx Vivado设计套件时如何有效利用Git进行版本控制。通过提供一个示例.gitignore文件,文章详细说明了哪些文件应该被忽略以保持仓库的整洁,同时确保所有重要的设计和配置文件都被正确跟踪。

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在git上进行Vivado版本控制,需要的.gitignore文件示例。

Xilinx ,AR# 61232-Vivado .gitignore example file
Xilinx,UG1198-Vivado Design Suite Tutorial Revision Control Systems
Xilinx,XAPP1165-Using Vivado Design Suite with Version Control System

#########################################################################################################
##	This is an example .gitignore file for Vivado, please treat it as an example as 
##	it might not be complete. In addition, XAPP 1165 should be followed.
#########################################################################################################
#########
#Exclude all
#########
*
!*/
!.gitignore
###########################################################################
##	VIVADO
###########################################################################
#########
#Source files:
#########
#Do NOT ignore VHDL, Verilog, block diagrams or EDIF files.
!*.vhd
!*.v
!*.bd
!*.edif
#########
#IP files
#########
#.xci: synthesis and implemented not possible - you need to return back to the previous version to generate output products
#.xci + .dcp: implementation possible but not re-synthesis
#*.xci(www.spiritconsortium.org)
!*.xci
#*.dcp(checkpoint files)
!*.dcp
!*.vds
!*.pb
#All bd comments and layout coordinates are stored within .ui
!*.ui
!*.ooc
#########
#System Generator
#########
!*.mdl
!*.slx
!*.bxml
#########
#Simulation logic analyzer
#########
!*.wcfg
!*.coe
#########
#MIG
#########
!*.prj
!*.mem
#########
#Project files
#########
#XPR  +  *.XML ? XPR (Files are merged into a single XPR file for 2014.1 version)
#Do NOT ignore *.xpr files
!*.xpr
#Include *.xml files for 2013.4 or earlier version
!*.xml
#########
#Constraint files
#########
#Do NOT ignore *.xdc files
!*.xdc
#########
#TCL - files
#########
!*.tcl
#########
#Journal - files
#########
!*.jou
#########
#Reports
#########
!*.rpt
!*.txt
!*.vdi
#########
#C-files
#########
!*.c
!*.h
!*.elf
!*.bmm
!*.xmp

### VHDL GitIgnore 文件模板 针对VHDL项目的特点,特别是考虑到FPGA工程项目中遇到的一些特殊挑战[^1],构建一个合适的`.gitignore`文件至关重要。这不仅有助于提高Git库的效率,还能确保团队协作更加顺畅。 #### 基础忽略规则 基础部分应排除编译过程中产生的临时文件和二进制输出: ```plaintext *.o *.obj *.exe *.dll *.so *.a *.lib ``` #### Vivado特定忽略项 由于Vivado工程会产生大量不必要的中间文件,这些文件不应被纳入版本控制系统之中: ```plaintext # Vivado project files that are not essential to version control .xpr/ .sim/ .cache/ .hw/ .ip_user_files/ .project/ .runs/ .webtalk/ xsd/ xsim.dir/ vivado.jou vivado.log ``` #### HDL设计文件管理 为了更好地处理HDL源代码及其关联资源,在`.gitignore`中还需要特别注意如何对待BD(Block Design)文件以及其他自动生成的内容: ```plaintext # Exclude auto-generated block design related files except the main BD file itself. *_bd/*.tcl *_bd/*.bmm *_bd/*.dcp !*_bd/*.bd ``` #### 工具链与依赖关系 某些情况下,本地安装的工具链或者第三方库也可能混入工作区,因此建议增加如下条目来防止意外提交此类文件: ```plaintext # Toolchain and external libraries toolchains/ external_libs/ ``` #### 用户定制化配置 允许开发者保存个人偏好设置而不影响他人: ```plaintext # User-specific settings .settings/ .userprefs/ ``` 通过以上配置可以有效减少无关紧要的数据占用存储空间,并保持Git仓库整洁有序。值得注意的是,具体到每一个项目时,还需根据实际情况灵活调整此模板以满足特定需求。
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