便携式手提万兆网络协议测试仪

便携式手提万兆网络协议测试仪

  • 平台简介

便携式手提万兆网络协议测试仪,以FPGA万兆卡和X86主板为基础,构建便携式的手提设备。

FPGA万兆卡是以Kintex-7XC7K325T PCIeX4的双路万兆光纤网络卡,支持万兆网络数据的收发和网络协议的定制设计。
    平台默认操作系统为win7 64位系统;具备丰富的外设接口,如VGA、HDMI、千兆网口、USB2.0/3.0以及方便的JTAG调试口;平台存储为8G内存、256G固态硬盘,具备高速数据读写能力,可满足大多数应用场景。屏幕为触摸显示屏。

配置详细说明:

一、机箱

材料

铝合金内部个别承重件为镀锌板

表面工艺

整体氧化外表面喷粉(军绿色)

尺寸

270x110x200(mm)(W×H×D)

整机重量

供电

+12V

散热方式

风冷散热

二、触摸屏

规格

10.1寸液晶电容触摸屏

三、主板

外设接口

VGA, HDMI, LVDS/EDP 支持同步/异步双显功能;6个USB(其中1 个USB3.0,2个板载插针);6COM RS-232, COM3 可设置成RS485;双Intel PCI-E总线千兆网卡;1 个MINI PCIE 扩展, 1 个PCIE x4 扩展

电源

DC 12V输入

处理器

Intel® Core™第七代Kaby lake-U Soc i3/i5/i7 处理器(目前为i3)

操作系统

支持windows 8;Windows 7等(预装Windows7系统

内存

1个笔记本内存插槽,支持DDR3/L 1066/1333/1600MHz 最大至8GB(预装8G内存条);1×SATA 3.0,1×mSATA2.0固态硬盘接口(预装三星msata 512G SSD硬盘:读:510MB/s,写:393MB/s

工作温度

-15~60℃

存储温度

-40~75℃

环境湿度

0~90% 空气湿度,无冷凝

防尘防水

独特的前面板设计,使整机结构坚固可靠,美观时尚。能符合绝大多数应用环境的防尘防水要求。

WIFI无线网络

该系列平板电脑可以外接WIFI无线网卡或者网线连接

其他

可安装打印机、办公软件、媒体播放器等

产品定制

可根据需求定制

三、内部集成FPGA万兆网卡

本板卡系我公司自主研发,采用Xilinx公司的XC7K325T-2FFG900I芯片作为主处理器。板卡设计满足工业级要求。

图 1:PCIe 万兆光纤收发卡实物图

图 2:PCIe 万兆光纤收发卡原理框图

    1. 板卡技术指标 
  • 标准PCIe半高卡,符合PCI Express 2.0 规范。
  • 支持PCIe x1、x4模式。
  • 两路万兆光纤接口,最大支持10Gbps线速率。
  • 两路SATA接口,支持SATA 2.0标准。
  • 板载1簇 2GB 64bit DDR3内存颗粒,1簇 1GB 32bit DDR3内存颗粒和2簇128MB 16bit DDR3 内存颗粒。
  • 板载16MB SPI Flash,用于FPGA程序加载。
  • 板载8个用户测试GPIO。
  • 板载5个用户可编程LED。
    1. 物理特性
  • 工作温度:商业级 0℃ ~ +55℃,工业级-40℃~+85℃。
  • 工作湿度:10%~80%。
    1. 供电要求
  • 单电源供电,整板功耗:20W。
  • 电压:DC +12V,3A。
  • 纹波:≤10%。
    1. 应用领域
  • 万兆网络。

高速数据采集、存储。

四:万兆网络协议测试仪功能

科研版主要功能

编号

功能类别

功能点编号

功能点名称

描述

F1

接口

F1.1

 10G/40G/100G

满带宽收/发数据包

F2

包源产生方式

F2.1

硬件产生包源

设备自带初始化包源进行发送

F2.2

软件产生包源

用户通过应用软件把自己合成的数据包源下载到硬件网卡并点击发送

F3

发包控制

F3.1

Continuous

模式

支持连续发包

F3.2

Bursts

模式

支持固定包数发送2^32(4294967296

F3.3

Seconds

模式

支持定时发送2^21

(可设置14天)

F4

抓包

F4.1

支持线路抓包

支持随机抓取数据包及存储

企业版主要功能

编号

功能类别

功能点编号

功能点名称

描述

F1

接口

F1.1

 10G/40G/100G

8个10G满带宽收/发数据包

F2

包源产生方式

F2.1

硬件产生包源

设备自带初始化包源进行发送

F2.2

软件产生包源

用户通过应用软件设置数据包结构、类型、载荷等,然后发送

F2.3

4口接入数据后汇聚1口输出

支持外接1路或4路10G线路,最终汇聚成10G输出

F3

发包控制

F3.1

Continuous

模式

支持连续发包

F3.2

Bursts

模式

支持固定包数发送2^32(4294967296

F3.3

Seconds

模式

支持定时发送2^21

(可设置14天)

F4

速率设置

F4.1

Bandwith Utilization(%)

固定设置,可设置各速率接口下%流量发送

(最小单位为100Mbit)

F4.2

Random speed

浮动设置,可设置随机Min%~Max %流量输出

F5

包长设置

F5.1

Fixed

可设置固定包长(16B~16383B)

F5.2

Increment/ Decrement

可设置数据包在Min~Max(Byte)区间内递增递减

F5.3

Random

可设置数据包在Min~Max(Byte)区间内随机,可设置seed

编号

功能类别

功能点编号

功能点名称

描述

F6

抓包

F6.1

支持线路抓包

支持随机抓取数据包及存储

F7

支持协议类型

F7.1

支持协议类型

支持Ethernet II数据包协议 和 IP类别

F8

MAC地址设置

F8.1

Fixed

设置smac/dmac固定地址

F8.2

Increment/ Decrement

设置smac/dmac地址递增或递减(含count、repeat、mask)

F8.3

Random

可设置seed(含mask)

F9

IP地址设置

F9.1

Fixed

设置sip/dip固定地址

F9.2

Increment/ Decrement

设置sip/dip地址递增或递减(含count、repeat、mask)

F9.3

Random

可设置seed(含mask)

F10

UDP端口号设置

F10.1

Fixed

设置sp/dp固定端口

F10.2

Increment/ Decrement

设置sp/dp地址递增或递减(含count、repeat、mask)

F10.3

Random

可设置seed(含mask)

F11

TCP端口号设置

F11.1

Fixed

设置sp/dp固定端口

F11.2

Increment/ Decrement

设置sp/dp地址递增或递减(含count、repeat、mask)

F11.3

Random

可设置seed(含mask)

编号

功能类别

功能点编号

功能点名称

描述

F12

其它可设置参数

(满足其它组合形式数据包递归设置)

F12.1

Fixed

设置xxxx位置固定

F12.2

Increment/ Decrement

设置xxxx位置递增或递减(含count、repeat、mask)

F12.3

Random

可设置seed(含mask)

F13

包源类型

F13.1

已知以太标准协议

采用模板方式下载配置逻辑内部ram,用户自定义更换,支持全协议数据包

F13.2

自定义协议数据包

采用模板方式下载配置逻辑内部ram,用户自定义更换,支持自定义数据包

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万兆UDP协议(Gigabit UDP Protocol)是一种在高速网络通信中使用的协议。这种协议基于UDP(用户数据报协议),可以实现高速、可靠且低延迟的数据传输。而Verilog是一种硬件描述语言,适用于FPGA(现场可编程门阵列)的设计和开发。 在使用万兆UDP协议进行通信时,我们可以利用Verilog语言编写FPGA的逻辑电路,实现万兆UDP协议的功能。通过Verilog代码,我们可以描述FPGA中各个模块的状态和行为,从而实现数据的收发、校验和错误处理等功能。 在实现万兆UDP协议的FPGA设计中,我们需要考虑以下几个方面: 1. 数据帧处理:通过Verilog代码实现数据帧的解析和封装,包括MAC地址的识别、IP地址的提取、端口号的识别等。 2. 数据交换:通过Verilog代码实现数据的接收和发送,包括从网络中接收数据帧并将其传输给合适的模块进行处理,以及将处理后的数据帧发送到网络中。 3. 错误检测和纠正:通过Verilog代码实现校验和的计算和检查,以及对错误数据的处理,如丢弃或重新发送。 4. 数据缓存和流控制:通过Verilog代码实现数据的暂存和流控制,以保证数据的稳定传输。 总之,通过使用Verilog语言编写FPGA的逻辑电路,结合万兆UDP协议,我们可以实现高速、可靠且低延迟的数据传输。这种设计在网络通信、数据中心和高性能计算等领域具有广泛的应用前景。

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