DP83867以太网眼图测试（Eye Diagram）

最新推荐文章于 2024-06-07 16:26:29 发布
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本文介绍了如何使用DP83867 PHY芯片进行以太网眼图测试，特别是在100M和1000M速度下配置不同测试模式的方法。对于100M，设置模式5即可；而对于1000M，需要分别设置模式1到4以满足不同测试需求。测试过程中，通过MDIOTool修改相关寄存器设置，并需要Tektronix7104示波器等专业设备配合。
摘要由CSDN通过智能技术生成


IEEE802.3规范指出PHY芯片需要在TX管脚上产生特定的test pattern. DP83867支持4种测试模式,通过配置CFG1(REG OFFSET 0x0009)寄存器的CFG1[15..13]可以配置不同的输出模式,同时配置TMCH_CTRL(REG OFFSET 0x0025)寄存器TMCH_CTRL[7..5]可以选择在不同的TX管脚上输出指定的信号.

 

对100M的速度而言只需要把测试输出模式

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DP83867IS SGMII eye diagram问题调试记录
bingdund的博客
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Anxinenen的博客
11-10 4406
SI信号完整性介绍 Signal Integrity信号完整性是指信号通过整个链路的传输不会因受到干扰而变坏。信号完整性测试主要检测信号通过链路的信号质量，避免信号因链路中的干扰，阻抗使得信号质量不达标。 SI信号完整性测试意义 信号完整性测试可以检测产品在通讯传输时是否有丢失数据，收发数据缓慢的情况，从而避免产品无法正常通迅，甚至带来整个系统崩溃等问题。因此，信号完整性测试可以在产品上市前规避潜在的风险。 SI信号完整性测试接口类型 当前有哪些接口需要做信号完整性测试呢，主要包括如下类型： USB (Un
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