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RSS订阅原创 学习笔记--FPGA同步复位和同步复位
同步复位always@(posedge sys_clk)同步只的是和工作时钟同步的意思，上升沿触发时，当时钟的上升沿到来时监测到按键的复位操作时才有效，否则无效。图中的输入输出的信号用可表达为always@（posedge sys_clk） out <= in ;在这幅图中我们着重看第二根和第三根虚线，我们可以发现当复位信号产生时输出，输出信号并没有立即被拉低，而是在上升沿到来的时刻才被拉低成功；第二根线可以看出复位释放的时候也是如此，输出信号并没有...
2021-11-12 10:31:43
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转载 FPGA时序逻辑和组合逻辑的区别
在学习fpga的时序逻辑时，发现在时序逻辑中信号老是被延迟一个系统周期。在接下来的这篇论文中则详细的讲述了fpga时序逻辑和组合逻辑的区别。原文链接：https://blog.csdn.net/github_33678609/article/details/53436213数字电路根据逻辑功能的不同特点，可以分成两大类，一类叫组合逻辑电路（简称组合电路），另一类叫做时序逻辑电路（简称时序电路）。1．组合逻辑概念 组合逻辑电路在逻辑功能上的特点是任意时刻的输出仅仅取决于该时刻的输入，与...
2021-10-15 11:02:15
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原创 基于C语言的十进制转二十六进制
A~Z 《====》1~26AA~ZZ 《====》27~702AAA~ZZZ 《====》703~18278转换公式与其他进制相同：ZZZ=26*26^2+26*26^1+26=17576+676+26=18278#include"stdio.h"int ten_twentysix (int n,int a[]){ int i=0; while(n!=0) { if(n%26!=...
2021-09-29 20:38:16
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原创 关于C语言数组元素个数和长度的问题
定义一个数组例如 : int a[3]={1,2,3};其中数组中的元素个数为3，数组长度为3，数组元素也为3；但是很多初学者会犯一个错误： 因为数组打印数组时是按照：a[0]=1;a[1]=2;a[2]=3;在这里我们可以看出无法打印出a[3],因为在打印输出数组元素时，下标是从0开始的，但是当定义数组时是不能按照这个来的，数组中定义多少个元素就要声明相应的数组长度。...
2021-09-28 16:49:11
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原创 C-简单的数值比较大小和函数的分装与应用
#include<stdio.h>int max(int a,int b);//申明函数void main(){ int a,b,c; printf("请输入两个数字：\n"); scanf("%d %d",&a,&b); c=max(a,b); printf("输入中的数较大的是：%d\n",c);}int max(int a,int b)//定义max函数{ if(a>=b) return a; else ...
2021-09-13 21:13:13
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空空如也
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