Makefile的基本用法

Makefile是一个基于UNIX的编译工具,其功能强大,编写简便。

1、首先理解一下它的工作过程:
第一步:编译  把源文件编译成中间代码文件,win下就是.obj文件,unix下就是.o文件。
            此过程就是编译。
            
第二步:链接  将便已生成的大量object 文件合成一个可执行文件。
            此过程就是链接。
            
2、执行Makefile有几个小规则:
    如果这个工程没有编译过,执行make就会编译链接所有的源文件。
    如果修改了.c文件,执行make就会只编译链接这几个修改的.c文件。
    如果修改了.h文件,执行make就会编译链接使用过.h的多有源文件。
    
3、编写规则:
    套路:
    target : file
        command
        。。。
    target是一个目标文件,可以是中间件也可以是可执行文件。
    file是生成target所需要的文件。
    command是需要执行的shell命令。
    
    简单理解就是一种依赖关系,使用Makefile大部分目的是为得到可执行文件,
    那么target就是最终的可执行文件,根据GCC规则知道,可执行文件的生成需
    要依赖于.o文件,而.o文件的生成需要依赖于源文件。
    注意:Makefile语句的缩进必须使用tab键。
    
4、一个简单的事例:
    我们有5个.c文件,1个.h文件,编译个Makefile文件。

main : main.o add.o mul.o sub.o div.o
        gcc -g -o main main.o add.o mul.o sub.o div.o

	main.o : main.c header.h
        gcc -c main.c
	add.o : add.c header.h
        gcc -c add.c
	sub.o : sub.c header.h
        gcc -c sub.c
	div.o : div.c header.h
        gcc -c div.c

	.PHONY:clean
	clean:
			rm -f *.o main

    Makefile文件编写完成,在当前目录下执行make命令,便直接生成可执行文件main。
    执行make clean,便执行rm -f *.o main命令。

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Makefile 是一个用于管理和自动化软件项目中的编译和构建过程的工具。通过 Makefile,可以定义一系列规则和依赖关系,告诉计算机如何构建和更新项目。 以下是 Makefile基本使用方法: 1. 创建一个名为 "Makefile" 或 "makefile" 的文件,并将其放置在项目根目录下。 2. 在 Makefile 中定义规则。每个规则由以下几部分组成: - 目标(Target):规定了要生成的文件或执行的操作。 - 依赖(Dependencies):规定了生成目标所需要的文件或操作。 - 命令(Command):规定了生成目标的具体操作。 例如,下面是一个简单的 Makefile 示例: ```makefile target: dependency1 dependency2 command1 command2 ``` 3. 定义规则后,可以在命令行中使用 `make` 命令执行 Makefile 中的规则。例如,要执行上述示例中的目标 `target`,可以运行命令: ``` make target ``` 4. Makefile 还提供了一些特殊的变量和函数,可以用于更灵活地定义规则。一些常用的变量包括: - `CC`:C 编译器的名称。 - `CFLAGS`:编译选项。 - `LDFLAGS`:链接选项。 - `SRC`:源文件列表。 - `OBJ`:目标文件列表。 - `BIN`:生成的可执行文件名。 你可以在规则中使用这些变量,例如: ```makefile CC = gcc CFLAGS = -Wall -O2 target: $(OBJ) $(CC) $(LDFLAGS) -o $(BIN) $(OBJ) %.o: %.c $(CC) $(CFLAGS) -c $< -o $@ ``` 这是 Makefile基本使用方法,通过定义规则和使用 make 命令,你可以自动化编译和构建项目。更复杂的项目可能需要更详细的 Makefile 配置,你可以查阅相关文档来深入了解。

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