实际中断处理

最新推荐文章于 2022-06-15 11:14:44 发布

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分类专栏：操作系统与中间件文章标签：单片机 stm32 嵌入式硬件

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中断处理

处理外界发出的信号。中断信号可能是关于数据读写操作的，也可能与外部设备控制有关。Intel处理器只有一个外部中断引脚INTR，为了使处理器能够同时接收多个硬件设备发送来的中断请求信号，特将锁有外部设备的中断请求汇总到中断控制器，再经由中断控制器的仲裁后，有选择性地将中断请求信号依次发往处理器的外部中断引脚INTR。

再多核处理器出现前,8269A PIC(Programmable Interrupt Controller，可编程中断处理器)是最普遍的中断控制器.

目前APIC（Advanced Programmable Interrupt Controller,高级可编程中断控制器）应用于多核处理器更为优秀。

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在俩芯片级联的过程中，一个8259A芯片中断控制器作为主芯片，与CPU的INTR引脚相连；另一个8259A中断控制器作为从芯片，与主8259A芯片的IR2引脚相连。其他中断请求引脚IR将与外部硬件设备的中断请求引脚相连。

可编程：意味着必然拥有一系列可以配置的寄存器。

一个8259A芯片包含着两个寄存器组，分别是ICW(Initialization Command Word,初始化命令字)寄存器组和OCW(Operational Control Word,操作控制字 )寄存器组。其中ICW寄存器组用于初始化中断控制器，在8259A芯片正常工作前，必须对ICW寄存器组进行设置；OCW寄存器组用于操作中断控制器，在8259A芯片的工作过程中，读者可随时通过OCW寄存器设置和管理中断控制器的工作方式。

PC机采用I/O地址映射的方式，将8259A PIC寄存器映射到I/O端口地址空间，因此必须借助IN和OUT汇编指令才能访问8259A PIC。主8259A芯片的i/O端口地址是20h和21h，从8259A芯片的I/O端口是A0h和A1h。

通过IO端口可操作性中断控制器的ICW和OCW寄存器组，进而配置IRR、PR、ISR、IMR等寄存器。

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IRR(Interrupte Request Register ，中断请求寄存器)用来保存IR0_{IR7引脚上接受的中断请求，该寄存器有8bit分别对应外部引脚的IR0}IR7.
IMR(Interrupt Mask Register,中断屏蔽寄存器)用于记录屏蔽的外部引脚，该寄存器同样也有8位分别对应IRR寄存器中的每一位，当IMR中的某一位或某几位被置位时，相应的IR引脚的中断请求信号就会被屏蔽。
PR(Priority Resolver，优先级解析器) 将从IRR寄存器接受的中断请求中选取最高优先级者，将其发往ISR(In-Service Register,正在服务寄存器)

ISR中记录着正在处理的中断请求，同时8259A芯片还会向CPU发送一个INT信号，而CPU会在执行完一条指令后检测是否接收到中断请求信号。如果接收到中断请求信号，处理器将不再继续执行指令，转而向8259A芯片发送一个INTA来应答中断请求信号。芯片收到应答后，会将中断请求保存到ISR中，同时复位IRR寄存器。

随后，CPU还会向8259A芯片发出第二个INTA脉冲信号，其作用是通知8259A芯片发送中断向量号，此时8259A芯片会把中断向量号（8位数据）发送到数据总线上供CPU读取。当CPU接受到中断向量后，随机跳转至中断描述符表IDT检索向量号对应的门描述符，并执行门描述符中的处理程序。

如果8259A芯片采用AEOI(Automatic End of Interrupt，自动结束中断)，那么它将会在第二个INTA脉冲信号的结尾处复位正在服务寄存器的对应位。如果8259A芯片采用非自动结束方式，那么CPU必须在中断处理程序的结尾处向8259A芯片发送一个EOI(End Of Interrupt 结束中断命令)，来复位ISR的对应位。如果中断来自级联芯片，则必须向两个芯片都发送EOI命令。

此后，8259A继续判断下一个最高优先级的中断，并重复上述处理过程。

芯片初始化 ICW

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操作控制字OCW

OCW包含OCW1、OCW2、OCW3三个寄存器，他们用于控制和调整工作期间的中断控制器，这三个寄存器没有操作顺序之分。主8259A的OCW1寄存器映射到IO端口21h地址处，OCW2 OCW3寄存器映射到IO端口20h地址处；从8259A的OCW1映射到A1h地址处，OCW2,OCW3寄存器映射到IO端口A0h处。

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