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RSS订阅原创 单像素与双像素或4像素转换仿真
随着视频分辨率的提升（如4K、8K），像素时钟频率显著增加，例如8K@60Hz的像素时钟频率高达2089.750MHz。为了降低FPGA图像处理中的时钟频率，可以采用双像素模式或4像素模式，通过增加位宽来减少时钟频率。在视频传输中，单像素模式每个时钟传输1个像素点（24bit），双像素模式传输2个像素点（48bit，时钟频率减半），4像素模式传输4个像素点（96bit，时钟频率降至四分之一）。仿真工程展示了从单像素模式到双像素或4像素模式的转换过程，并通过仿真波形验证了转换的正确性。
2025-05-17 09:57:29
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原创 GBK与UTF-8编码问题(2)
在Python中使用open函数打开文本文件时，如果文件内容包含中文且显示乱码，通常是由于文件编码与默认编码不匹配所致。默认编码在Windows上通常是ANSI（如GBK），而在Linux/macOS上通常是UTF-8。解决方法有两种：一是在open函数中明确指定编码为utf-8，如open(filename, 'r', encoding='utf-8')；二是将文件编码转换为与默认编码一致，如使用Notepad++将文件编码改为GBK。
2025-05-13 21:42:19
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原创 GBK与UTF-8编码问题(1)
在编译Python代码时，如果遇到“SyntaxError: (unicode error) 'utf-8' codec can't decode byte 0xc4 in position 0: invalid continuation byte”类似错误，通常是因为文件编码方式与Python解释器的编码解析方式不一致。提供两种可行的解决方法。
2025-05-12 23:05:26
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原创 8b10b编解码仿真
8B/10B编码是一种将8位数据转换为10位符号的编码技术，由IBM工程师于1983年提出。其核心目标是通过引入冗余位实现直流平衡和时钟同步，广泛应用于高速数据传输场景。编码原理将8位数据分为高5位和低3位，分别编码为6位和4位符号，最终合并为10位符号。编码后的符号分为数据符号（D码）和控制符号（K码），并通过偏置值（Running Disparity, RD）机制保持整体平衡。
2025-05-09 23:31:28
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原创 DP1.4数据格式分析
学习DisplayPort最好的方法是在学习协议的同时能够抓取实际的数据查看。以下是DP接收实际抓取的数据。总的来说，DP传输数据时序与VESA时序是很接近的。也是以帧为单位，每帧有消隐行和数据有效行。
2025-04-26 11:07:58
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原创 FWFT_FIFO和Standard_FIFO对比仿真
在FPGA中使用FIFO时，如果使用FPGA厂商提供的FIFO IP，一般都会有First Word Fall Through FIFO和Standard FIFO类型选项，那么这两种FIFO有什么差异么。通过仿真对比，First Word Fall Through FIFO相比Standard FIFO最大的差别就是在读使能有效时，数据立刻输出没有延时。
2025-04-25 22:41:49
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原创 从FPGA实现角度介绍DP_Main_link主通道原理
DisplayPort（简称DP）是一个标准化的数字式视频接口标准，具有三大基本架构包含影音传输的主要通道（Main Link）、辅助通道（AUX）、与热插拔（HPD）。Main Link：用来传输各种类型的视频数据和音频数据，Main Link由1~4对差分线构成，这些数据线是单向的，从source指向sink。Main Link具体需要几对数据线，取决于屏幕的分辨率和颜色位数。
2025-04-19 22:52:25
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原创 DP 32bit位宽数据扰码实现和仿真
32bit数据扰码，每个时钟输入数据位宽为32bit，LFSR需要有四组，分别是移位8个时钟周期后输出，移位16个时钟周期后的输出，移位24个时钟周期后的输出，移位32个时钟周期后的输出，再根据DP协议规则分别与32bit数据中的4个字节按位异或输出，输出数据为32bit。
2025-04-17 23:29:16
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原创 DP 16bit位宽数据扰码实现和仿真
如何在1个时钟就能完成16bit数据的扰码呢？输入16bit数据可以分成2个8bit数据，其中1个8bit数据是与移位了8bit的LFSR的输出相异或，另1个8bit数据是与移位了16bit的LFSR的输出相异或。所以需要有2组LFSR寄存器。
2025-04-15 23:13:25
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原创 DP扰码LFSR输出公式推导
要得到n个时钟后LFSR输出值，可以将运算过程n次迭代后得到最终输出表达式。这样利用最终输出表达式，只需1个时钟就可以得到原先8个时钟以后的输出值。
2025-04-12 14:46:12
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原创 DP扰码模块verilog仿真
在DisplayPort 1.4协议中，为了减少EMI，在8B/10B编码之前，需进行扰码Scramble。LFSR每移位8个bit后，用最高有效 8 位以相反的位顺序与一个字节数据进行异或从而实现数据加扰/解扰。如果数据是K码，则不进行异或，直接输出K码数据。
2025-04-10 22:10:11
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原创 DP_AUX辅助通道介绍
DisplayPort（简称DP）是一个由PC及芯片制造商联盟开发，视频电子标准协会（VESA）标准化的数字式视频接口标准。其中辅助通道（AUX）是一条独立双向半双工的传输通道，它也是一对差分信号线。其数据传输速率1Mbps，用来传输配置参数与指令。
2025-04-09 21:43:22
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原创 HDMI接口类型介绍
HDMI可用于机顶盒、DVD播放机、数字音响与电视机等设备。HDMI可同时发送音频和视频信号，由于音频和视频信号采用同一条线材，大大简化系统线路的安装难度。HDMI目前主要有五种HDMI接口，分别是A，B，C，D，E Type。
2025-04-02 21:48:48
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原创 DisplayPort和HDMI各版本差异对比
DisplayPort简称DP，由VESA（PC及显示器行业联盟）制定，最新版本DP 2.1带宽可达80Gbps，主要服务于PC及专业显示器领域。我们来看看DP各版本有哪些差异。
2025-04-01 21:28:42
345
原创 3种实现MIPI_CRC模块的verilog代码仿真
MIPI（Mobile Industry Processor Interface）协议标准中计算数据校验和的方法是用16bit CRC校验来实现，生成多项式是x^16 + x^12 + x^5 + x^0。这里提供3种verilog实现代码并进行仿真验证。
2025-04-01 08:36:54
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原创 不同插值算法图像缩放效果对比
图像缩放Scaler功能是图像处理中的一种常用功能，目的是将输入图像从一种分辨率转换到另一种分辨率输出。介绍了不同插值算法，并对图像缩放效果做了对比。
2025-03-31 20:31:32
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原创 CRC校验verilog代码生成工具介绍
CRC校验verilog代码生成工具，在cmd命令提示符窗口，进入解压后目录crc-gen，输入命令 举例：D:\crc-gen> crc-gen verilog 8 16 1021，即可在当前窗口产生verilog代码。
2025-03-29 16:14:01
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原创 UART转APB模块ModelSim仿真
APB(Advance Peripheral Bus)也是一种常用的FPGA内部总线接口。UART转APB模块用于实现一种简单的通过上位机控制FPGA内部寄存器的方式。上位机通过串口助手发送读写寄存器的指令，UART转APB模块接收指令后解析出地址，命令，数据信息，然后转成APB总线格式输出。
2025-03-26 00:12:10
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原创 BMP位图格式解析和Modelsim仿真
介绍在硬件描述语言仿真平台中如果能简单地载入BMP图像文件和输出图像文件，并对BMP文件格式做个简单介绍。
2025-03-19 20:24:13
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原创 UART转AHB模块ModelSim仿真
UART转AHB模块用于实现一种简单的通过上位机控制FPGA内部寄存器的方式。上位机通过串口助手发送读写寄存器的指令，UART转AHB模块接收指令后解析出地址，命令，数据信息，然后转成AHB总线格式输出。
2025-03-17 21:20:35
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原创 UART转AHB总线接口参考设计介绍
Tang Nano 4K开发板上实现的UART转AHB总线接口参考设计，通过配置寄存器改变testpattern。
2025-03-14 00:07:28
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原创 帧率转换原理及读写指针实现
因为视频信号在传输过程中，输入和输出的帧率可能不同，例如输出要求固定是60帧/s，而输入是30帧/s，50帧/s，或是75帧/s等等，为了保证图像仍然连续传输，无撕裂现象，那么就需要做帧率转换。
2025-03-10 23:28:13
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原创 TangNano4K板改OV2640彩色输出
Tang Nano 4K开发板原来自带的参考例程中，ov2640摄像头配置的是RAW10格式，所以图像就是以灰度图呈现。修改初始化寄存器配置后，改成RGB565彩色图像显示。
2025-03-09 10:39:24
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原创 介绍一个能支持高带宽的EDID编辑软件
软件名称叫980 Manager 4.24.16，是一款由Quantum Data公司发布的EDID编辑软件。
2025-03-06 23:15:32
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原创 Tang Nano 4K开发板HDMI输出例程
Tang Nano 4K是由开源硬件厂商SiPEED矽速科技推出，基于高云半导体的小蜜蜂系列 GW1NSR-LV4C设计，内置M3硬核。板卡虽然小巧，但也包含有HDMI输出，DVP接口（外接OV2640摄像头），2个按键，1个LED灯，并且所有IO资源引出，方便开发者拓展使用。另外JTAG下载器已集成在板上，只需一根USB Type-C的线就可以实现下载调试，板卡供电也是依靠这条Type-C的线。
2025-03-02 00:30:36
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原创 国产FPGA开发板选择
选择合适的FPGA开发板是学习和开发FPGA的关键步骤，本文罗列了一些淘宝上的FPGA开发板店铺。希望读者能根据自身需求和预算，选择到合适的FPGA开发板，提升学习和开发效率。
2025-02-16 00:02:22
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原创 FPGA应用领域
FPGA凭借其灵活性、高性能和低延迟特性，在传统领域和新兴领域都得到了广泛应用。在传统领域，FPGA主要用于通信、工业控制、航空航天、医疗电子和消费电子等领域；在新兴领域，FPGA逐渐扩展到数据中心、人工智能、物联网、金融科技和科学研究等领域。随着技术的不断发展，FPGA的应用场景将会更加广泛，成为推动各行业技术进步的重要力量。
2025-02-11 22:58:04
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原创 图像Scaler缩放因子
图像Scaler缩放因子1 Scaler介绍2 缩放因子计算工具1 Scaler介绍Scaler功能就是我们常说的图像缩放功能，是图像处理中的一种常用功能，目的是将输入图像从一种分辨率转换到另一种分辨率输出。在实时系统中，还要满足视频实时输入实时输出的要求。我们将Scaler的输入图像称为原图，Scaler的输出图像称为目标图。图像缩放存在方向性：分为水平方向缩放和垂直方向缩放。在某个方向上，目标图的分辨率比原图的分辨率大，在这个方向上为图像放大。在某个方向上，目标图的分辨率比原图的分辨率小，在
2021-11-13 19:43:16
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原创 EDID编辑器介绍
EDID编辑器介绍1 EDID介绍2 DDC通道3 EDID编辑工具3.1 Phoenix EDID Designer3.2 Deltacast E-EDID Editor4 EDID烧录工具1 EDID介绍 EDID, Extended display identification data，中文名称扩展显示器识别数据，是VESA在制定DDC(Display Data Channel)显示器数据通道通信协议时，制定的有关显示器识别数据的标准。EDID存储在显示器中的DDC存储器中，当电脑主机与显示器
2021-10-25 19:44:21
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原创 如何评价去隔行效果
1 隔行图像基本概念1.1帧 为了更好地理解帧的概念，我们先看看电影放映的原理。 电影的放映就是将一幅幅画面放映到屏幕上。在画面更换时，就将光线遮住，更换完毕再将光线打开。在更换过程中，屏幕上就会出现短暂的黑暗，不过这种短暂的黑暗会被人的视觉生理现象“视觉暂留”所弥补。人眼观看物体时，成像于视网膜上，并由视神经输入人脑，感觉到物体的像。但当物体移去时，视神经对物体的印象不会立即消...
2019-08-08 22:47:43
1164
原创 图像bayer格式及bayer插值原理介绍
1 图像bayer格式介绍Bayer格式图片源自拜耳阵列，拜耳阵列是CCD或CMOS传感器拍摄彩色图像的主要技术之一。拜耳阵列是由伊士曼·柯达公司科学家Bryce Bayer发明的，被广泛运用数字图像。对于彩色图像，每个像素点可用RGB三种颜色来表示，最简单的采样方法就是在每个像素点上用三个滤镜，红色的滤镜透过红色的波长，绿色的滤镜透过绿色的波长，蓝色的滤镜透过蓝色的波长。这样一来为了采集R...
2019-03-31 18:05:00
18153
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原创 RGB转YCbCr422_BT709颜色空间转换仿真
1.前言表示图像颜色的方法除了RGB颜色模型之外，还有一些别的颜色模型，这些颜色模型被叫做色彩空间，色域空间，或颜色空间。常见的颜色空间有RGB，YIQ，HSV，YCbCr。RGB图像又称真彩色图像，R、G、B分别代表红、绿、蓝3种不同的颜色。YIQ空间对应NTSC模型，广泛应用于美国等国家的电视信号。Y表示亮度(luminance)，I表示色度(hue)，Q表示饱和度(saturati...
2019-03-16 22:49:13
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原创 ModelSim仿真图像输入和输出
目录1.前言2.框图3.图像输入4.图像输出5.仿真1.前言ModelSim仿真最麻烦的就是仿真平台的搭建，对于图像仿真来说，图像的输入输出就是搭建仿真平台的关键。本文介绍一下如何在ModelSim中实现图像的输入输出。2.框图在testbench中主要有两个模块，一个是图像输入模块driver，一个是图像输出模块monitor。Driver模块负责把bmp位图转换成RGB并行数据，Mo...
2019-03-12 00:37:47
5142
2
原创 视频领域FPGA平台式开发体系
随着产品上市速度要求，质量要求的不断提升，硬件和软件都在通过各自的方式提升自己的开发速度。硬件领域的模块化，软件领域的平台化，都已经取得了比较明显的效果。无论是在产品质量，开发速度，新员工快速上手方面，只要按照平台化的方式进行开发，都能很好的提升效率。因此，对于逻辑FPGA的开发，可以结合公司的产品其自身的特点，采用以下的FPGA平台式开发模式，将与底层硬件相关的IP(Intellectual ...
2019-03-12 00:34:41
295
支持单双及四像素模式testpattern仿真工程
2025-05-24
8b/10b编解码verilog仿真工程
2025-04-28
First Word Fall Through FIFO与Standard FIFO对比仿真
2025-04-24
显示技术DisplayPort 1.4标准详解：视频音频数据传输接口设计与优化
2025-04-19
DP 32bit位宽数据扰码模块仿真
2025-04-17
DP 16bit位宽数据扰码模块仿真
2025-04-15
DisplayPort 8bit数据扰码模块verilog仿真
2025-04-10
MIPI CRC校验功能实现verilog代码仿真
2025-03-31
CRC校验verilog代码生成工具
2025-03-29
用python语言实现的MIPI ECC和CRC计算工具
2025-03-27
UART转APB接口总线Modelsim仿真工程
2025-03-19
UART转AHB总线接口Modelsim仿真工程
2025-03-14
UART转AHB总线接口verilog实现参考设计
2025-03-13
Tang Nano 4K开发板参考例程更新IP
2025-03-03
EDID文件格式转换工具2
2022-04-23
RGB to YC颜色空间转换仿真
2019-03-13
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