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原创 在(不清楚设置的)模板上写论文--改图编号【仅作记录】

先从学校的模板,或者其他完美模板里复制。

2024-04-02 15:08:34 145

原创 WPS使用,当用“三个下划线(或者其他线)+回车键”打出分隔符后,再换页发现自动在页尾出现新的分隔符 问题的解决办法

*解决:**将鼠标光标定位在——出现新分隔符页面的末端,然后点击鼠标右键,点击“段落”,将选中的“如果定义了文档网格,则与网格对齐(W)”打勾去除,像下图,即解决。**

2023-12-15 15:54:17 449

原创 MUX实现反相器/与门/或门/与非门/或非门/异或门/同或门-合集

MUX实现反相器/与门/或门/与非门/或非门/异或门/同或门-合集

2023-08-11 21:47:44 755

原创 牛客verilogVL21 根据状态转移表实现时序电路

用三段式解法,之前图省事,中间部分nstate的赋值,一般都在always后面的括号直接写。,这次试着加入变量,结果理解不到位漏写。

2023-08-07 11:14:34 74

原创 牛客刷题verilog

这是通过的代码,但总觉得波形图不对,根据波形图。中间应该没有寄存器才对。

2023-08-07 09:56:07 48

原创 IC/FPGA秋招准备中遇到的有意思的题

欢迎讨论。

2023-07-30 11:36:11 906

原创 Verilog相关

verilog相关

2023-05-15 10:18:08 378

原创 Python记录

为了课题组项目,需要用python参与卷积神经网络训练、仿真以及部分功能性验证,结果图像显示,因此记录下载和使用过程。

2023-05-07 18:50:11 120 1

原创 modelsim遇到的问题

A:timescale左上角的一点是数字键1的左边那个键的点,而不是单引号的点。

2023-03-06 16:11:39 1894

原创 VIVADO使用——打开已有文件

Open Project打开.xpr文件。

2022-11-01 16:23:13 6521 1

原创 添加白名单不成功

文件添加白名单不成功,下载不了或者总是被自动删除。

2022-10-21 11:28:54 839

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