MSI中断与Linux

最新推荐文章于 2024-09-17 09:09:49 发布

harvey2008

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1.什么是MSI中断

Message Signaled Interrupts 是pci2.2中提出来的一种新的中断形式。后续有msi-x扩展。

msi以及msi-x这种中断形式的一个最主要的特点就是，它在系统的特定地址做一个memory write transaction，将一个系统约定的数据写入，以此通知CPU一个中断产生了。这个特点带来的最主要的好处就是脱离了传统的interrupt pin的约束，中断的数目也不再受到限制。

2.PCI规范中的MSI设计

msi以及msi-x的相关数据作为pci配置空间的一个capability structure来实现的。

msi的capability structure比较简单。

这是一个最简单的32为message 地址以及16位message 数据的msi capability structure。根据message control中的标记，地址可以是64位，还可能存在masking/pending域，用于对msi中断的屏蔽进行管理。

msi-x为了扩展支持更多的中断向量，其capability structure包含的是中断向量表的地址（由设备的bar来确定）。

（address和data的格式根据不同的体系结构有不同的实现方式。最简单的实现就可以是address就是一个固定的地址，data就是为其分配的中断向量号，这样root complex在发现对这个address写了数据，就会通知CPU对应的msi中断到了。当然，我们也可以细分这些数据结构，达到中断检查等目的）

3.Linux 2.6.26中的msi中断处理

以X86为例。

一般的流程是，设备驱动里面检查自己是否具有msi或者msi能力，如果有的话，调用driver/pci/msi.c中的pci_enable_msi或者pci_enable_msix。

这里以msi为例，msix稍微复杂一些，但原理类似。

int pci_enable_msi(struct pci_dev* dev)
{
int status;

status = pci_msi_check_device(dev, 1, PCI_CAP_ID_MSI);
if (status)
return status;

WARN_ON(!!dev->msi_enabled);

/* Check whether driver already requested for MSI-X irqs */
if (dev->msix_enabled) {
printk(KERN_INFO "PCI: %s: Can't enable MSI. "
"Device already has MSI-X enabled/n",
pci_name(dev));
return -EINVAL;
}
status = msi_capability_init(dev);
return status;

开始时检查，重点看msi_capability_init

static int msi_capability_init(struct pci_dev *dev)
{
struct msi_desc *entry;
int pos, ret;
u16 control;

msi_set_enable(dev, 0); /* Ensure msi is disabled as I set it up */

pos = pci_find_capability(dev, PCI_CAP_ID_MSI);
pci_read_config_word(dev, msi_control_reg(pos), &control);
/* MSI Entry Initialization */
entry = alloc_msi_entry();
if (!entry)
return -ENOMEM;

entry->msi_attrib.type = PCI_CAP_ID_MSI;
entry->msi_attrib.is_64 = is_64bit_address(control);
entry->msi_attrib.entry_nr = 0;
entry->msi_attrib.maskbit = is_mask_bit_support(control);
entry->msi_attrib.masked = 1;
entry->msi_attrib.default_irq = dev->irq; /* Save IOAPIC IRQ */
entry->msi_attrib.pos = pos;
if (is_mask_bit_support(control)) {
entry->mask_base = (void __iomem *)(long)msi_mask_bits_reg(pos,
    is_64bit_address(control));
}
entry->dev = dev;
if (entry->msi_attrib.maskbit) {
unsigned int maskbits, temp;
/* All MSIs are unmasked by default, Mask them all */
pci_read_config_dword(dev,
   msi_mask_bits_reg(pos, is_64bit_address(control)),
   &maskbits);
temp = (1 << multi_msi_capable(control));
temp = ((temp - 1) & ~temp);
maskbits |= temp;
pci_write_config_dword(dev,
   msi_mask_bits_reg(pos, is_64bit_address(control)),
   maskbits);
entry->msi_attrib.maskbits_mask = temp;
}
list_add_tail(&entry->list, &dev->msi_list);