技术问题交流
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Jazel
Lattice FPGA 螺丝工
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IMXRT1050开发板使用问题记录
IMXRT1050开发板使用问题记录原创 2023-02-08 10:59:50 · 272 阅读 · 0 评论 -
TI ADS1299使用BUG记录
基于Kintex-7系列FPGA驱动ADS1299开发过程中的BUG记录原创 2022-11-06 20:04:18 · 2019 阅读 · 52 评论 -
米联客udp_stack以太网协议栈使用教程
使用米联客udp_stack.dcp开发以太网的教程原创 2022-10-06 11:08:31 · 3260 阅读 · 20 评论 -
米联客含协议栈.dcp的工程仿真
使用新买的米联客K7开发板跑以太网通信的时候,使用的是米联客自己写的.dcp协议栈,然后仿真中是不能够直接调用的,本博客记录了解决方案。原创 2022-09-11 09:42:08 · 1625 阅读 · 2 评论 -
2023秋招英特尔Intel 软件/FPGA真题回忆录
2023秋招英特尔Intel 软件/FPGA真题回忆录原创 2022-09-09 11:10:38 · 1349 阅读 · 2 评论 -
研究生电子设计大赛参赛心得
研究生电子设计大赛参赛心得原创 2022-08-22 14:01:34 · 6709 阅读 · 9 评论 -
Lattice Propel在线Debug/Run
本文介绍的是Propel SDK中 Run和debug的使用,在使用了一段时间Propel(Propel SDK & Propel builder)这个“新手劝退软件 ”后,认为十分有必要记录一下部分操作以帮助新手绕过大坑!原创 2022-08-16 20:26:05 · 845 阅读 · 0 评论 -
Lattice Radiant烧写程序
Lattice Radiant烧写程序教程原创 2022-08-08 20:34:23 · 1664 阅读 · 0 评论 -
使用Xilinx Vivado重新设置IP参数时出错
Vivado报错提示Generate of output products did not run again as all output products were previously generated and up-to-date.原创 2022-08-06 09:34:00 · 2428 阅读 · 0 评论 -
Lattice Diamond设置Notepad++为默认编辑器
Lattice Diamond设置Notepad++为默认编辑器原创 2022-07-27 20:03:55 · 1093 阅读 · 0 评论 -
lattice的Diamond或Radiant打不开Modelsim
Lattice的Diamond或者Radiant打不开Modelsim原创 2022-07-27 14:49:55 · 802 阅读 · 0 评论 -
震惊~Signal <XXX> missing in the sensitivity list is added for synthesis purposes在verilog中警告的解决方法
你是否还在为秃头而烦恼?你是否还在通宵为了赶项目而焦急?朋友,你不是 一个人!看看吧,下面是这个bug的描述:WARNING:HDLCompiler:91 - "F:\FPGA_Doc\AD_test\uart.v" Line 56: Signal <symbol> missing in the sensitivity list is added for synthesis purposes. HDL and post-synthesis simulations may differ a原创 2020-09-30 11:01:36 · 2306 阅读 · 0 评论 -
震惊!!!Linux上安装Github报错:Permission denied (publickey)问题
震惊!!!Linux上安装Github报错:Permission denied (publickey)问题1.报错内容:No more authentication methods to try. git@github.com: Permission denied (publickey).2.进程:楼主已经完成了本地添加ssh秘钥以及在github上添加ssh秘钥;然而绝望的楼主在不断尝试将SSH公钥添加到github后依然验证失败之后(如上图所示),终于找到了最终解:3.首先输入ssh-age原创 2020-08-27 11:17:55 · 701 阅读 · 0 评论 -
震惊·X话最少的~“原理图更新到PCB时出现Unknown Pin: PinXXX 问题解决方案”
使用Altium Designer时,被它强大功能折服的你,是否有遇到过下面这令你绝望的问题呢?废话不多说,直接上干货:检查 “报错元器件” 的Scheme引脚与PCB封装的引脚是否有不对应的地方(如D3-3就是元件D3的第三个引脚)如果从这里看到的Pin Designerator与PCB引脚不对应的话,当然就要直接改啦!改完后,想要局部更新到PCBDoc,可以点击PCBDoc界面的Update XXX,也可以点击 原理图上的Design-> Update PCB document XX原创 2020-07-14 16:15:58 · 8548 阅读 · 3 评论