Linux 下 make 命令以及 Makefile 汇总

1、全面解析Linux Make规则

随着Linux的深入了解，我们知道为什么Linux会赶上微软。在当今社会Linux越来越成为主流，本文为你详细介绍Linux Make规则，为你在学习Linux Make规则时起一定的作用。这是一段在Makefile中常见的规则 。

　　1.clean:

　　2.rm -r core *.o *.a tmp_make

　　3.for i in *.c; do rm -f `basename $$i .c`.s; done

　　4.(cd chr_drv; make clean)

　　5.(cd blk_drv; make clean)

　　6.(cd math; make clean)

　　第一句的 rm -f core *. *.a tmp_make 作用只是删除文件，意思直白，没什么好说的。

　　第二句 for 循环遍历目录下所有的文件，将所有后缀名为.c文件名依次赋给i。然后执行do语句，当符合循环结束是执行done。可以说这里的for和shell里for语法是如此貌似。

　　我们可以来做个实验来验证一下：

　　1.$ mkdir test #建立个实验用的目录

　　2.$ cd test

　　3.$ touch a.x #建几个实验用的文件

　　4.$ touch b.x

　　5.$ touch yy.x

　　6.$ vi Makefile #写个实验脚本

　　在文件中写入：

　　clean:

　　    for i in *.x; do echo $$i; done

　　写好后，保存退出。运行命令：

　　$ make

　　随后可看到输出的结果：

　　1.for i in *.x;do echo $i;done

　　2.a.x

　　3.b.x

　　4.yy.x

　　看到结果，for语句实现的功能就很清楚了。

　　对于结果，有一个怪异的就是，原来脚本中的$$i，在输出是就变成了$i。这时的for是不是就是一样了。现在可以先做个结论，make处理脚本可shell处理脚本几乎雷同，只是个别情况下要做变通。make会对$x进行扩展。比如：

　　1.ec=echo

　　2.test:

　　3.$(ec) 'ddd'

　　就可以在屏幕上看到输出：

　　1.echo 'ddd'

　　2.ddd

　　所以应该是make对Makefile进行处理，将其变成shell可执行的脚本，最后由shell解释器来执行有make翻译过的脚本。并且是翻译一句然后shell执行一句，对于这个可以再做个验证。

　　1.e =echo

　　2.prt=ls

　　3.clean:

　　4.$(prt)

　　5.for i in *.x;do $e $$i;done

　　其输出为：

　　1.ls

　　2.a.sh a.x b.x Makefile yy.x

　　3.for i in *.x;do echo $i;done

　　4.a.x

　　5.b.x

　　6.yy.x

　　可以看到，$(prt)被扩展后就立即执行了。后面的for也是这样。

　　到这里开篇的那个例子算是解析完毕了。下面在看看Makefile中的规则定义，在make中的规则分为两种，一种是显示规则，另一种无可争议的就是隐含规则了。

　　显示规则，定义如下

　　目标文件 : 依赖文件

　　生成目标文件的规则

　　隐含规则

　　.源文件扩展名.目标文件扩展名:

　　生成目标文件的规则

　　在使用隐含规则时要使用一些内定宏来指定文件名：

　　$@ 全路径的目标文件

　　$* 去除扩张名的全路径的目标文件

　　$? 所有源文件名

　　$< 源文件名

　　以上就是Linux Make规则的知识。

 

原文地址：http://www.xxlinux.com/linux/article/accidence/technique/20100415/18205.html

 

 

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2、 Linux/Unix环境下的make命令详解

无论是在Linux还是在Unix环境中，make都是一个非常重要的编译命令。　　Makefile文件

　　Make工具最主要也是最基本的功能就是通过makefile文件来描述源程序之间的相互关系并自动维护编译工作。而makefile 文件需要按照某种语法进行编写，文件中需要说明如何编译各个源文件并连接生成可执行文件，并要求定义源文件之间的依赖关系。makefile 文件是许多编译器--包括 Windows NT 下的编译器--维护编译信息的常用方法，只是在集成开发环境中，用户通过友好的界面修改 makefile 文件而已。

　　在 UNIX 系统中，习惯使用 Makefile 作为 makfile 文件。如果要使用其他文件作为 makefile，则可利用类似下面的 make 命令选项指定 makefile 文件：

　　$ make -f Makefile.debug

　　例如，一个名为prog的程序由三个C源文件filea.c、fileb.c和filec.c以及库文件LS编译生成，这三个文件还分别包含自己的头文件a.h 、b.h和c.h。通常情况下，C编译器将会输出三个目标文件filea.o、fileb.o和filec.o。假设filea.c和fileb.c都要声明用到一个名为defs的文件，但filec.c不用。即在filea.c和fileb.c里都有这样的声明：

　　#include "defs"

　　那么下面的文档就描述了这些文件之间的相互联系:

　　　#It is a example for describing makefile
　　　prog : filea.o fileb.o filec.o
　　　cc filea.o fileb.o filec.o -LS -o prog
　　　filea.o : filea.c a.h defs
　　　cc -c filea.c
　　　fileb.o : fileb.c b.h defs
　　　cc -c fileb.c
　　　filec.o : filec.c c.h
　　　cc -c filec.c

　　这个描述文档就是一个简单的makefile文件。

　　从上面的例子注意到，第一个字符为 # 的行为注释行。第一个非注释行指定prog由三个目标文件filea.o、fileb.o和filec.o链接生成。第三行描述了如何从prog所依赖的文件建立可执行文件。接下来的4、6、8行分别指定三个目标文件，以及它们所依赖的.c和.h文件以及defs文件。而5、7、9行则指定了如何从目标所依赖的文件建立目标。

　　当filea.c或a.h文件在编译之后又被修改，则 make 工具可自动重新编译filea.o，如果在前后两次编译之间，filea.C 和a.h 均没有被修改，而且 test.o 还存在的话，就没有必要重新编译。这种依赖关系在多源文件的程序编译中尤其重要。通过这种依赖关系的定义，make 工具可避免许多不必要的编译工作。当然，利用 Shell 脚本也可以达到自动编译的效果，但是，Shell 脚本将全部编译任何源文件，包括哪些不必要重新编译的源文件，而 make 工具则可根据目标上一次编译的时间和目标所依赖的源文件的更新时间而自动判断应当编译哪个源文件。

　　Makefile文件作为一种描述文档一般需要包含以下内容:

　　◆ 宏定义
　　◆ 源文件之间的相互依赖关系
　　◆ 可执行的命令

　　Makefile中允许使用简单的宏指代源文件及其相关编译信息，在Linux中也称宏为变量。在引用宏时只需在变量前加$符号，但值得注意的是，如果变量名的长度超过一个字符，在引用时就必须加圆括号（）。

　　下面都是有效的宏引用：

　　$(CFLAGS)
　　$2
　　$Z
　　$(Z)

　　其中最后两个引用是完全一致的。

　　需要注意的是一些宏的预定义变量，在Unix系统中，$*、$@、$?和$<四个特殊宏的值在执行命令的过程中会发生相应的变化，而在GNU make中则定义了更多的预定义变量。关于预定义变量的详细内容，宏定义的使用可以使我们脱离那些冗长乏味的编译选项，为编写makefile文件带来很大的方便。

　　　# Define a macro for the object files
　　　OBJECTS= filea.o fileb.o filec.o
　　　# Define a macro for the library file
　　　LIBES= -LS
　　　# use macros rewrite makefile
　　　prog: $(OBJECTS)
　　　cc $(OBJECTS) $(LIBES) -o prog
　　　……

　　此时如果执行不带参数的make命令，将连接三个目标文件和库文件LS；但是如果在make命令后带有新的宏定义：

　　make "LIBES= -LL -LS"

　　则命令行后面的宏定义将覆盖makefile文件中的宏定义。若LL也是库文件，此时make命令将连接三个目标文件以及两个库文件LS和LL。

　　在Unix系统中没有对常量NULL作出明确的定义，因此我们要定义NULL字符串时要使用下述宏定义：

　　STRINGNAME=

　　Make命令

　　在make命令后不仅可以出现宏定义，还可以跟其他命令行参数，这些参数指定了需要编译的目标文件。其标准形式为：

　　target1 [target2 …]:[:][dependent1 …][;commands][#…]
　　[(tab) commands][#…]

　　方括号中间的部分表示可选项。Targets和dependents当中可以包含字符、数字、句点和"/"符号。除了引用，commands中不能含有"#",也不允许换行。

　　在通常的情况下命令行参数中只含有一个":"，此时command序列通常和makefile文件中某些定义文件间依赖关系的描述行有关。如果与目标相关连的那些描述行指定了相关的command序列，那么就执行这些相关的command命令，即使在分号和(tab)后面的aommand字段甚至有可能是NULL。如果那些与目标相关连的行没有指定command，那么将调用系统默认的目标文件生成规则。

　　如果命令行参数中含有两个冒号"::"，则此时的command序列也许会和makefile中所有描述文件依赖关系的行有关。此时将执行那些与目标相关连的描述行所指向的相关命令。同时还将执行build-in规则。

　　如果在执行command命令时返回了一个非"0"的出错信号，例如makefile文件中出现了错误的目标文件名或者出现了以连字符打头的命令字符串，make操作一般会就此终止，但如果make后带有"-i"参数，则make将忽略此类出错信号。

　　Make命本身可带有四种参数：标志、宏定义、描述文件名和目标文件名。其标准形式为：

　　Make [flags] [macro definitions] [targets]

　　Unix系统下标志位flags选项及其含义为：

　　-f file　 指定file文件为描述文件，如果file参数为"-"符，那么描述文件指向标准输入。如果没有"-f"参数，则系统将默认当前目录下名为 makefile或者名为Makefile的文件为描述文件。在Linux中， GNU make 工具在当前工作目录中按照GNUmakefile、makefile、Makefile的顺序搜索 makefile文件。

　　-i 　　忽略命令执行返回的出错信息。
　　-s 　　沉默模式，在执行之前不输出相应的命令行信息。
　　-r 　　禁止使用build-in规则。
　　-n 　　非执行模式，输出所有执行命令，但并不执行。
　　-t 　　更新目标文件。
　　-q　　 make操作将根据目标文件是否已经更新返回"0"或非"0"的状态信息。
　　-p　　 输出所有宏定义和目标文件描述。
　　-d　　 Debug模式，输出有关文件和检测时间的详细信息。

　　Linux下make标志位的常用选项与Unix系统中稍有不同，下面我们只列出了不同部分：

　　-c dir　　 在读取 makefile 之前改变到指定的目录dir。
　　-I dir 　　当包含其他 makefile文件时，利用该选项指定搜索目录。
　　-h 　　help文挡，显示所有的make选项。
　　-w 　　在处理 makefile 之前和之后，都显示工作目录。

　　通过命令行参数中的target ，可指定make要编译的目标，并且允许同时定义编译多个目标，操作时按照从左向右的顺序依次编译target选项中指定的目标文件。如果命令行中没有指定目标，则系统默认target指向描述文件中第一个目标文件。

　　通常，makefile 中还定义有 clean 目标，可用来清除编译过程中的中间文件，例如：

　　clean:
　　rm -f *.o

　　运行 make clean 时，将执行 rm -f *.o 命令，最终删除所有编译过程中产生的所有中间文件。

　　隐含规则

　　在make 工具中包含有一些内置的或隐含的规则，这些规则定义了如何从不同的依赖文件建立特定类型的目标。Unix系统通常支持一种基于文件扩展名即文件名后缀的隐含规则。这种后缀规则定义了如何将一个具有特定文件名后缀的文件（例如.c文件），转换成为具有另一种文件名后缀的文件（例如.o文件）：

　　.c:.o
　　$(CC) $(CFLAGS) $(CPPFLAGS) -c -o $@ $<
　　系统中默认的常用文件扩展名及其含义为：
　　.o 　目标文件
　　.c 　C源文件
　　.f 　FORTRAN源文件
　　.s 　汇编源文件
　　.y 　Yacc-C源语法
　　.l 　Lex源语法

　　在早期的Unix系统系统中还支持Yacc-C源语法和Lex源语法。在编译过程中，系统会首先在makefile文件中寻找与目标文件相关的.C文件，如果还有与之相依赖的.y和.l文件，则首先将其转换为.c文件后再编译生成相应的.o文件；如果没有与目标相关的.c文件而只有相关的.y文件，则系统将直接编译.y文件。

　　而GNU make 除了支持后缀规则外还支持另一种类型的隐含规则--模式规则。这种规则更加通用，因为可以利用模式规则定义更加复杂的依赖性规则。模式规则看起来非常类似于正则规则，但在目标名称的前面多了一个 % 号，同时可用来定义目标和依赖文件之间的关系，例如下面的模式规则定义了如何将任意一个 file.c 文件转换为 file.o 文件：

　　%.c:%.o
　　$(CC) $(CFLAGS) $(CPPFLAGS) -c -o $@ $<
#EXAMPLE#

　　下面将给出一个较为全面的示例来对makefile文件和make命令的执行进行进一步的说明，其中make命令不仅涉及到了C源文件还包括了 Yacc语法。本例选自"Unix Programmer's Manual 7th Edition, Volume 2A" Page 283-284

　　下面是描述文件的具体内容：

　　　#Description file for the Make command
　　　#Send to print
　　　P=und -3 | opr -r2
　　　#The source files that are needed by object files
　　　FILES= Makefile version.c defs main.c donamc.c misc.c file.c /
　　　dosys.c gram.y lex.c gcos.c
　　　#The definitions of object files
　　　OBJECTS= vesion.o main.o donamc.o misc.o file.o dosys.o gram.o
　　　LIBES= -LS
　　　LINT= lnit -p
　　　CFLAGS= -O
　　　make: $(OBJECTS)
　　　cc $(CFLAGS) $(OBJECTS) $(LIBES) -o make
　　　size make
　　　$(OBJECTS): defs
　　　gram.o: lex.c
　　　cleanup:
　　　-rm *.o gram.c
　　　install:
　　　@size make /usr/bin/make
　　　cp make /usr/bin/make ; rm make
　　　#print recently changed files
　　　print: $(FILES)
　　　pr $? | $P
　　　touch print
　　　test:
　　　make -dp | grep -v TIME>;1zap
　　　/usr/bin/make -dp | grep -v TIME>;2zap
　　　diff 1zap 2zap
　　　rm 1zap 2zap
　　　lint: dosys.c donamc.c file.c main.c misc.c version.c gram.c
　　　$(LINT) dosys.c donamc.c file.c main.c misc.c version.c /
　　　gram.c
　　　rm gram.c
　　　arch:
　　　ar uv /sys/source/s2/make.a $(FILES)

　　通常在描述文件中应象上面一样定义要求输出将要执行的命令。在执行了make命令之后，输出结果为：

　　$ make
　　cc -c version.c
　　cc -c main.c
　　cc -c donamc.c
　　cc -c misc.c
　　cc -c file.c
　　cc -c dosys.c
　　yacc gram.y
　　mv y.tab.c gram.c
　　cc -c gram.c
　　cc version.o main.o donamc.o misc.o file.o dosys.o gram.o /
　　-LS -o make
　　13188+3348+3044=19580b=046174b

　　最后的数字信息是执行"@size make"命令的输出结果。之所以只有输出结果而没有相应的命令行，是因为"@size make"命令以"@"起始，这个符号禁止打印输出它所在的命令行。

　　描述文件中的最后几条命令行在维护编译信息方面非常有用。其中"print"命令行的作用是打印输出在执行过上次"make print"命令后所有改动过的文件名称。系统使用一个名为print的0字节文件来确定执行print命令的具体时间，而宏$?则指向那些在print 文件改动过之后进行修改的文件的文件名。如果想要指定执行print命令后，将输出结果送入某个指定的文件，那么就可修改P的宏定义：

　　make print "= cat>;zap"

　　在Linux中大多数软件提供的是源代码，而不是现成的可执行文件，这就要求用户根据自己系统的实际情况和自身的需要来配置、编译源程序后，软件才能使用。只有掌握了make工具，才能让我们真正享受到到Linux这个自由软件世界的带给我们无穷乐趣。

 

原文地址：http://bbs.chinaunix.net/viewthread.php?tid=372282

 

 

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3、MakeFile 文件的作用

 

去支付宝面试，面试官问我了一个问题：Makefile的作用，我没有回答上来。今特找来放到这里，叫我不要忘记面试那天的情况。

 

     makefile文件保存了编译器和连接器的参数选项,还表述了所有源文件之间的关系(源代码文件需要的特定的包含文件,可执行文件要求包含的目标文件模块及库等).创建程序(make程序)首先读取makefile文件,然后再激活编译器,汇编器,资源编译器和连接器以便产生最后的输出,最后输出并生成的通常是可执行文件.创建程序利用内置的推理规则来激活编译器,以便通过对特定CPP文件的编译来产生特定的OBJ文件.  
  附上原文:  
  Experienced   programmers   are   familiar   with   makefiles.   A   makefile   stores   compiler   and   linker   options   and   expresses   all   the   interrelationships   among   source   files.   (A   source   code   file   needs   specific   include   files,   an   executable   file   requires   certain   object   modules   and   libraries,   and   so   forth.)   A   make   program   reads   the   makefile   and   then   invokes   the   compiler,   assembler,   resource   compiler,   and   linker   to   produce   the   final   output,   which   is   generally   an   executable   file.   The   make   program   uses   built-in   inference   rules   that   tell   it,   for   example,   to   invoke   the   compiler   to   generate   an   OBJ   file   from   a   specified   CPP   file.

 

一、Makefile里有什么？

Makefile里主要包含了五个东西：显式规则、隐晦规则、变量定义、文件指示和注释。

1、显式规则。显式规则说明了，如何生成一个或多的的目标文件。这是由Makefile的书写者明显指出，要生成的文件，文件的依赖文件，生成的命令。

2、隐晦规则。由于我们的make有自动推导的功能，所以隐晦的规则可以让我们比较粗糙地简略地书写Makefile，这是由make所支持的。

3、变量的定义。在Makefile中我们要定义一系列的变量，变量一般都是字符串，这个有点你C语言中的宏，当Makefile被执行时，其中的变量都会被扩展到相应的引用位置上。

4、文件指示。其包括了三个部分，一个是在一个Makefile中引用另一个Makefile，就像C语言中的include一样；另一个是指根据某些情况指定Makefile中的有效部分，就像C语言中的预编译#if一样；还有就是定义一个多行的命令。有关这一部分的内容，我会在后续的部分中讲述。

5、注释。Makefile中只有行注释，和UNIX的Shell脚本一样，其注释是用“#”字符，这个就像C/C++中的“//”一样。如果你要在你的Makefile中使用“#”字符，可以用反斜框进行转义，如：“/#”。

最后，还值得一提的是，在Makefile中的命令，必须要以[Tab]键开始。

二、Makefile的文件名

默认的情况下，make命令会在当前目录下按顺序找寻文件名为“GNUmakefile”、“makefile”、“Makefile”的文件，找到了解释这个文件。在这三个文件名中，最好使用“Makefile”这个文件名，因为，这个文件名第一个字符为大写，这样有一种显目的感觉。最好不要用 “GNUmakefile”，这个文件是GNU的make识别的。有另外一些make只对全小写的“makefile”文件名敏感，但是基本上来说，大多数的make都支持“makefile”和“Makefile”这两种默认文件名。

当然，你可以使用别的文件名来书写Makefile，比如：“Make.Linux”，“Make.Solaris”，“Make.AIX”等，如果要指定特定的Makefile，你可以使用make的“-f”和“--file”参数，如：make -f Make.Linux或 make --file Make.AIX。

三、引用其它的Makefile

在Makefile使用include关键字可以把别的Makefile包含进来，这很像C语言的#include，被包含的文件会原模原样的放在当前文件的包含位置。include的语法是：

     include <filename>;

     filename可以是当前操作系统Shell的文件模式（可以保含路径和通配符）

在include前面可以有一些空字符，但是绝不能是[Tab]键开始。include和<filename>;可以用一个或多个空格隔开。举个例子，你有这样几个Makefile：a.mk、b.mk、c.mk，还有一个文件叫foo.make，以及一个变量$(bar)，其包含了 e.mk和f.mk，那么，下面的语句：

     include foo.make *.mk $(bar)

     等价于：

     include foo.make a.mk b.mk c.mk e.mk f.mk

make命令开始时，会把找寻include所指出的其它Makefile，并把其内容安置在当前的位置。就好像C/C++的#include指令一样。如果文件都没有指定绝对路径或是相对路径的话，make会在当前目录下首先寻找，如果当前目录下没有找到，那么，make还会在下面的几个目录下找：

     1、如果make执行时，有“-I”或“--include-dir”参数，那么make就会在这个参数所指定的目录下去寻找。
     2、如果目录<prefix>;/include（一般是：/usr/local/bin或/usr/include）存在的话，make也会去找。

如果有文件没有找到的话，make会生成一条警告信息，但不会马上出现致命错误。它会继续载入其它的文件，一旦完成makefile的读取，make会再重试这些没有找到，或是不能读取的文件，如果还是不行，make才会出现一条致命信息。如果你想让make不理那些无法读取的文件，而继续执行，你可以在include前加一个减号“-”。如：

     -include <filename>;
     其表示，无论include过程中出现什么错误，都不要报错继续执行。和其它版本make兼容的相关命令是sinclude，其作用和这一个是一样的。

四、环境变量 MAKEFILES

如果你的当前环境中定义了环境变量MAKEFILES，那么，make会把这个变量中的值做一个类似于include的动作。这个变量中的值是其它的Makefile，用空格分隔。只是，它和include不同的是，从这个环境变中引入的Makefile的“目标”不会起作用，如果环境变量中定义的文件发现错误，make也会不理。

但是在这里我还是建议不要使用这个环境变量，因为只要这个变量一被定义，那么当你使用make时，所有的Makefile都会受到它的影响，这绝不是你想看到的。在这里提这个事，只是为了告诉大家，也许有时候你的Makefile出现了怪事，那么你可以看看当前环境中有没有定义这个变量。

五、make的工作方式

GNU的make工作时的执行步骤入下：（想来其它的make也是类似）

     1、读入所有的Makefile。
     2、读入被include的其它Makefile。
     3、初始化文件中的变量。
     4、推导隐晦规则，并分析所有规则。
     5、为所有的目标文件创建依赖关系链。
     6、根据依赖关系，决定哪些目标要重新生成。
     7、执行生成命令。

1-5步为第一个阶段，6-7为第二个阶段。第一个阶段中，如果定义的变量被使用了，那么，make会把其展开在使用的位置。但make并不会完全马上展开，make使用的是拖延战术，如果变量出现在依赖关系的规则中，那么仅当这条依赖被决定要使用了，变量才会在其内部展开。

当然，这个工作方式你不一定要清楚，但是知道这个方式你也会对make更为熟悉。有了这个基础，后续部分也就容易看懂了。

 

原文地址：http://blog.sina.com.cn/s/blog_5fd6a0e50100g89d.html