实验记录
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明天一定早睡早起
乐于开坑,苦于填坑。
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tensor转cv::Mat(即CHW转HWC)原理含C#代码实现
将模型预测输出tensor的shape从CHW转成OpenCV中的cv::Mat类型数据。原创 2022-08-06 17:56:47 · 3201 阅读 · 2 评论 -
flask局域网访问失败解决方法(使用pycharm运行代码的一定要看)
flask局域网访问失败解决方法,使用pycharm运行代码的一定要看看原创 2022-07-19 17:48:46 · 3123 阅读 · 0 评论 -
ConvNext笔记
1.drop path1.1.复习下dropout早些时候学习过drop out,先回顾下drop out的原理。简单来说,就是在训练过程中随机“失活”部分神经元。,如图所示:所谓失活,就是将神经元的输出值置0。更具体来说,我们现在所用的dropout都是Inverted Dropout,即训练过程中除去失活的神经元外,对剩余的神经元进行缩放。那么我们为什么要进行缩放呢?这就不得不提到早先时候dropout原始论文所提到的“朴素版”,也称为Vanilla Dropout早先Vanilla D原创 2022-05-10 09:22:22 · 2120 阅读 · 4 评论 -
PatchEmbed代码讲解记录
PatchEmbed代码首先上代码。class PatchEmbed(nn.Module): """ Image to Patch Embedding """ def __init__(self, img_size=256, patch_size=8, in_chans=3, embed_dim=512): super().__init__() img_size = to_2tuple(img_size) patch_size =原创 2022-04-28 17:06:32 · 7212 阅读 · 8 评论 -
解决pyqt5 DLL load failed: 找不到指定的程序的问题
解决pyqt5 DLL load failed: 找不到指定的程序的问题做个记录以防下次再遇到同样的问题。遇到类似问题的朋友可以直接看文章最后总结。感谢其他博主提供的教程。关于pyqt5的安装可以参考pycharm+PyQt5+python最新开发环境配置,踩坑过程详解安装过程大同小异,基本是安装pyqt5和pyqt5-tools,如果用到webengine似乎对pyqt5的版本还有要求。然后配置qt designer和pyuic,还有一个pyrcc我还没用过所以就没配置。进入正题:起因是anac原创 2022-04-13 21:09:24 · 4088 阅读 · 3 评论 -
Ubuntu20.04 编译 darknet 训练yolov3-tiny 记录
Ubuntu20.4 编译 darknet 训练yolov3-tiny 记录帮学弟训练配的,编译踩了些坑故记录一下。配置及环境GPU:GTX1050TICUDA/CUDNN:11.21. git darknetgit clone https://github.com/pjreddie/darknet2.修改makefile文件GPU=1 #如果使用GPU设置为1,CPU设置为0CUDNN=0 #如果使用CUDNN设置为1,否则为0OPENCV=0 #如果调用摄像头,还需要设置OP原创 2022-03-31 01:31:21 · 1811 阅读 · 9 评论 -
Visio画神经网络卷积层
简单记录下,画的是类似这种的首先选择基本形状里的正方形,手动调整下大小接着我们选中这个正方形,点击上方的视图然后选择加载项→其他Visio方案→排列形状选择形状边缘之间,间距全部设置为0,数目根据需要进行设置,这里示范一下生成一个3行3列的生成的结果如图接下来我们重新框住新生成的这个3x3的正方形(一定要全部框住!!!),右键选择组合组合以后我们可以直接拖动这个大块的正方形了,然后我们继续右键,选择设置形状格式在右边弹出的界面按照图中红色箭头找到三维旋转里面的预设我们选择原创 2021-11-18 10:27:11 · 11488 阅读 · 12 评论 -
petalinux离线编译
petalinux离线编译1.准备aarch64 sstate-cache和downloads文件2.配置1.准备aarch64 sstate-cache和downloads文件以2020.1版本为例,首先要到XILINX官网下载aarch64 sstate-cache和downloads文件并解压2.配置以2020.1版本为例,首先要到XILINX官网下载aarch64 sstate-cache和downloads文件并解压...原创 2021-10-10 19:49:20 · 960 阅读 · 0 评论 -
Vitis部分实验记录
Vitis部分实验记录环境ARM裸机输出hello world硬件平台工程APP工程测试JTAG模式SD卡模式QSPI模式环境Ubuntu18.04Vitis2020.1ARM裸机输出hello world前提:FPGA工程师已完成Vivado硬件设计部分(XSA)按照course_s2的1.3部分创建vitis工程, 工程包含两个部分,一个是硬件平台工程(由FPGA工程师完成),另一个部分为APP工程(由软件工程师完成)。Vitis最好是根据不同的项目新建不同的工作空间,以免造成工程混乱。原创 2021-10-10 18:09:02 · 754 阅读 · 0 评论