自己动手写CPU之第九阶段（5）——实现加载存储指令1（修改译码阶段）

最新推荐文章于 2023-07-31 22:53:31 发布

leishangwen

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分类专栏：自己动手写CPU 文章标签： MIPS 处理器开源自己动手写CPU 软核

本文链接：https://blog.csdn.net/leishangwen/article/details/40273717

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本文介绍如何修改OpenMIPS处理器的译码阶段以支持加载存储指令，包括lb、lwl等，详细阐述了对ID模块和ID/EX模块的修改，涉及寄存器读写和运算类型的选择。

摘要由CSDN通过智能技术生成

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9.3 修改OpenMIPS以实现加载存储指令

9.3.1 修改译码阶段

1、修改ID模块

参考图9-19可知，ID模块要增加接口inst_o，如表9-1所示。

在ID模块还要增加对加载存储指令的分析，根据图9-1、9-2、9-6、9-12给出的加载存储指令的格式可知，这些指令的指令码都是不同的，所以可以直接依据指令码确定是哪一种指令，确定指令的过程如图9-20所示。

其中涉及的宏定义如下，正是各个加载存储指令的指令码，在本书附带光盘Code\Chapter9_1目录下的defines.v文件可以找到这些定义。

`define EXE_LB   6'b100000
`define EXE_LBU  6'b100100
`define EXE_LH   6'b100001
`define EXE_LHU  6'b100101
`define EXE_LW   6'b100011
`define EXE_LWL  6'b100010
`define EXE_LWR  6'b100110
`define EXE_SB   6'b101000
`define EXE_SH   6'b101001
`define EXE_SW   6'b101011
`define EXE_SWL  6'b101010
`define EXE_SWR  6'b101110

修改译码阶段的ID模块如下。完整代码请参考本书附带光盘Code\Chapter9_1目录下的id.v文件。

module id(
  ......
	
  output wire[`RegBus]          inst_o,   // 新增加的输出接口
	
  ......
);

  ......

  assign inst_o = inst_i;    // inst_o的值就是译码阶段的指令
    
  always @ (*) begin
    if (rst == `RstEnable) begin
     ......
    en