在clk信号由1到0变化的时候,如果D信号还在变化,那Q存储的结果就是不稳定的
此时需要clk信号由1变0的前面一段时间Tsu,之后的一段时间Th内,D信号保持稳定。
有三角表示正边缘触发
三角加圈负边缘 触发
2020/5/25数字逻辑 触发器和寄存器
最新推荐文章于 2024-04-30 12:06:03 发布
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在clk信号由1到0变化的时候,如果D信号还在变化,那Q存储的结果就是不稳定的
此时需要clk信号由1变0的前面一段时间Tsu,之后的一段时间Th内,D信号保持稳定。
有三角表示正边缘触发
三角加圈负边缘 触发