54.makefile 实例

凌琳天上

已于 2022-03-05 19:28:06 修改

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分类专栏：应用文章标签： linux

于 2022-03-04 20:43:22 首次发布

本文链接：https://blog.csdn.net/linglintianshang/article/details/123273602

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一个例子

Makefile


CROSS_COMPILE = arm-linux-
AS		= $(CROSS_COMPILE)as
LD		= $(CROSS_COMPILE)ld
CC		= $(CROSS_COMPILE)gcc
CPP		= $(CC) -E
AR		= $(CROSS_COMPILE)ar
NM		= $(CROSS_COMPILE)nm

STRIP		= $(CROSS_COMPILE)strip
OBJCOPY		= $(CROSS_COMPILE)objcopy
OBJDUMP		= $(CROSS_COMPILE)objdump

export AS LD CC CPP AR NM
export STRIP OBJCOPY OBJDUMP

CFLAGS := -Wall -Werror -O2 -g
CFLAGS += -I $(shell pwd)/include

LDFLAGS := -lm -lfreetype -lts -lpthread -ljpeg

export CFLAGS LDFLAGS

TOPDIR := $(shell pwd)
export TOPDIR

TARGET := digitpic


obj-y += main.o
obj-y += display/
obj-y += encoding/
obj-y += fonts/
obj-y += input/
obj-y += debug/
obj-y += render/
obj-y += page/
obj-y += file/

all : 
	make -C ./ -f $(TOPDIR)/Makefile.build
	$(CC) $(LDFLAGS) -o $(TARGET) built-in.o


clean:
	rm -f $(shell find -name "*.o")
	rm -f $(TARGET)

distclean:
	rm -f $(shell find -name "*.o")
	rm -f $(shell find -name "*.d")
	rm -f $(TARGET)

Makefile.build

PHONY := __build
__build:


obj-y :=
subdir-y :=

include Makefile

# obj-y := a.o b.o c/ d/
# $(filter %/, $(obj-y))   : c/ d/
# __subdir-y  : c d
# subdir-y    : c d
__subdir-y	:= $(patsubst %/,%,$(filter %/, $(obj-y)))
subdir-y	+= $(__subdir-y)

# c/built-in.o d/built-in.o
subdir_objs := $(foreach f,$(subdir-y),$(f)/built-in.o)

# a.o b.o
cur_objs := $(filter-out %/, $(obj-y))
dep_files := $(foreach f,$(cur_objs),.$(f).d)
dep_files := $(wildcard $(dep_files))

ifneq ($(dep_files),)
  include $(dep_files)
endif


PHONY += $(subdir-y)


__build : $(subdir-y) built-in.o

$(subdir-y):
	make -C $@ -f $(TOPDIR)/Makefile.build

built-in.o : $(cur_objs) $(subdir_objs)
	$(LD) -r -o $@ $^

dep_file = .$@.d

%.o : %.c
	$(CC) $(CFLAGS) -Wp,-MD,$(dep_file) -c -o $@ $<
	
.PHONY : $(PHONY)

例子解析：

Makefile.build相当于把部分重复操作单独提出来，然后取名为Makefile.build，换成其它名字，比如test.build，对应修改Makefile里Makefile.build的名字，也可以。

所以，仅仅因为它们名字上有类似，就以为有关系、区别，是没意义的，整个工程必须有Makefile，但不一定有Makefile.build。

在多层级目录的项目中，可以通过创建一个Makefile.build来方便对每个子目录进行操作。

执行make，调用顶层Makefile，进而调用执行Makefile.build，Makefile.build里对每个目录都执行Makefile.build，从而得到各个.o文件，最后将所有.o合并成最终二进制文件。

$表示依赖的关系，=是延时变量，使用时才会赋值，把CROSS_COMPILE带进去，就等价于，构造出编译的环境

CROSS_COMPILE = arm-linux-
AS		= arm-linux-as
LD		= arm-linux-ld
CC		= arm-linux-gcc
CPP		= arm-linux-gcc -E
AR		= arm-linux-ar
NM		= arm-linux-nm

STRIP		= arm-linux-strip
OBJCOPY		= arm-linux-objcopy
OBJDUMP		= arm-linux-objdump

MakeFile中export的使用 - Love流浪的猪 - 博客园

export出来的变量arch将被子make进程继承

gcc -I -i -L -l 参数区别 / -l(静态库/动态库)_Do-CSDN博客_-i gcc

-I是指定头文件路径，-L指定库文件路径

：=是即时变量，CFLAGS在赋值的时候就获得值，+=表示追加，shell pwd是脚本命令，pwd代表makefile的当前路径，比如在/home/book/example文件夹下面

综合起来，等价于

CFLAGS += -Wall -Werror -O2 -g -I /home/book/example/include

all : 
	make -C ./ -f $(TOPDIR)/Makefile.build
	$(CC) $(LDFLAGS) -o $(TARGET) built-in.o
这段话的意思是对子目录递归执行Makefile.build，把built-in.o生成$(TARGET)的可执行文件。
built-in.o从Makefile.build里面得到

6.在makefile.build里面