芯片验证-UVM
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UVM学习整理
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这个作者很懒,什么都没留下…
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UVM学习整理——UVM通信(sequence)
五、sequenceUVM的sequence机制最大的作用就是将test case和testbench分离开来。 对一个项目而言,testbench是相对稳定的框架,而针对各个module要有不同的测试内容,所以具体的test case 的差异非常大。在UVM中, test和sequence类总是成对出现,实现了testbench和具体的test case的结合。test类中可以针对具体的测试内容对testbench做一些差异化配置,在sequence类中则是实现test case的具体...原创 2021-11-28 15:25:28 · 4378 阅读 · 0 评论 -
UVM学习整理——UVM通信(component类)
三、UVM通信(component类)UVM验证平台的特点是验证环境整体基于面向对象的开发方式,组件之间的通信也是基于TLM通信方式,但在driver与硬件的接口之间,需要将TLM抽象事务降解到基于时钟的信号驱动级别。3.1UVM TLM基本概念TLM是一个基于事务(transaction)的通信方式,TLM通信两个对象根据通信动作分为initiator object(通信请求动作发起方)和target object(通信的响应方);根据事务传输方向分为produ...原创 2021-11-28 11:15:32 · 2118 阅读 · 0 评论 -
UVM学习整理——UVM结构(object派生类)
目录2.3uvm object派生类2.3uvm object派生类除了派生自uvm_component类之外的类,几乎所有的类都派生自uvm_object。换个说法,除了driver、monitor、agent、model、scoreboard、env、test之外的几乎所有的类,本质上都是uvm_object,如sequence、sequence_item、transaction、config等。uvm_sequence_item:所有的transaction要从uvm_sequence原创 2021-11-27 14:50:20 · 1179 阅读 · 0 评论 -
UVM学习整理——附录(部分组件源码)
附录二部分组件源码1.Driver和SequencerDriver和Sequencer之间的握手机制:Driver的seq_item_port和Sequencer的seq_item_export:uvm_driver的源代码:uvm_sequencer的源代码:Driver中的seq_item_port和Sequencer的seq_item_export的连接方式(和普通的TLM端口类似):如果不想使用自带的成员变量,想加入改动,也可以由uvm_component来.原创 2021-11-27 14:36:22 · 2254 阅读 · 0 评论 -
UVM学习整理——UVM结构(component派生类)
目录二、UVM结构2.1UVM组件2.1.1uvm_driver2.1.2uvm_monitor2.1.3uvm_sequencer2.1.4uvm_agent2.1.5uvm_scoreboard2.1.6reference model2.1.7uvm_env2.1.8uvm_test2.1.9uvm_component相关宏2.2UVM验证平台的树形结构二、UVM结构2.1UVM组件UVM的组件(uvm_component类)继承于UVM的原创 2021-11-26 20:07:43 · 7082 阅读 · 1 评论 -
UVM学习整理——UVM整体介绍
目录一、典型UVM验证平台介绍1.1典型UVM验证平台的主要组成和基本功能1.2UVM类库地图1.3UVM常用类的继承关系一、典型UVM验证平台介绍1.1典型UVM验证平台的主要组成和基本功能driver:向sequencer申请sequence_item(数据包transaction),并将包里的信息按照总线协议规定驱动到DUT的端口上;sequencer:组织管理sequence,driver申请数据时,它就把sequence生成的sequence_item发给drive原创 2021-11-26 19:49:52 · 21137 阅读 · 4 评论