对于高速信号完整性,一块聊聊啊(18)

本文详细介绍了使用Allegro进行高速信号完整性后仿真的全过程,包括获取和检查IBIS模型、仿真准备如叠层和电源网格设置、以及仿真参数配置和结果分析。通过该流程,确保PCB设计的信号完整性。
摘要由CSDN通过智能技术生成

本文摘录一篇Allegro进行后仿真的完整流程,可能allegro版本有点老,但整个过程还是描述比较详细的。

目录

1、获取IBIS模型

1.1模型下载

1.2检查IBIS模型

1.3IBIS转换为DML

1.4保存DML模型

2、仿真准备

2.1叠层设置

2.2电源网格设置

2.3仿真库配置

3、仿真

3.1拓扑结构提取

3.2仿真参数设置

3.3仿真结果分析及波形分析


1、获取IBIS模型

1.1模型下载

这个需要到元器件厂商的官网上下载,例如:Intelligent Power and Sensing Technologies | onsemi

可以输入ibis模型进行搜索

1.2检查IBIS模型

IBIS模型需要检查是否存在语法错误,或者其他的错误,这一步是必须的。打开软件Model Integrity,点击0pen打开ibs文件,打开文件时软件自动进行Check。

1.3IBIS转换为DML

由于A1legroSI不能够直接对应IBIS模型,需要把IBIS模型转换成A1legro专用的DML模型,两者实际上都是文本文档,只是在描述的方式上有所区别。

1.4保存DML模型

待所有需要的器件模型全部转换成DML模型以后要和IBIS模型保存在同一文件夹。当需要修改或者更新时,更改模型Name,确保IBIS模型和DML模型的Name一对应。

2、仿真准备

打开brd文件后,需要做:层叠设置、电源网格设置、仿真库配置。

2.1叠层设置

通过设置PCB叠层的每一层厚度和走线层线宽,使得各层特征阻抗符合设计要求,以保证仿真的准确性。由于后仿真时走线已经结束,所以只需要根据PCB设计条件书的参数要求设置叠层厚度。

2.2电源网格设置

设置好叠层参数后,继续选择NEXT进入定义电源网络界面,对电源网络进行定义。这一步对前后仿真来说都不是必须的,只要保证仿真的网络与电源和地没有关联,可以省略这一步。

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