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RSS订阅原创 管理anaconda的虚拟环境
conda create -n learn python=3 // 创建一个名为learn的环境并指定python版本为3(的最新版本)conda env export > environment.yaml // 导出当前环境的包信息。conda remove -n learn --all // 删除learn环境及下属所有包。conda env list // 列出conda管理的所有环境。activate learn // 切换到learn环境。conda list // 列出当前环境的所有包。
2025-02-02 22:46:59
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原创 quartus软件中设计频率相位可调的正弦波信号发生器
正弦波初始相位是0，第一个相位累加器是0相位加上频率控制字，频率控制字其实就是rom地址跳变的多少，如果是rom地址连续的变，频率控制字就是1，第一个加法器就是加一器，和寄存器组成了加一计数器。如果地址跳变，读取正弦波的数据就减少，跳变越多，读取正弦波的数据就越少，相应的正弦波输出的频率就增加。第二个相位调制器，就是一个简单的加法器，加上初始相位的偏移量即可。
2024-12-09 02:36:18
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原创 利用quartus软件的IP核实现正弦波信号发生器的设计
将正弦波的波形通过软件取出一定格式的数据，或者通过编程的方式获得数据，将该数据文件存储到quartus中的IP核中。通过存储器地址的变换来读取正弦波数据，然后利用DA和滤波器输出正弦波波形。将正弦波换成其他波形，原理相同。可以用不同的ROM来存储不同的波形。
2024-12-08 23:31:16
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原创 verilog中几种实现计数器的方法
repeat (11) begin //重复11次。//while语句打印出count的值。//、for语句打印出count的值。
2023-11-17 20:33:26
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转载 Verilog常用语法总结
module 模块名（口1,口2,口3,…）;两种模块例化方式：方法一：模块名（连接端口1信号名,连接端口2信号名,连接端口3信号名,…）；方法二：模块名（.端口名1（连接信号1名）,.端口名2（连接信号2名）,…）；例化时还可以对模块中的参数型（parameter）变量进行重新赋值；例如：endmodule对以上模块进行例化并修改a,b值；在模块uut_min中a与b的值就都为10了，所以参数化设计在例化时能很方便的对参数进行修改，而不需要修改原模块内容；
2023-10-25 08:20:51
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原创 VHDL实现的交通灯
NS_RED, NS_YELLOW, NW_GREEN 南北向的红、黄、绿灯信号线。WE_RED,WE_YELLOW,WE_GREEN 东西向的红、黄、绿灯信号线。控制时间暂定为： 正常行驶时间60s，黄灯等待时间3s。输出六路信号，分别控制南北向和东西向的红、黄、绿灯。状态机实现的一个典型实例。
2023-10-19 21:45:36
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原创 斐波那契数列的python实现
斐波那契数列来源于兔子繁殖问题，所以也叫兔子序列。第一年有一对小兔子，一年后成年。成年的兔子又可以生出一对小兔子，如此循环往复，每年的兔子数就构成了一个斐波那契数列。斐波那契数列：1，1，2，3，5，8，13，21，34，55，89...
2023-10-19 20:57:21
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空空如也
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