EDA数字系统设计与VHDL课程大作业

最新推荐文章于 2021-12-14 13:42:03 发布
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分类专栏： 数字逻辑系统 文章标签： fpga开发 单片机 嵌入式硬件 eda VHDL
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EDA数字系统设计与VHDL课程大作业

题目一：数字频率计设计（平台实现）★

(1) 能对输入的方波信号频率进行采样；
(2) 采样频率范围为0~5999999Hz，以1Hz为单位进行显示；
(3) 采用七个七段数码管显示当前采样的频率值，如采样频率值为500HZ，则只显示500，而不显示0000500（即前面4个0不显示）；
(4)本电路系统板输入时钟为6MHz。

完整数字系统设计代码及其报告下载：EDA源码报告点这里
VHDL部分代码：
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[外链图片转存失败,源站可能有防盗链机制,建议将图片保存下来直接上传(img-Qpqm96NB-1639400642158)(C:/Users/Lenovo/AppData/Local/Temp/ksohtml/wpsEF84.tmp.jpg)]

实验测试图：
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陈陈不会敲代码
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