【ZYNQ Ultrascale+ MPSOC FPGA教程】第十九章Hello World(下)

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适用于板卡型号：

AXU2CGA/AXU2CGB/AXU3EG/AXU4EV-E/AXU4EV-P/AXU5EV-E/AXU5EV-P /AXU9EG/AXU15EG

 

此文基于第十八章内容进行软件开发

【ZYNQ Ultrascale+ MPSOC FPGA教程】第十八章Hello World(上)

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软件工程师工作内容

Vitis工程目录为“ps_hello/vitis”

以下为软件工程师负责内容。

1.Vitis调试；

2.创建Application工程；

1）新建一个文件夹，将vivado导出的xx.xsa文件拷贝进来；

2）Vitis是独立的软件，可以双击Vitis软件打开；

也可以通过在Vivado软件中选择ToolsLaunch Vitis打开Vitis软件

选择之前新建的文件夹，点击”Launch”

3）启动Vitis之后界面如下，点击“Create Application Project”，这个选项会生成APP工程以及Platfrom工程，Platform工程类似于以前版本的hardware platform，包含了硬件支持的相关文件以及BSP。

4）第一页为介绍页，直接跳过，点击Next

 

5）选择“Create a new platform from hardware(XSA)”，选择“Browse”

选择之前生成的xsa，点击打开

6）最下面的Generate boot components选项，如果勾选上，软件会自动生成fsbl工程，我们一般选择默认勾选上。

7）填入APP工程名称，在方框处点击可以选择对应的处理器，我们这里保持默认

8）在这个界面可以修改Domain名称，选择操作系统，ARM架构等，这里保持默认，操作系统选择standalone，也就是裸机。

9）选择”Hellow World”模板，点击“Finish”完成

10）完成之后可以看到生成了两个工程，一个是硬件平台工程，即之前所说的Platfrom工程，一个是APP工程