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RSS订阅原创 基于FPGA的图像灰度处理
通过python使用PILLOW，获得输入bmp图片的RGB值，并将R/G/B三个分量分别以16进制写入三个txt文件中。再通过vivado仿真FPGA处理，读取三个txt文件数据分别到三个寄存器中。再从寄存器中读取数据，以verilog语言进行RGB转YCbCr格式处理。在格式转换过程中，同时以两个always模块处理乘、加和一个assig取高8位进行运算。得到YCbCr的Y分量之后，将Y分量输出到一个txt文件中，即为灰度转换的512*512图片的结果。通过python使用OpenCV将tx
2023-12-09 21:11:40
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原创 FPGA图像处理技术之图像反转
但当FPGA处理时，任何时刻不同的像素都处于不同的运行状态。如像素a在处理二值化，像素b在处理Sobel算子，像素c正在处理降噪，相互之间互不影响。研究图像处理的流水线和数据并发是用Verilog语言处理数字图像算法的关键，这样的运行方式大大加快了FPGA的图像处理速度。至此，可以看到在vivado仿真中，处理速度就可以达到5.26ms，如果在FPGA实机中，速度将可以达到更快。将前文转换的data.txt，放在工程文件的xsim文件夹里，仿真的结果都输出在了xsim文件夹里的new_data.txt。
2023-11-28 22:58:56
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原创 数字电路：边沿触发的D触发器简析
D触发器是一个具有记忆功能的，具有两个稳定状态的信息存储器件，是构成多种时序电路的最基本逻辑单元，也是数字逻辑电路中一种重要的单元电路。因此，D触发器在数字系统和计算机中有着广泛的应用。触发器具有两个稳定状态，即"0"和"1"，在一定的外界信号作用下，可以从一个稳定状态翻转到另一个稳定状态。本次我们着重介绍边沿(上升沿)触发式D触发器，负边沿(下降沿)触发式D触发器边沿(上升沿)触发式D触发器本触发器仅在控制时钟上升沿到来的时刻，采样D输入信号，并据..
2022-02-03 12:20:01
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原创 数字电路：常见的锁存器浅析（S-R,S‘-R‘,使能端的S-R，D）
锁存器是数字电路中基础的基础，本文将展现出常用的锁存器类型，便于读者的学习。一、S-R锁存器S-R锁存器由双或非原件组成功能表如下：①S,R均为0，S-R锁存器相当于双稳态元件，通过反馈回路维持电路之前的状态。②仅R输出有效，易知Q端输出为0(低电位)，Q'输出为1(高电位)③仅S输出有效，易知Q'输出为0(低电位)，Q输出为1(高电位)④S,R输出均有效，易知Q和Q'输出均为0(低电位)总之，作者为大家提供一个取巧的方式(当然使用之前要注意使用条件)，某门输入有
2022-01-30 22:06:46
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原创 数字电路：浅析S-R锁存器的亚稳态形成原理
S-R锁存器是大多数时序电路的基本构件。然而其亚稳态的形成原理及过程常常被人忽略，本文浅析S-R锁存器的亚稳态的形成原理及过程有助于读者对锁存器加深理解，并对于其他器件的亚稳态的理解达到触类旁通的效果。我们首先了解S-R锁存器的基本结构，该锁存器由两个或非门构成，入下图（Q'的表述实际上是不准确的，应用QN描述更加准确） S-R锁存器的输出关系为-----------------------------------------------S R Q Q'0 0QQ’0 ...
2022-01-26 21:41:35
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原创 0基础带你学数电（2）：组合逻辑设计原理1
逻辑电路分为两大类：“组合的”和“时序的”。在组合逻辑电路中，任意时刻的输出仅仅决定于当时的输入，其可以含有任意数目的逻辑门和反相器，但不包含反馈回路。只有学好组合逻辑电路，我们才能方便我们对于时序逻辑电路的学习。本次我们将通过习题的方式，带领大家学习组合逻辑设计原理。例1此题主要涉及到n变量开关代数定理中的德·摩根定理F=(A'B'C'D')+A+B+C+D=(A+B+C+D)'+(A+B+C+D)=X'+X=1①我们可以记忆一下德摩根定理[(X1)(X2).....(Xn)]'=
2022-01-25 22:27:11
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原创 0基础带你学数电（1）：数制和编码1
对于很多非CS方面的同学，以及没有好好学过C语言的同学来说，数制和编码方面一直是令人头痛的一部分知识点，我们首先将以习题的方式带大家初步了解本方面内容，帮助同学们快速掌握知识。例（1）因为1位十六进制数基数为16，需要16个数码（以0123456789ABCDEF表示），我们非常容易发现，4位二进制数恰好可以唯一地有16种组合，进而我们可以将（0123456789ABCDEF）替换为（0000,0001,0010,0011,0100,0101,0110,0111,1000,1001,1010,.
2022-01-25 17:42:43
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空空如也
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