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笔记
半分笑166
这个作者很懒,什么都没留下…
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2021-07-01
信号发生器的实验报告:1、实验目的:了解信号发生器的类型;掌握用数字电路产生随机序列码的实现方法;对信号发生器有更深刻的认识。掌握信号发生器的基本原理;理解仿真。2、实验内容:本波形发生器应该具有时钟复位信号,并具有选择和分频输入信号,选择信号的目的是为了选择输出四种之中的哪种波形,分频输入信号是为了提供分频的值。为了方便设计,这里选用2n分频,即输入的n输出的是2n分频后的波形。此外需要一个输出信号来输出选择好的波形。整个设计的代码如下,中间rom部分做成一个函数,输入对应地址就能返回表中的数值原创 2021-07-01 11:15:52 · 93 阅读 · 0 评论 -
2021-07-01
2-4译码器的实验报告:1、实验目的:掌握译码器的测试方法;了解中规模集成译码器的功能管脚分布掌握其逻辑功能;学习译码器的扩展。2、原创 2021-07-01 12:59:02 · 55 阅读 · 0 评论 -
2021-06-29
静态冒险和动态冒险的效应实验报告:1、实验目的:原创 2021-06-29 19:59:25 · 84 阅读 · 0 评论 -
2021-06-11
Quartus ii实验报告八(第三个实验)1.实验目的:下载Quartur ii软件和modlsim并进行联合仿真。2.实验内容:参今日头条老师发的视频及电子书,然后用quartus ii和modlsim进行联合仿真3.实验原理:建立V文件,书写和运行代码,完成联合仿真操作。4实验工具:pc机和Quartur ii软件和modlsim软件。5.实验截图:6.实验代码:module div (clk, reset, start, A, B, D, R, ok, err);paramet原创 2021-06-11 15:21:28 · 63 阅读 · 1 评论 -
2021-06-11
Quartus ii实验报告八(第二个实验)1.实验目的:下载Quartur ii软件和modlsim并进行联合仿真。2.实验内容:参今日头条老师发的视频及电子书,然后用quartus ii和modlsim进行联合仿真3.实验原理:建立V文件,书写和运行代码,完成联合仿真操作。4实验工具:pc机和Quartur ii软件和modlsim软件。5.实验截图:6.实验代码:module my_rs (reset,set,q,qbar);input reset,set;output q,q原创 2021-06-11 15:18:47 · 44 阅读 · 1 评论 -
2021-06-11
Quartus ii实验报告八(第一个实验)1.实验目的:下载Quartur ii软件和modlsim并进行联合仿真。2.实验内容:参今日头条老师发的视频及电子书,然后用quartus ii和modlsim进行联合仿真3.实验原理:建立V文件,书写和运行代码,完成联合仿真操作。4实验工具:pc机和Quartur ii软件和modlsim软件。5.实验截图:6.实验代码:module ex8_1(clock,reset,x,y1,y2) ;input clock,reset;input原创 2021-06-11 14:43:22 · 48 阅读 · 0 评论 -
2021-06-04
1、实验目的:下载Quartur ii软件和modlsim并进行联合仿真。2、实验内容:参今日头条老师发的视频代码,然后用quartus ii和modlsim进行联合仿真3、实验原理:建立V文件,书写和运行代码,完成联合仿真操作。4、实验工具:pc机和Quartur ii软件和modlsim软件。5、实验截图:实验一截图:实验二截图:6、实验代码:实验一代码:module decoder3x8(din,en,dout,ex);input [2:0] din;input en;原创 2021-06-04 15:47:32 · 59 阅读 · 0 评论 -
2021-05-28
Modlsim实验报告六1.实验目的:下载Quartur ii软件和modlsim并进行联合仿真。2.实验内容:参今日头条老师发的视频代码,然后用quartus ii和modlsim进行联合仿真3.实验原理:建立V文件,书写和运行代码,完成联合仿真操作。4.效果演示:1:代码来源:数字电路书籍2; 文件名:fulladd.v,MSDFF.V3;测试代码试验一module fulladd(sum,c_out,a,b,c_in);output sum,c_out;input a,b,c原创 2021-05-28 15:30:33 · 58 阅读 · 0 评论 -
2021-05-28
1、实验目的:Modelsim工程仿真和主从D触发器的门级建模2、实验内容:根据实验代码进行Modelsim工程仿真和主从D触发器的门级建模3、实验代码:Modelsim工程仿真:module fulladd(sum,c_out,a,b,c_in) ;output sum,c_out;input a,b,c_in;wire s1,c1,c2;xor (s1,a,b) ;and (c1,a,b) ;xor (sum,s1,c_in) ;and (c2,s1,c_in) ;or(c_o原创 2021-05-28 15:24:31 · 45 阅读 · 0 评论 -
2021-05-28
1、实验目的:使用Quartur ii软件和modelsim并使用矢量表示4位加法器2、实验内容:参照数字逻辑基础与Verilog设计书中的代码,使用矢量表示4位加法器3、实验原理:根据书上的代码和教学步骤进行建模4、实验工具:quartus ||和Modelsim软件5、实验部分代码:module adder4 (carryin,X,Y,S,carryout);input carryin;input [3:0] X,Y;output [3:0] S;output carryout原创 2021-05-28 00:17:23 · 80 阅读 · 0 评论 -
2021-05-07
1、实验目的:4位加法器的门级建模2、实验内容:参照今日头条中的教程代码,进行4位加法器的门级建模3、实验原理:根据书上的代码和教学步骤进行建模4、实验工具:quartus||和Modelsim软件5、实验部分代码:6、实验截图:7、在哔哩哔哩上观看视频...原创 2021-05-27 23:48:24 · 34 阅读 · 0 评论 -
2021-05-21
1.实验目的:使用Quartur ii软件和modelsim并进行译码器的门级建模2.实验内容:参照今日头条中教程的代码,然后用quartus ii和modlsim并进行译码器的门级建模3.实验原理:按照视频上的内容,书写和运行代码,完成联合仿真操作module fulladd(S,Cout,Cin,A,B);output S,Cout;input Cin,A,B;wire and1,and2,and3,and4;xor (S,Cin,A,B);and (and1,Cin,A);and原创 2021-05-21 19:43:27 · 51 阅读 · 0 评论 -
2021-05-21
1.实验目的:使用Quartur ii软件和modelsim并进行Modelsim基本仿真流程2.实验内容:参照今日头条中教程的代码,然后用quartus ii和modelsim并进行Modelsim基本仿真流程3.实验原理:按照视频上的内容,书写和运行代码,完成联合仿真操作module fulladd (sum, c_out,a,b,c_in) ;output sum,c_out;input a,b,c_in;wire s1,c1,c2;xor (s1,a,b) ;and (c1, a原创 2021-05-21 19:14:34 · 48 阅读 · 0 评论