EMMC工作原理_emmc clk(1)

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EMMC总线的四类信号功能:

1、时钟信号 CLK:给EMMC提供数据交互的时钟。

2、控制信号  Data Strobe:  DS是由EMMC向主控端传输,频率和CLK信号相同,用于同步Device端输出的数据,在HS400模式下使用,在主控端实现数据同步功能。该信号在eMMC5.0中引入。

3、CMD: 命令交互信号,用于传输控制命令或者回应主机。

4、数据信号:DAT[7:0]:双向接口,数据收发。

EMMC的双向数据总线,用于主机和设备进行数据通信。-------工作在应对快速命令的推挽模式。

DAT线在某一时刻只能支持单向传输,只能被设备或者EMMC HOST一方控制。默认下,当用户上电或者复位时。仅DAT0能传输数据。但可以配置想要使用的DAT线的数量,

比如 选择4跟数据线。则断开1-3的内部上拉,如果用户选择的是8根,同理会断开DAT1-7的上拉。

5、RST_N 复位信号。

6、电源信号: VCC 是EMMC的Core电源    VCCQ是IO电源。

工作过程: 

CMD从高到低时:

DAT经历的过程是:Boot ACK Time 引导启动恢复时间(准备时间)

Boot Data Time  启动数据时间(数据传输)

Boot terminated  引导终止(传输结束)

56 clocks required from CMD signal high to next MMC command:

从CMD信号高到下一个MMC命令需要56个时钟

就是两次通信之间必须间隔56个时钟。

各命令所需时间

二、硬件设计

硬件设计框图:

最下面的R data Strobe 电阻需要下拉到地。

IMX6评估板实际电路连接。

如果芯片内部没有上拉:则DATA[7:0]数据端、CMD信号线需要外加上拉电阻。


主机MCU通信的引脚为:

layout建议:

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当 SOC 2 中的 EMMC CLK 信号异常拉低时,可能会导致一些问题或故障,具体影响取决于系统的设计和使用情况。 EMMC CLK 是用于控制 eMMC 存储器的时钟信号。它的正常工作状态应该是稳定的高电平或低电平,以确保数据的正确传输和读写操作。如果该信号异常拉低,可能会出现以下情况: 1. eMMC 存储器无法正常工作:EMMC CLK 异常拉低可能导致 eMMC 存储器无法接收正确的时钟信号,从而影响存储器的读写操作。这可能导致数据传输错误或存储器无法访问。 2. 系统启动问题:EMMC CLK 异常拉低可能会影响系统的引导过程。由于时钟信号不正确,系统可能无法正确加载操作系统或启动其他关键组件,导致系统无法正常启动。 3. 性能下降:EMMC CLK 异常拉低可能会导致存储器访问速度下降,从而影响系统性能。存储器读写操作可能变得缓慢,导致应用程序响应时间延迟。 为了解决这个问题,您可以考虑以下步骤: 1. 检查硬件连接:确保 SOC 2 和 eMMC 存储器之间的连接正确并稳定。检查时钟线路和电源线路,确保没有短路或断路等问题。 2. 检查电源供应:确保 SOC 2 和 eMMC 存储器都能够获得稳定的电源供应。不稳定的电源供应可能导致时钟信号异常。 3. 检查驱动程序和配置:确保 SOC 2 上的驱动程序和配置正确设置。可能需要更新驱动程序或重新配置相关寄存器。 如果以上步骤无法解决问题,建议咨询相关硬件或系统设计专家,以获取更详细的支持和指导。

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