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RSS订阅原创 半精度二进制浮点数-十进制浮点数转换MATLAB代码
与上一篇十进制浮点数-半精度二进制浮点数转换相对应，这里为了进行验证，又写了一个半精度二进制浮点数-十进制浮点数转换的MATLAB代码，其实就是个逆过程，上一篇的链接在https://blog.csdn.net/qq_34365687/article/details/106087767目前没有发现问题，数据转换是肯定存在误差的，代码如下function [dec_num] = half_float2dec(half_float_num) Decimal = 0; if(half_f
2020-05-13 13:41:28
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原创 十进制浮点数-半精度二进制浮点数转换MATLAB代码
最近设计用到了十进制浮点数->半精度二进制浮点数的大批量转换，发现没有现成的转换代码，就根据原理用matlab撸了一个，与在线转换器对比暂时没有发现bug，通过写blog的方式debug（小黄鸭调试法），也欢迎大家帮我找茬，一起debug.半精度浮点数数据格式16bit，遵循IEEE754的标准，1bit符号位，5bit阶码，10bit尾数。关于浮点数的计算可以看下面这个blog，写的很详细：https://blog.csdn.net/fwb330198372/article/details/
2020-05-12 23:40:44
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原创 关于SNN有监督学习的项目
今明两天将会在个人的GitHub库里推送一个SNN的项目 敬请关注，是关于paper：‘’SEFRON: A New Spiking Neuron Model WithTime-Varying Synaptic Efficacy Function for Pattern Classification‘’的复现...
2019-08-08 11:28:39
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转载 一位资深工程师FPGA设计经验精华
从大学时代第一次接触FPGA至今已有10多年的时间。至今依然记得当初第一次在EDA实验平台上完成数字秒表，抢答器，密码锁等实验时，那个兴奋劲。当时由于没有接触到HDL硬件描述语言，设计都是在MAX+plus II原理图环境下用74系列逻辑器件搭建起来的。后来读研究生，工作陆陆续续也用过Quartus II，Foundation，ISE，Libero，并且学习了verilogHDL语言，学习的过程中...
2019-07-28 16:53:36
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原创 基于FPGA的充电系统
2019年6月19日晚，重写了一版充电系统，此设计基于铱元素科技的EGO1FPGA开发板，采用Xilinx的Xc7a35tcsg324-1芯片，用Verilog编写，借助了数据包的思想：module charger_top(clk,dula_ch,wela_ch,wela_coin,dula_coin,channel,control,rest_n,coin_in,ok,led);input c...
2019-06-20 09:04:46
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原创 win10系统下tensorlfow（CPU）+spyder部署流程
之前安装tensorlfow用了好长时间，这次在教研室很顺利就安装OK了，记录一下过程，备用。os是win10,python版本3.7，使用anaconda安装1.首先是anaconda的安装，官网就有，使用的是anaconda 2018.2（64bit），流程如下：2.安装完anaconda3，接下来以管理员身份运行prompt，下载安装tensorflow：先设置一下清华...
2019-03-29 14:35:20
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原创 使用Xilinx FIFO IP核的总结（一）
FIFO IP核的总结（一）第一次使用Vivado中的FIFO generator,一般FIFO（以同步FIFO）的端口也就10个左右：CLK；srst:复位端口读相关：dout:FIFO数据输出（output）；empty：读空（output），empty为1，表明FIFO内无数据；Vaild:读有效（output）rd_en:读使能（input）写相关：din:FIFO数据...
2019-03-28 21:59:19
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SERFON_python-master.zip
2019-08-09
空空如也
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