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原创 二、ACE 协议:信号描述

用于表示一笔读传输完成。

2024-03-01 17:39:19 1094 2

原创 cache 的基本概念

cache 是学习 ACE 协议的基础,是 CPU 结构中重要的组成部分。

2024-03-01 15:10:03 1238

原创 一、ACE 协议:ACE 简介

该文章是阅读 ace spec 的学习笔记,因此文章结构也是与他类似的

2024-02-02 18:31:09 3222 3

原创 地址、内存之间的换算

在实际硬件中,一个寄存器一般是存储8位数据,所以对于地址来说,一个地址对应一个寄存器,也就是 8bit 的数据(1 个 byte)。

2023-11-08 17:34:49 131

原创 AXI 协议中的“对齐”与“非对齐”访问

1. 对齐传输:在实际硬件中,一个寄存器一般是存储8位数据,所以对于一笔32位的数据,就需要4个寄存器来存储,因此这笔32位的数据的地址需要以0X00,0X04,0X08···这样使用,也就是所谓的地址对齐2. 非对齐传输AHB总线只支持对齐传输,而AXI协议支持地址的非对齐传输(且burst类型为wrap的不支持)。非对齐传输也就是所谓的可以访问的地址不需要以上例中0X00,0X04,0X08···这样使用。在第一笔数据的传输时,如果首地址不是对齐的,那么主设备会在第一笔传输中对数据进

2022-05-25 11:11:41 10987

原创 Verdi 改变字体大小额方法

更改verdi字体字号

2022-05-12 16:45:51 6187

翻译 [SV]SystemVerilog Semaphore

SemaphoreSemaphore是一个SystemVerilog内置类,用于对共享资源的访问控制和基本同步。信号量就像一个包含键数的桶。使用信号量的进程必须首先从bucket中获取一个键,然后才能继续执行。所有其他进程必须等待,直到有足够数量的键返回到bucket。假设有两个进程试图访问一个共享内存区域。其中一个进程试图写入,而另一个进程试图读取相同的内存位置。这导致一个不可预测的结果。信号量可以用来克服这种情况。Semaphore 语法semaph...

2022-04-27 14:39:01 2605

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