问题描述:
在Vivado 2018.3中创建工程,添加设计文件和约束文件后,点击"SYNTHESIS"没有问题
下一步点击“IMPLETATION”时
报以下错误:
问题原因查找:
约束文件中信号定义的格式错误
正确格式如下
修改后问题解决!!!
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下一步点击“IMPLETATION”时
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约束文件中信号定义的格式错误
正确格式如下
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