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时钟scl为高的时候 sda数据为低的时候是起始位
当scl信号为高电平的时候 sda数据为高的时候是 停止位 （时钟稳定 数据变化 才会发生起始位和停止位）
当sclk为高电平时 sda 数据需要保持或者需要保持稳定 （理解就是不要有上升沿和下降沿的变化）
sclk为低电平时 sda数据发生变化 （这样就不会触发起始位和停止位）
器件地址+存储地址+数据
根据时许写状态
s0：空闲状态
s1：产生起始位状态
s2:传输8为数据
s3:检查ACK
s4:NOACK
s5:产生停止位
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