Unsupported Modules Detected: Compilation is not supported for following modules: 搞坏了

最新推荐文章于 2023-05-23 15:38:02 发布
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分类专栏： android
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17/5/17
下午4:21	Unsupported Modules Detected: Compilation is not supported for following modules: lib_DragViewPager, lib_commonUtils, lib_dateTimePickers, lib_fileSelector, lib_weekMonth. Unfortunately you can't have non-Gradle Java modules and Android-Gradle modules in one project.

下午4:22	Plugin Error
				Problems found loading plugins:
				Following plugins are incompatible with current IDE build: .ignore



在更新aar的时候，把项目搞坏了，报了一个这样的错误， 然后就是各种倒腾，clean， rebuild， 重启，没屌用，最后好像看好像是Gradle的问题。




点击Sync Project With Gradle Files就解决问题了。记录一下

狼之血舞
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抱歉，对不起给你带来困惑。你提到的错误是因为 `$sin` 这个系统函数在综合过程中不被支持。Verilog综合工具主要用于将硬件描述语言转化为硬件电路，而不支持执行数学函数。 为了解决这个问题，你可以考虑使用固定点数学或者查找表来代替使用 `$sin` 函数。下面是一个使用查找表生成正弦波的例子： ```verilog module SinWaveGenerator( input wire clk, // 时钟信号 input wire rst, // 复位信号 output reg [7:0] sin_output // 正弦波输出信号，8位精度 ); reg [7:0] sin_table [0:255]; // 正弦波查找表 integer i; initial begin // 初始化正弦波查找表 for(i = 0; i < 256; i = i + 1) begin sin_table[i] = $signed(128 + 128 * sin(2 * $pi * i / 256)); end end always @(posedge clk or posedge rst) begin if(rst) begin sin_output <= 8'h00; // 复位时输出0 end else begin sin_output <= sin_table[sin_output + 1]; // 每个时钟周期输出下一个正弦波值 end end endmodule ``` 在这个例子中，我们使用 `sin()` 函数来计算正弦值，并使用查找表将其转化为固定点数。请注意，这个例子仅供参考，你可能需要根据你的具体需求进行修改和调整。 希望这次能够解决你的问题。如果还有其他问题，请随时提问。
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