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原创 【Modelsim仿真原理】

了解Modelsim仿真器的工作流程对如何正确的编写Testbench具有重要意义如:明明是串行工作,modelsim如何使程序并行?

2023-03-25 10:09:47 478 2

原创 【Verilog硬件语法描述的硬件结构】

Verilog与其他高级语言本质的区别在于它是一种硬件描述语言,其所有的变量和语法结构应该与实际数字电路相互映射,孤立的使用Verilog语法去完成一定的逻辑结构不利于深入对FPGA的了解以及开发。

2023-03-01 22:31:30 140

原创 【Verilog 循环移位操作】

【代码】【Verilog 循环移位操作】

2023-03-01 22:30:28 746

原创 指针的强制转换

指针变量与其类型首先指针变量仅代表一个存储空间地址量,如32位总线处理器是一个32位的地址。当他指向某个确定的变量时,指针所指的存储空间内的值就代表这个变量。如指针unsigned char*p=&a;如果p=0x12345678(32位处理器),而a=0x01,那么就表示编号为0x12345678的格子里面(格子空间为1字节)装的数为0x01。但是指针还有一个很重要的东西即指针类型,指针只是一个地址即最多指一个格子,那它如何指向一个需要占多个格子的变量呢,关键就在指针类型。比如unsigned

2022-03-14 16:57:47 4621

原创 为什么用了#ifndef还说我重复定义?

比如一个.c文件中有多个重复包含的头文件,那么条件编译#ifndef可以使各个.h头文件仅使用一次,得到最终编译完成的一个.c文件。但是你如果把变量定义放在头文件中,不同的.c文件编译时有可能调用相同的头文件造成变量重复定义。所以良好的习惯应该是变量定义在.c文件中,变量声明在.h文件中。...

2022-03-09 11:02:37 770

原创 【STM32内部架构理解】

STM32和GD32F10X内部架构整体架构模块架构总线矩阵最开始学stm32开始对架构各部分不是很了解看架构图基本上走马观花,然后陷入对各个外设的投入中去(比如GPIO/ADC/CAN等),但是对整体架构的掌握对后面编程很多细节的理解帮助很大,而外设的使用是学不完的,无需沉溺其中。在此处做回忆自用。整体架构看图说话:ARM公司是设计芯片内核的公司,将专利授权给STM公司后,STM公司在内核如CotexM3的基础上进行设计,如外设和内核如何传递信息、外围设计哪些外设等。最后将整体封装引脚引出交付给

2021-12-20 20:25:37 3845

原创 KEIL软件读取不到部分头文件

建立GD32的工程时,有个gd32f10x_libopt文件一直读取不到(或者读取的是安装路径下的此文件),反复检查头文件包含路径都没有问题。最后发现KEIL软件读取头文件会优先从设置目录读取,读取不到会读取安装的固件库里的头文件,我的工程设置为中文导致KEIL没有从设置路径读取,改成英文就好了。...

2021-12-15 22:24:15 2703

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