makefile使用方法

一、makefile是什么?

Makefile是一个描述文件,用于自动化构建程序的过程。它指定了如何从源代码文件生成可执行文件或库文件等目标文件。Makefile定义了一系列的规则来指定哪些文件需要先编译,哪些文件需要后编译,以及在什么情况下需要重新编译。

二、使用方法

命名:makefile或Makefile 才可以 使用make 命令

1 个规则:

目标:依赖条件
	(一个tab缩进)命令

	1. 目标的时间必须晚于依赖条件的时间,否则,更新目标

	2. 依赖条件如果不存在,找寻新的规则去产生依赖条件。

	ALL:指定 makefile 的终极目标。(否则把第一个规则的目标当做总目标)

2个函数:

$的作用: $(name) 取name的值 在脚本中变量的值就是字符串

src = $(wildcard ./*.c): 匹配当前工作目录下的所有.c 文件。将文件名组成列表,赋值给变量 src。  src = add.c sub.c div1.c 

obj = $(patsubst %.c, %.o, $(src)): 将参数3中,包含参数1的部分,替换为参数2。 obj = add.o sub.o div1.o

clean:	(没有依赖)

	-rm -rf $(obj) a.out	“-”:作用是,删除不存在文件时,不报错。顺序执行结束。

make clean -n 测试但不执行

3 个自动变量:

	$@: 在规则的命令中,表示规则中的目标。

	$^: 在规则的命令中,表示所有依赖条件。

	$<: 在规则的命令中,表示第一个依赖条件。如果将该变量应用在模式规则中,它可将依赖条件列表中的依赖依次取出,套用模式规则。

模式规则:

%.o:%.c
	  gcc -c $< -o %@

静态模式规则:

$(obj):%.o:%.c
	  gcc -c $< -o %@	

伪目标:

.PHONY: clean ALL

参数:
	-n:模拟执行make、make clean 命令。

	-f:指定文件执行 make 命令。				xxxx.mk

总结

总的来说,Makefile是一个自动化管理工具,用于控制软件的构建过程。它可以自动化编译和管理复杂的工程,并且通过指定一系列规则来确保正确的构建过程。

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Makefile 是一个用于管理和自动化软件项目中的编译和构建过程的工具。通过 Makefile,可以定义一系列规则和依赖关系,告诉计算机如何构建和更新项目。 以下是 Makefile 的基本使用方法: 1. 创建一个名为 "Makefile" 或 "makefile" 的文件,并将其放置在项目根目录下。 2. 在 Makefile 中定义规则。每个规则由以下几部分组成: - 目标(Target):规定了要生成的文件或执行的操作。 - 依赖(Dependencies):规定了生成目标所需要的文件或操作。 - 命令(Command):规定了生成目标的具体操作。 例如,下面是一个简单的 Makefile 示例: ```makefile target: dependency1 dependency2 command1 command2 ``` 3. 定义规则后,可以在命令行中使用 `make` 命令执行 Makefile 中的规则。例如,要执行上述示例中的目标 `target`,可以运行命令: ``` make target ``` 4. Makefile 还提供了一些特殊的变量和函数,可以用于更灵活地定义规则。一些常用的变量包括: - `CC`:C 编译器的名称。 - `CFLAGS`:编译选项。 - `LDFLAGS`:链接选项。 - `SRC`:源文件列表。 - `OBJ`:目标文件列表。 - `BIN`:生成的可执行文件名。 你可以在规则中使用这些变量,例如: ```makefile CC = gcc CFLAGS = -Wall -O2 target: $(OBJ) $(CC) $(LDFLAGS) -o $(BIN) $(OBJ) %.o: %.c $(CC) $(CFLAGS) -c $< -o $@ ``` 这是 Makefile 的基本使用方法,通过定义规则和使用 make 命令,你可以自动化编译和构建项目。更复杂的项目可能需要更详细的 Makefile 配置,你可以查阅相关文档来深入了解。

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