SystemVerilog
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luckyfish_01
这个作者很懒,什么都没留下…
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System Verilog 约束技巧
文章目录System Verilog的约束与随机约束System Verilog的约束与随机约束简单表达式:一个表达式中最多只能使用一个关系操作符,约束块里只能包含表达式,所以在约束块里不能进行赋值。权重分布:distsrc dist {0:40,[1:3]:=60}; //权重和不用等于100,值和权重可以是常数或者变量集合(set)和insidec inside {[lo:hi]} ; c inside {[$:4],[20:$]} //可以使用$取位宽范围内的最大或者最原创 2021-07-23 22:52:12 · 3151 阅读 · 2 评论 -
SystemVerilog------线程的管理
索引前言一、线程的使用1.1、线程的创建1.1.1、fork...join1.1.2、fork...join_none1.1.3、fork...join_any1.1、线程中的自动变量:1.2、等待子线程:1.3、线程间共享变量1.4、停止线程1.4.1、多个线程的停止1.4.2、单个线程的停止二、线程间通信2.1 事件2.读入数据总结前言本文主要介绍System Verilog中的线程控制以及线程间通信。一、线程的使用verilog对语句有两种分组方式,使用begin end或者fork j原创 2021-04-21 15:20:18 · 572 阅读 · 0 评论