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verilog学习
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LNAmp
屌丝一枚爱好硬件
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Verilog HDL 学习笔记1-data type
2013-05-02 18:13:20 开始做毕设将近有两个月了,主要做的是《基于FPGA的基带解调器的设计》,其中最核心的部分是4096点FFT的设计。截止到目前,算是完成了4096点FFT的模块设计(仅仅modelsim仿真通过)。通过两个月的学习,对Verilog HDL有了新的认识。学习贵在总结,遂将心得体会记录!Verilog HDL 学习笔记1-data type 接触原创 2013-05-06 10:33:39 · 1660 阅读 · 0 评论 -
Verilog HDL 学习笔记2-blocking and non-blocking assignment
2013年5月6日 10:42:38Verilog HDL 学习笔记2-blocking and non-blocking assignment---学习贵在总结,将学习的心得体会记录 在学习verilog的过程中,碰到的第一块绊脚石就是data type中wire 和reg的使用,第二块就是blocking 和non-blocking assignment 的区别和使用。现将学习过原创 2013-05-06 16:42:19 · 2466 阅读 · 0 评论 -
Verilog HDL 学习笔记3-Latch
Verilog HDL 学习笔记3-Latch 第一次接触Latch是在大二学习数电的时候,那时候Latch被翻译成锁存器,当时还纠结着锁存器和寄存器的区别(要是当时我知道他俩的英文名叫latch和register我还纠结个P)。扯远了,话不多说,该说说latch与verilog的联系。 还是照惯例,首先必须放上关于latch的定义和解释。ALTERA 的reco原创 2013-11-05 16:59:19 · 1730 阅读 · 0 评论