Cadence Allegro16.5使用技巧问题总结贴

最新推荐文章于 2023-11-10 17:58:42 发布

阳光守望者Coder

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分类专栏： PCB 文章标签： Cadence Allegro PCB Layout

本文链接：https://blog.csdn.net/u012246376/article/details/44784293

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本文总结了Cadence Allegro16.5的使用技巧，包括自动布线转45度角、调整系统字体大小、隐藏覆铜、添加测试点、修改边框圆角、实时显示走线长度、锁定/解锁元器件、保护手动布线不被自动布线覆盖、生成钻孔文件等关键操作，帮助提升PCB设计效率。

摘要由CSDN通过智能技术生成

1.ALLEGRO 自动布线后,为直角调整成45度角走线:Route-Gloss-Parameters-Convertcorner to arc。
2.ALLEGRO系统菜单字体太小修改：Setup-User PreferencesEditor-Ui-Fonts-fontsize中Value改大点，默认12改为14就差不多了。
3.隐藏覆铜：Setup-User Preferences Editor-
Display-shape_fill-no_shape_fill打钩。
覆铜设置:Shape-Global Dynamic Parameters.动态填充方式：Smooth、Rough、Disable,Smooth完全显示避让效果,Rough：铜皮避让显示不完全, Disabled：不显示铜皮避让效果。覆铜时可以先采用后两种，可以加快布线及DRC检查的速度，但是出Artwork时,通过Updateto Smooth转换成过来。动态铜皮的避让间距Clearances-Thru pin-Oversizevalue加10mil其他默认。
合并两块铜皮：Shape-Merge Shapes然后分别点击这两块铜皮。
4.添加测试点:Manufacture-Testprep-Automatic进行设置
5.allegro布线完成后，对一些要进行修改调整Route-Slide,有三种模式可以选择。
6.撤销已经放置好的元件，框选元件右键Unplace component。
7. 在摆放元件时为方便需要关闭飞线：Display–Blank Rats–All 。
8.查找某一元件，Find对话框-Find By Name-Symbol(or Pin)-name输入元件名，Enter.
9.约束规则设定：Setup-Constraints-Constraint Manager进