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笔记
slymp
这个作者很懒,什么都没留下…
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Sigma-Delta ADC原理
Sigma-Delta ADC原理原创 2023-06-01 11:56:31 · 523 阅读 · 0 评论 -
2021-03-16
Verilog时钟切换时钟切换出现问题的原因是:无法预测切换信号与新旧时钟的相位关系举例:以系统切换两个相同频率时钟源为例子,时钟周期均为10us,高低电平各占5us1.系统当前的时钟相位处于下降沿后1us处,(低电平才开始1us)2.此刻切换至别一个同频时钟源,新时钟相位处于上升沿后4us处(高电平还剩1us)3.可知,此刻切换时钟,相当于向系统输送了一个2us周期的高频时钟。(低电平1us,高电平1us)其他极限情况下可能造成在切换时钟时,高电平或低电平持续时间极窄。...原创 2021-03-16 17:23:43 · 96 阅读 · 0 评论 -
移除时间和恢复时间
移除时间和恢复时间指的都是复位信号撤消的时机。是时钟有效沿与复位信号的间隔时间。复位信号不能在时钟有效沿时刻撤消,否则会有如下问题恢复时间:如果复位信号在时钟有效沿之前撤消,并且离时间有效沿非常接近,再加上时间有效沿的离散性,那么极有可能一部份触发器仍处于复位状态中而对时钟沿没有响应,而一部份触发器有响应,那么从这一个时钟开始,电路的状态已经出错了。移除时间:如果复位信号在时钟有效沿之后撤消,并且离时间有效沿非常接近,再加上时间有效沿的离散性,那么极有可能一部份触发器从复位状态中恢复并响应了时钟原创 2020-09-28 16:12:06 · 4137 阅读 · 0 评论 -
恢复时间和移除时间
这里写自定义目录标题欢迎使用Markdown编辑器新的改变功能快捷键合理的创建标题,有助于目录的生成如何改变文本的样式插入链接与图片如何插入一段漂亮的代码片生成一个适合你的列表创建一个表格设定内容居中、居左、居右SmartyPants创建一个自定义列表如何创建一个注脚注释也是必不可少的KaTeX数学公式新的甘特图功能,丰富你的文章UML 图表FLowchart流程图导出与导入导出导入欢迎使用Markdown编辑器你好! 这是你第一次使用 Markdown编辑器 所展示的欢迎页。如果你想学习如何使用Mar原创 2020-09-28 15:51:03 · 552 阅读 · 0 评论