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原创 Go! 2014
今天是第二个quarter的第一天,试听了四节课,明天计划继续试听三节,周三还有两节需要听的课。从上个quarter得出的经验(教训),选对课是非常重要的。“对”与“不对”作为一个命题的答案虽然很难衡量,但是有一点是永远不错的:多学习一点总归是没有坏处的。好比如虽然上学期256感觉特别坑,但是为了完成作业了解了不少algorithm的概念,当然也学了很多algorithm,不过鉴于都是图这个领域的
2014-01-07 14:38:38
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原创 Verilog(2): Testbench
以test Add_half作为例子,testbench 关键字initialmodule t_Add_half();wire sum, c_out;reg a,b;Add_half M1 (c_out, sum, a, b); //UUT (Unit Under Test)initial begin//Time out #100 $finish;
2014-01-05 07:33:39
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原创 Verilog学习札记(1):Structural models of combinational logic
Verilog所描述的I-O关系可以分为两类:structural view: similar to creating a schematicbehavior view: could be a simple boolean equation model, a register transfer level (RTL) model or an algorithmVerilog包含了26组
2014-01-04 08:49:03
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原创 ModelSim仿真流程
Basic simulation workflow for ModelSim:1. Create a new directory and copy design files into itI have already created a new directory D:/Verilog/tutorial2. Start ModelSimFile-Change Directory a
2014-01-04 06:30:04
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android基于opencv边缘检测
2014-02-09
android face detection人脸识别app
2014-02-09
空空如也
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