Xilinx SDK编译移植c++项目到zynq7020

新建Application Project

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测试代码

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应用工程上右键编译

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出现编译报错

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查看报错的内容,发现是下载的sdk源编译器库代码报错,排查了很多原因(中文空格、中文字符等),因为是源码库,基本上也不可能出现这种问题。在报错代码的下方出现的错误代码为:

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怀疑该头文件加密解密格式出错,更换加密策略,成功解决其报错问题,生成.elf可执行文件。

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向7020移植可执行文件,chmod后执行报错

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error while loading shared libraries:libgcc_s.so.1提示无该动态库文件和目录
了解动态库链接过程:静态库是在编译阶段链接到可执行文件,而动态库是在执行过程中链接到可执行文件-->查看7020中lib和usr/lib下发现确实缺失该库

解决方法:
查看.elf文件中的Dynamic Section模块如下:

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需要上图中四个动态库;
去SDK的交叉编译器中找到上述的库,路径为:

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将上述所缺少的依赖文件通过FileZilla或者MobaXterm上传到7020的/lib文件夹下;
注意:windows下的libstdc++.so.6文件显示大小为0KB,不正确的上传方式会导致执行过程中出现lib文件too short的问题;上传到7020/lib文件夹下的libstdc++.so.6等文件要保证其大小正确(使用FileZilla不会出错,上传完成之后检查所传文件的大小),此时能够解决全部问题,执行.elf文件后在终端能够成功打印出hello cpp!!!的信息
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Tinyriscv是一个基于RISC-V架构的处理器核。要将Tinyriscv移植Zynq7020 FPGA上,可以按照以下步骤进行操作: 1. 首先,根据引用\[1\]中的配置文件tinyriscv.cfg,设置JTAG连接和目标设备。确保正确设置了芯片名称、IR长度和预期ID。 2. 然后,根据引用\[2\]中的说明,选择一个未使用的管脚来绑定Tinyriscv的JTAG接口。这个管脚不能与FPGA自身的JTAG接口冲突。 3. 接下来,根据引用\[3\]中提供的链接,下载Tinyriscv的master v2.4版本代码。可以使用Git克隆到本地。 4. 在移植过程中,需要使用终端软件,如Cygwin。确保已经安装了Cygwin,并按照引用\[3\]中的教程进行配置。 5. 在移植过程中,需要根据Zynq7020 FPGA的具体情况进行适配和配置。这包括设置时钟、引脚映射、外设接口等。 6. 最后,根据移植后的配置,使用JTAG工具将Tinyriscv固件加载到Zynq7020 FPGA上,并进行验证和测试。 需要注意的是,移植Tinyriscv到Zynq7020 FPGA是一个复杂的过程,需要对FPGA和RISC-V架构有一定的了解。建议参考相关文档和资料,以确保正确完成移植过程。 #### 引用[.reference_title] - *1* *2* *3* [手把手教你移植 tinyriscv 到FPGA上](https://blog.csdn.net/qq_44447544/article/details/123251073)[target="_blank" data-report-click={"spm":"1018.2226.3001.9630","extra":{"utm_source":"vip_chatgpt_common_search_pc_result","utm_medium":"distribute.pc_search_result.none-task-cask-2~all~insert_cask~default-1-null.142^v91^insertT0,239^v3^insert_chatgpt"}} ] [.reference_item] [ .reference_list ]
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