上周帮助T12nm A55训练营学员debug一个Calibre LVS问题,小编觉得挺好的一个问题。这个问题之前没有遇到过,今天分享给大家。
数字IC后端先进工艺设计实现之TSMC 12nm 6Track工艺数字IC后端实现重点难点盘点
下图所示为Calibre LVS的报告。从报告中看到当前LVS 只有Instance INCORRECT,即只有17个instance对不上,其他net数量,port数量都是完全对上的。
通过高亮这17个错误,我们发现这里是报SOURCE多出17个instance,而在layout中找不到这些cell。
确实通过dbGet top.insts.name $XRC_CG_HIER_INST504 也获取不到!
于是小编就打开A55 chipfinish后的gate level netlist。发现RC_CG_MOD_504这是一个空module。