2019.9.4 Xilinx FPGA Zynq petaLinux 保留内存并制作BOOT.BIN、uimage 及文件系统

本文参考: https://xilinx-wiki.atlassian.net/wiki/spaces/A/pages/18841683/Linux+Reserved+Memory
如有错误之处还请不吝赐教!
软件版本:Vivado 2018.2 ,petalinux 2018.2,Ubuntu 16.04
1、安装petalinux 2018.2 和 Vivado 2018.2
petalinux安装教程:https://blog.csdn.net/leon_zeng0/article/details/82766472
Vivado 2018.2安装教程:https://blog.csdn.net/q774318039a/article/details/86603812
2、准备工作
设置petalinux和交叉编译工具链在命令窗口输入:
source /opt/pkg/petalinux/settings.sh
source /opt/Xilinx/Vivado/2018.2/settings64.sh

复制vivado 项目中生成的.sdk到指定路径(如何生成sdk,https://blog.csdn.net/long_fly/article/details/78727813
3、创建工程以及更改设备树设置保留内存
创建工程:petalinux-create -t project -n prj_resmem --template zynq
然后
cd prj_resmem /project-spec/meta-user/recipes-bsp/device-tree/files/
更改 system-user.dtsi为:

/include/ "system-conf.dtsi"
/ {
	reserved-memory {
		#address-cells = <1>;
		#size-cells = <1>;
		ranges;

		reserved: buffer@0x10000000 {
			 no-map;
			 reg = <0x10000000 0x10000000>;
		};
	};

	reserved-driver@0 {
		compatible = "xlnx,reserved-memory";
		memory-region = <&reserved>;
	};
	
};

设置地址 (base address 0x1000_0000, size 0x1000_0000 )
4、通过.sdk配置环境
petalinux-config --get-hw-description DIR_where_you_put_the_design_1_wrapper.sdk
在这里插入图片描述
配置SD卡启动 Image packaing configration–>file system type or rootfs–> SD card
5、进一步配置和编译项目
*编译项目并生成BOOT.BIN
petalinux-build
petalinux-package -boot --fsbl image/linux/zynq_fsbl.elf --fpga --u-boot --force
需要使用:BOOT.BIN, image.ub and rootfs.cpio. 三个文件
在这里插入图片描述
6、SD卡化分区以及解压文件系统
*将SD卡化分区为:FAT和EXT4
*将BOOT.BIN, image.ub拷贝到FAT
*将rootfs.cpio拷贝到EXT4并解压
sudo pax -rvf rootfs.cpio
7、最后启动我们的系统

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Xilinx FPGA Zynq 7020最小系统板原理图是指Zynq 7020 FPGA芯片在最简化的系统板上的电路连接图。该芯片是Xilinx公司的一款可编程逻辑器件,同时还集成了ARM处理器核。最小系统板原理图展示了这个芯片与其他元件之间的连接方式和电路设计。 Zynq 7020最小系统板原理图一般包含以下组成部分: 1. Zynq 7020 FPGA芯片:原理图中会标注芯片引脚的连接情况,如外部引脚与其他器件的接口连接。 2. ARM处理器核:Zynq 7020芯片内集成了ARM处理器核,原理图中会显示其与其他器件的连接,如存储器、外设设备等。 3. 存储器:原理图中会展示Zynq 7020芯片与各种存储器之间的连接关系,如DDR3内存、Flash存储器等。 4. 外设设备:原理图中会描绘与Zynq 7020芯片连接的各种外设设备,例如串口通信、以太网接口、USB接口等。 5. 时钟源:原理图中会显示为Zynq 7020芯片提供时钟的外部时钟源,如晶体振荡器或时钟发生器。 6. 电源管理:原理图中会显示供电芯片、稳压器等电源管理元件与Zynq 7020芯片之间的连接,确保芯片正常运行所需的电源条件。 7. 连接线和引脚:原理图会标注各种信号线、电源线以及引脚的连接方式和连接关系,以便设计者参考和布线。 从Zynq 7020最小系统板原理图可以了解到芯片与其他外围器件的连接方式和电路设计,为开发者提供了设计和开发基于Zynq 7020芯片的嵌入式系统的参考和指导。
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