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RSS订阅原创 如何用VCS+Verdi仿真Xilinx IP
文章目录如何用VCS+Verdi仿真Xilinx IP1. VCS以及Vivado的版本问题2. 使用VCS编译Vivado的IP库3. 使用Vivado工具调用VCS进行仿真1.新建带有IP的工程2.从vivado工具中调用VCS进行仿真4. 从Vivado中导出VCS的仿真脚本5. 编写Makefile脚本仿真如何用VCS+Verdi仿真Xilinx IP1. VCS以及Vivado的版本问题工欲善其事必先利其器，我们第一步要做的事情就是安装相关的工具，关于具体怎么安装vivado以及vcs、ve
2021-07-02 18:56:14
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原创 从零开始搭建一个智能处理器(一)
文章目录从零开始搭建一个智能处理器(一)1.背景介绍2.自定义一份极简指令集架构3.四条指令的硬件电路实现3.1 MOV指令数据通路3.2 Load指令数据通路3.3 Store指令数据通路3.4 MAC指令数据通路3.5 所有指令整体数据通路4.智能处理器的verilog实现从零开始搭建一个智能处理器(一)1.背景介绍2.自定义一份极简指令集架构我们在这里可以仿照RISC-V指令集定义一份专门用于人工智能领域的极简的16位指令集，该指令集非常简单，只有4条指令，分别是Load、Store、MAC、
2021-04-08 16:00:30
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原创 hreadyout和hready_in的区别
文章目录AHB协议中slave的HREADYOUT和HREADYIN的区别没有hready_in会发生什么有hready_in会发生什么AHB协议中slave的HREADYOUT和HREADYIN的区别HREADYOUT：用于指示slave准备好接收master发过来的一笔传输HREADYIN：用于指示slave的上一笔传输是否结束没有hready_in会发生什么由于AHB是支持pipeline传输的，所以当前的cycle会是上一个slave的data phase，也是下一个slave的ad
2021-01-21 17:01:41
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原创 建立时间和保持时间
文章目录建立时间和保持时间1. 建立时间和保持时间的概念2. 建立时间和保持时间如何约束时序电路2.1 建立时间约束2.2 保持时间约束3. 为什么触发器会有建立时间和保持时间建立时间和保持时间1. 建立时间和保持时间的概念建立时间tsu：所谓建立时间就是说为了保证D触发器的输出是稳定的，数据必须在时钟上升沿tsu时间之前保持稳定，否则D触发器的输出就是不稳定的。保持时间thold：所谓保持时间就是说为了保证D触发器的输出是稳定的，数据必须在时钟上升沿来之后继续保持thold时间的稳定，否
2021-01-02 22:40:25
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转载 C/C++ 中typedef关键字
文章目录C/C++ 中typedef关键字1.简介2.1. 常规变量类型定义2.2. 指针类型定义2.3. 结构体定义2.4. 数组类型定义2.5. 函数定义2.5.1 函数声明2.5.2 函数指针C/C++ 中typedef关键字1.简介typedef 为 C 语言的关键字，作用是 为一种数据类型定义一个新名字。比如人们常常使用 typedef 来编写更美观和可读的代码。所谓美观，意指 typedef 能隐藏笨拙的语法构造以及平台相关的数据类型，从而** 增强可移植性以及未来的可维护性**。这里的
2020-12-28 11:44:37
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原创 verilog FSM为什么要使用one hot去编码状态
verilog FSM为什么要使用one hot去编码状态假设我们有四个状态A B C D:编码规则1：A = 2’b00B = 2’b01C = 2’b10D = 2’b11编码规则2：A = 4’b0001B = 4’b0010C = 4’b0100D = 4’b1000假设存在如下状态转移关系编码规则1针对编码规则1，我们可以这样描述其状态转移关系：module top_module( input in, input [1:0] state,
2020-12-27 21:45:22
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原创 RISC-V GCC工具链种类
RISC-V GCC工具链种类RISC-V GCC工具链种类工具链分类RISC-V GCC工具链种类GCC工具链支持不同的处理器架构，不同处理器架构的GCC工具链会有不同的命名。当前RISC-V GCC工具链有以下几个版本。1、riscv32-unknown-linux-gnu-2、riscv64-unknown-linux-gnu-3、riscv32-unknown-elf-4、riscv64-unknown-elf-5、riscv64-multilib-elf-6、riscv64-liu
2020-06-18 19:26:40
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空空如也
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